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https://github.com/c64scene-ar/llvm-6502.git
synced 2025-04-09 16:45:03 +00:00
Add missing test cases for ARM VLD3 (single 3-element structure to all lanes)
instructions. git-svn-id: https://llvm.org/svn/llvm-project/llvm/trunk@155453 91177308-0d34-0410-b5e6-96231b3b80d8
This commit is contained in:
parent
2c66edf434
commit
24e767d076
@ -1734,6 +1734,25 @@
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0xcf 0x1a 0xe0 0xf4
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# CHECK: vld3.32 {d17[1], d19[1], d21[1]}, [r0]
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# CHECK: vld3.8 {d0[], d1[], d2[]}, [r4]
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0x0f 0x0e 0xa4 0xf4
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# CHECK: vld3.8 {d0[], d1[], d2[]}, [r4]!
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0x0d 0x0e 0xa4 0xf4
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# CHECK: vld3.8 {d0[], d2[], d4[]}, [r4], r5
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0x25 0x0e 0xa4 0xf4
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# CHECK: vld3.16 {d0[], d2[], d4[]}, [r4]
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0x6f 0x0e 0xa4 0xf4
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# CHECK: vld3.16 {d0[], d1[], d2[]}, [r4]!
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0x4d 0x0e 0xa4 0xf4
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# CHECK: vld3.16 {d0[], d2[], d4[]}, [r4], r5
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0x65 0x0e 0xa4 0xf4
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# CHECK: vld3.32 {d0[], d1[], d2[]}, [r4]
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0x8f 0x0e 0xa4 0xf4
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# CHECK: vld3.32 {d0[], d1[], d2[]}, [r4]!
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0x8d 0x0e 0xa4 0xf4
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# CHECK: vld3.32 {d0[], d2[], d4[]}, [r4], r5
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0xa5 0x0e 0xa4 0xf4
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0x3f 0x03 0xe0 0xf4
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# CHECK: vld4.8 {d16[1], d17[1], d18[1], d19[1]}, [r0, :32]
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0x4f 0x07 0xe0 0xf4
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@ -1475,6 +1475,25 @@
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0xe0 0xf9 0xcf 0x1a
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# CHECK: vld3.32 {d17[1], d19[1], d21[1]}, [r0]
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0xa4 0xf9 0x0f 0x0e
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# CHECK: vld3.8 {d0[], d1[], d2[]}, [r4]
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0xa4 0xf9 0x0d 0x0e
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# CHECK: vld3.8 {d0[], d1[], d2[]}, [r4]!
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0xa4 0xf9 0x25 0x0e
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# CHECK: vld3.8 {d0[], d2[], d4[]}, [r4], r5
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0xa4 0xf9 0x6f 0x0e
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# CHECK: vld3.16 {d0[], d2[], d4[]}, [r4]
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0xa4 0xf9 0x4d 0x0e
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# CHECK: vld3.16 {d0[], d1[], d2[]}, [r4]!
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0xa4 0xf9 0x65 0x0e
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# CHECK: vld3.16 {d0[], d2[], d4[]}, [r4], r5
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0xa4 0xf9 0x8f 0x0e
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# CHECK: vld3.32 {d0[], d1[], d2[]}, [r4]
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0xa4 0xf9 0x8d 0x0e
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# CHECK: vld3.32 {d0[], d1[], d2[]}, [r4]!
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0xa4 0xf9 0xa5 0x0e
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# CHECK: vld3.32 {d0[], d2[], d4[]}, [r4], r5
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0xe0 0xf9 0x3f 0x03
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# CHECK: vld4.8 {d16[1], d17[1], d18[1], d19[1]}, [r0, :32]
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0xe0 0xf9 0x4f 0x07
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