mirror of
https://github.com/c64scene-ar/llvm-6502.git
synced 2025-07-19 02:25:01 +00:00
ARM assembly parsing and encoding for four-register VST1.
git-svn-id: https://llvm.org/svn/llvm-project/llvm/trunk@145450 91177308-0d34-0410-b5e6-96231b3b80d8
This commit is contained in:
@@ -2204,10 +2204,14 @@ static DecodeStatus DecodeVSTInstruction(llvm::MCInst &Inst, unsigned Insn,
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case ARM::VST1d16Twb_register:
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case ARM::VST1d32Twb_register:
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case ARM::VST1d64Twb_register:
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case ARM::VST1d8Q_UPD:
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case ARM::VST1d16Q_UPD:
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case ARM::VST1d32Q_UPD:
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case ARM::VST1d64Q_UPD:
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case ARM::VST1d8Qwb_fixed:
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case ARM::VST1d16Qwb_fixed:
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case ARM::VST1d32Qwb_fixed:
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case ARM::VST1d64Qwb_fixed:
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case ARM::VST1d8Qwb_register:
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case ARM::VST1d16Qwb_register:
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case ARM::VST1d32Qwb_register:
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case ARM::VST1d64Qwb_register:
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case ARM::VST2d8_UPD:
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case ARM::VST2d16_UPD:
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case ARM::VST2d32_UPD:
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@@ -2268,14 +2272,6 @@ static DecodeStatus DecodeVSTInstruction(llvm::MCInst &Inst, unsigned Insn,
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// Second input register
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switch (Inst.getOpcode()) {
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case ARM::VST1d8Q:
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case ARM::VST1d16Q:
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case ARM::VST1d32Q:
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case ARM::VST1d64Q:
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case ARM::VST1d8Q_UPD:
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case ARM::VST1d16Q_UPD:
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case ARM::VST1d32Q_UPD:
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case ARM::VST1d64Q_UPD:
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case ARM::VST2d8:
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case ARM::VST2d16:
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case ARM::VST2d32:
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@@ -2330,14 +2326,6 @@ static DecodeStatus DecodeVSTInstruction(llvm::MCInst &Inst, unsigned Insn,
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// Third input register
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switch (Inst.getOpcode()) {
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case ARM::VST1d8Q:
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case ARM::VST1d16Q:
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case ARM::VST1d32Q:
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case ARM::VST1d64Q:
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case ARM::VST1d8Q_UPD:
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case ARM::VST1d16Q_UPD:
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case ARM::VST1d32Q_UPD:
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case ARM::VST1d64Q_UPD:
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case ARM::VST2q8:
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case ARM::VST2q16:
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case ARM::VST2q32:
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@@ -2380,14 +2368,6 @@ static DecodeStatus DecodeVSTInstruction(llvm::MCInst &Inst, unsigned Insn,
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// Fourth input register
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switch (Inst.getOpcode()) {
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case ARM::VST1d8Q:
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case ARM::VST1d16Q:
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case ARM::VST1d32Q:
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case ARM::VST1d64Q:
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case ARM::VST1d8Q_UPD:
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case ARM::VST1d16Q_UPD:
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case ARM::VST1d32Q_UPD:
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case ARM::VST1d64Q_UPD:
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case ARM::VST2q8:
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case ARM::VST2q16:
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case ARM::VST2q32:
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