From 851cba0b25b3a71c9f9f99d797b4a629cfbc6da4 Mon Sep 17 00:00:00 2001 From: Thomas Harte Date: Sat, 22 Feb 2020 12:34:16 -0500 Subject: [PATCH 01/28] Corrects lambda capture. --- OSBindings/Mac/Clock SignalTests/68000ComparativeTests.mm | 2 +- 1 file changed, 1 insertion(+), 1 deletion(-) diff --git a/OSBindings/Mac/Clock SignalTests/68000ComparativeTests.mm b/OSBindings/Mac/Clock SignalTests/68000ComparativeTests.mm index 7448ec658..38aa41718 100644 --- a/OSBindings/Mac/Clock SignalTests/68000ComparativeTests.mm +++ b/OSBindings/Mac/Clock SignalTests/68000ComparativeTests.mm @@ -149,7 +149,7 @@ } // Run the thing. - const auto comparitor = [] { + const auto comparitor = [=] { // Test the end state. NSDictionary *const finalState = test[@"final state"]; const auto state = test68000->processor.get_state(); From 825b68e5c451fe59fc8c5a0b57e24bb6faa33ef2 Mon Sep 17 00:00:00 2001 From: Thomas Harte Date: Sat, 22 Feb 2020 12:34:47 -0500 Subject: [PATCH 02/28] Adds separate entry points for zexall and zexdoc. --- .../Mac/Clock SignalTests/ZexallTests.swift | 15 ++++++++++++--- 1 file changed, 12 insertions(+), 3 deletions(-) diff --git a/OSBindings/Mac/Clock SignalTests/ZexallTests.swift b/OSBindings/Mac/Clock SignalTests/ZexallTests.swift index ced5b6d8d..074fefc03 100644 --- a/OSBindings/Mac/Clock SignalTests/ZexallTests.swift +++ b/OSBindings/Mac/Clock SignalTests/ZexallTests.swift @@ -14,8 +14,8 @@ class ZexallTests: XCTestCase, CSTestMachineTrapHandler { fileprivate var done = false fileprivate var output = "" - func testZexall() { - if let filename = Bundle(for: type(of: self)).path(forResource: "zexdoc", ofType: "com") { + private func runTest(_ name: String) { + if let filename = Bundle(for: type(of: self)).path(forResource: name, ofType: "com") { if let testData = try? Data(contentsOf: URL(fileURLWithPath: filename)) { // install test program, at the usual CP/M place @@ -47,10 +47,11 @@ class ZexallTests: XCTestCase, CSTestMachineTrapHandler { var cyclesToDate: TimeInterval = 0 let startDate = Date() var printDate = Date() + let printMhz = false while !done { machine.runForNumber(ofCycles: cyclesPerIteration) cyclesToDate += TimeInterval(cyclesPerIteration) - if printDate.timeIntervalSinceNow < -5.0 { + if printMhz && printDate.timeIntervalSinceNow < -5.0 { print("\(cyclesToDate / -startDate.timeIntervalSinceNow) Mhz") printDate = Date() } @@ -131,6 +132,14 @@ class ZexallTests: XCTestCase, CSTestMachineTrapHandler { } } + func testZexAll() { + runTest("zexall") + } + + func testZexDoc() { + runTest("zexdoc") + } + func testMachine(_ testMachine: CSTestMachine, didTrapAtAddress address: UInt16) { let testMachineZ80 = testMachine as! CSTestMachineZ80 switch address { From 2370575eb52b736bb96d956ea9b677fd1777e27c Mon Sep 17 00:00:00 2001 From: Thomas Harte Date: Sat, 22 Feb 2020 15:49:36 -0500 Subject: [PATCH 03/28] Starts introducing the Patrik Rak tests. --- Machines/AmstradCPC/AmstradCPC.cpp | 5 +- .../Clock Signal.xcodeproj/project.pbxproj | 6 + .../xcschemes/Clock Signal.xcscheme | 2 +- .../Patrik Rak Z80 Tests/changes.txt | 3 + .../Patrik Rak Z80 Tests/license.txt | 19 + .../Patrik Rak Z80 Tests/readme.txt | 28 + .../Patrik Rak Z80 Tests/src/Makefile | 34 + .../Patrik Rak Z80 Tests/src/crctab.asm | 1037 +++++++++++++ .../Patrik Rak Z80 Tests/src/idea.asm | 291 ++++ .../Patrik Rak Z80 Tests/src/loader.bas | 2 + .../Patrik Rak Z80 Tests/src/main.asm | 149 ++ .../Patrik Rak Z80 Tests/src/print.asm | 82 + .../Patrik Rak Z80 Tests/src/testmacros.asm | 103 ++ .../Patrik Rak Z80 Tests/src/tests.asm | 1379 +++++++++++++++++ .../Patrik Rak Z80 Tests/src/z80ccf.asm | 18 + .../Patrik Rak Z80 Tests/src/z80doc.asm | 18 + .../Patrik Rak Z80 Tests/src/z80docflags.asm | 18 + .../Patrik Rak Z80 Tests/src/z80flags.asm | 18 + .../Patrik Rak Z80 Tests/src/z80full.asm | 18 + .../Patrik Rak Z80 Tests/src/z80memptr.asm | 21 + .../Patrik Rak Z80 Tests/z80ccf.tap | Bin 0 -> 14219 bytes .../Patrik Rak Z80 Tests/z80doc.tap | Bin 0 -> 13758 bytes .../Patrik Rak Z80 Tests/z80docflags.tap | Bin 0 -> 13758 bytes .../Patrik Rak Z80 Tests/z80flags.tap | Bin 0 -> 13758 bytes .../Patrik Rak Z80 Tests/z80full.tap | Bin 0 -> 13758 bytes .../Patrik Rak Z80 Tests/z80memptr.tap | Bin 0 -> 13758 bytes .../Clock SignalTests/PatrikRakTests.swift | 181 +++ 27 files changed, 3430 insertions(+), 2 deletions(-) create mode 100644 OSBindings/Mac/Clock SignalTests/Patrik Rak Z80 Tests/changes.txt create mode 100644 OSBindings/Mac/Clock SignalTests/Patrik Rak Z80 Tests/license.txt create mode 100644 OSBindings/Mac/Clock SignalTests/Patrik Rak Z80 Tests/readme.txt create mode 100644 OSBindings/Mac/Clock SignalTests/Patrik Rak Z80 Tests/src/Makefile create mode 100644 OSBindings/Mac/Clock SignalTests/Patrik Rak Z80 Tests/src/crctab.asm create mode 100644 OSBindings/Mac/Clock SignalTests/Patrik Rak Z80 Tests/src/idea.asm create mode 100644 OSBindings/Mac/Clock SignalTests/Patrik Rak Z80 Tests/src/loader.bas create mode 100644 OSBindings/Mac/Clock SignalTests/Patrik Rak Z80 Tests/src/main.asm create mode 100644 OSBindings/Mac/Clock SignalTests/Patrik Rak Z80 Tests/src/print.asm create mode 100644 OSBindings/Mac/Clock SignalTests/Patrik Rak Z80 Tests/src/testmacros.asm create mode 100644 OSBindings/Mac/Clock SignalTests/Patrik Rak Z80 Tests/src/tests.asm create mode 100644 OSBindings/Mac/Clock SignalTests/Patrik Rak Z80 Tests/src/z80ccf.asm create mode 100644 OSBindings/Mac/Clock SignalTests/Patrik Rak Z80 Tests/src/z80doc.asm create mode 100644 OSBindings/Mac/Clock SignalTests/Patrik Rak Z80 Tests/src/z80docflags.asm create mode 100644 OSBindings/Mac/Clock SignalTests/Patrik Rak Z80 Tests/src/z80flags.asm create mode 100644 OSBindings/Mac/Clock SignalTests/Patrik Rak Z80 Tests/src/z80full.asm create mode 100644 OSBindings/Mac/Clock SignalTests/Patrik Rak Z80 Tests/src/z80memptr.asm create mode 100644 OSBindings/Mac/Clock SignalTests/Patrik Rak Z80 Tests/z80ccf.tap create mode 100644 OSBindings/Mac/Clock SignalTests/Patrik Rak Z80 Tests/z80doc.tap create mode 100644 OSBindings/Mac/Clock SignalTests/Patrik Rak Z80 Tests/z80docflags.tap create mode 100644 OSBindings/Mac/Clock SignalTests/Patrik Rak Z80 Tests/z80flags.tap create mode 100644 OSBindings/Mac/Clock SignalTests/Patrik Rak Z80 Tests/z80full.tap create mode 100644 OSBindings/Mac/Clock SignalTests/Patrik Rak Z80 Tests/z80memptr.tap create mode 100644 OSBindings/Mac/Clock SignalTests/PatrikRakTests.swift diff --git a/Machines/AmstradCPC/AmstradCPC.cpp b/Machines/AmstradCPC/AmstradCPC.cpp index 99d248090..a6b4a2375 100644 --- a/Machines/AmstradCPC/AmstradCPC.cpp +++ b/Machines/AmstradCPC/AmstradCPC.cpp @@ -1012,6 +1012,9 @@ template class ConcreteMachine: default: break; } + // Check whether the interrupt signal has changed the other way. + if(interrupt_timer_.request_has_changed()) z80_.set_interrupt_line(interrupt_timer_.get_request()); + // This implementation doesn't use time-stuffing; once in-phase waits won't be longer // than a single cycle so there's no real performance benefit to trying to find the // next non-wait when a wait cycle comes in, and there'd be no benefit to reproducing @@ -1228,7 +1231,7 @@ template class ConcreteMachine: KeyboardState key_state_; AmstradCPC::KeyboardMapper keyboard_mapper_; - uint8_t ram_[128 * 1024]; + uint8_t ram_[1024 * 1024]; }; } diff --git a/OSBindings/Mac/Clock Signal.xcodeproj/project.pbxproj b/OSBindings/Mac/Clock Signal.xcodeproj/project.pbxproj index 3763a8c49..9bf6104c7 100644 --- a/OSBindings/Mac/Clock Signal.xcodeproj/project.pbxproj +++ b/OSBindings/Mac/Clock Signal.xcodeproj/project.pbxproj @@ -817,6 +817,8 @@ 4BD67DCC209BE4D700AB2146 /* StaticAnalyser.cpp in Sources */ = {isa = PBXBuildFile; fileRef = 4BD67DCA209BE4D600AB2146 /* StaticAnalyser.cpp */; }; 4BD67DD0209BF27B00AB2146 /* Encoder.cpp in Sources */ = {isa = PBXBuildFile; fileRef = 4BD67DCE209BF27B00AB2146 /* Encoder.cpp */; }; 4BD67DD1209BF27B00AB2146 /* Encoder.cpp in Sources */ = {isa = PBXBuildFile; fileRef = 4BD67DCE209BF27B00AB2146 /* Encoder.cpp */; }; + 4BD91D732401960C007BDC91 /* STX.cpp in Sources */ = {isa = PBXBuildFile; fileRef = 4B7BA03323C58B1E00B98D9E /* STX.cpp */; }; + 4BD91D772401C2B8007BDC91 /* PatrikRakTests.swift in Sources */ = {isa = PBXBuildFile; fileRef = 4BD91D762401C2B8007BDC91 /* PatrikRakTests.swift */; }; 4BDA00DA22E60EE300AC3CD0 /* ROMRequester.xib in Resources */ = {isa = PBXBuildFile; fileRef = 4BDA00D922E60EE300AC3CD0 /* ROMRequester.xib */; }; 4BDA00DD22E622C200AC3CD0 /* ROMImages in Resources */ = {isa = PBXBuildFile; fileRef = 4BC9DF441D044FCA00F44158 /* ROMImages */; }; 4BDA00E022E644AF00AC3CD0 /* CSROMReceiverView.m in Sources */ = {isa = PBXBuildFile; fileRef = 4BDA00DF22E644AF00AC3CD0 /* CSROMReceiverView.m */; }; @@ -1696,6 +1698,7 @@ 4BD67DCE209BF27B00AB2146 /* Encoder.cpp */ = {isa = PBXFileReference; fileEncoding = 4; lastKnownFileType = sourcecode.cpp.cpp; path = Encoder.cpp; sourceTree = ""; }; 4BD67DCF209BF27B00AB2146 /* Encoder.hpp */ = {isa = PBXFileReference; fileEncoding = 4; lastKnownFileType = sourcecode.cpp.h; path = Encoder.hpp; sourceTree = ""; }; 4BD9137D1F311BC5009BCF85 /* i8255.hpp */ = {isa = PBXFileReference; fileEncoding = 4; lastKnownFileType = sourcecode.cpp.h; name = i8255.hpp; path = 8255/i8255.hpp; sourceTree = ""; }; + 4BD91D762401C2B8007BDC91 /* PatrikRakTests.swift */ = {isa = PBXFileReference; fileEncoding = 4; lastKnownFileType = sourcecode.swift; path = PatrikRakTests.swift; sourceTree = ""; }; 4BDA00D922E60EE300AC3CD0 /* ROMRequester.xib */ = {isa = PBXFileReference; lastKnownFileType = file.xib; path = ROMRequester.xib; sourceTree = ""; }; 4BDA00DE22E644AF00AC3CD0 /* CSROMReceiverView.h */ = {isa = PBXFileReference; lastKnownFileType = sourcecode.c.h; path = CSROMReceiverView.h; sourceTree = ""; }; 4BDA00DF22E644AF00AC3CD0 /* CSROMReceiverView.m */ = {isa = PBXFileReference; lastKnownFileType = sourcecode.c.objc; path = CSROMReceiverView.m; sourceTree = ""; }; @@ -3316,6 +3319,7 @@ 4BEF6AAB1D35D1C400E73575 /* DPLLTests.swift */, 4BBF49AE1ED2880200AB3669 /* FUSETests.swift */, 4B1414611B58888700E04248 /* KlausDormannTests.swift */, + 4BD91D762401C2B8007BDC91 /* PatrikRakTests.swift */, 4B14145F1B58885000E04248 /* WolfgangLorenzTests.swift */, 4B08A2741EE35D56008B7065 /* Z80InterruptTests.swift */, 4BDDBA981EF3451200347E61 /* Z80MachineCycleTests.swift */, @@ -4643,6 +4647,7 @@ 4BEF6AAA1D35CE9E00E73575 /* DigitalPhaseLockedLoopBridge.mm in Sources */, 4B778F3123A5F0CB0000D260 /* Keyboard.cpp in Sources */, 4B778F4A23A5F1FB0000D260 /* StaticAnalyser.cpp in Sources */, + 4BD91D772401C2B8007BDC91 /* PatrikRakTests.swift in Sources */, 4B680CE223A5553100451D43 /* 68000ComparativeTests.mm in Sources */, 4B778F3723A5F11C0000D260 /* Parser.cpp in Sources */, 4B778F4523A5F1CD0000D260 /* SegmentParser.cpp in Sources */, @@ -4780,6 +4785,7 @@ 4B778F0223A5EBA40000D260 /* MFMSectorDump.cpp in Sources */, 4BFCA1271ECBE33200AC40C1 /* TestMachineZ80.mm in Sources */, 4B778F3E23A5F17C0000D260 /* IWM.cpp in Sources */, + 4BD91D732401960C007BDC91 /* STX.cpp in Sources */, 4B778F1023A5EC5D0000D260 /* Drive.cpp in Sources */, 4B9D0C4F22C7E0CF00DE1AD3 /* 68000RollShiftTests.mm in Sources */, ); diff --git a/OSBindings/Mac/Clock Signal.xcodeproj/xcshareddata/xcschemes/Clock Signal.xcscheme b/OSBindings/Mac/Clock Signal.xcodeproj/xcshareddata/xcschemes/Clock Signal.xcscheme index a99eb0a5d..63be2c037 100644 --- a/OSBindings/Mac/Clock Signal.xcodeproj/xcshareddata/xcschemes/Clock Signal.xcscheme +++ b/OSBindings/Mac/Clock Signal.xcodeproj/xcshareddata/xcschemes/Clock Signal.xcscheme @@ -67,7 +67,7 @@ $@ + mktap $(basename $(word 2,$^)) 32768 <$(word 2,$^) >>$@ + +FILES := Makefile loader.bas $(addsuffix .asm,$(PROGS)) $(addsuffix .asm, $(SRCS)) + +dist: all + ln -s .. $(PKG) + cp *.tap $(PKG) + zip ../$(PKG).zip $(addprefix $(PKG)/src/, $(FILES)) $(PKG)/*.txt $(PKG)/*.tap + rm $(PKG)/*.tap + rm $(PKG) + +clean: + rm -rf *.out *.lst *.tap + +tidy: clean + rm -rf $(PROGS) diff --git a/OSBindings/Mac/Clock SignalTests/Patrik Rak Z80 Tests/src/crctab.asm b/OSBindings/Mac/Clock SignalTests/Patrik Rak Z80 Tests/src/crctab.asm new file mode 100644 index 000000000..4c397ce69 --- /dev/null +++ b/OSBindings/Mac/Clock SignalTests/Patrik Rak Z80 Tests/src/crctab.asm @@ -0,0 +1,1037 @@ +; CRC table for the standard 100000100110000010001110110110111 polynomial. +; Chunked little endian, the 256 LSBs first, the 256 MSBs last, for fast access. +; +; Copyright (C) 2012 Patrik Rak (patrik@raxoft.cz) +; +; This source code is released under the MIT license, see included license.txt. + +crctable: + db 0x00 ; 00 00000000 + db 0x96 ; 01 77073096 + db 0x2c ; 02 ee0e612c + db 0xba ; 03 990951ba + db 0x19 ; 04 076dc419 + db 0x8f ; 05 706af48f + db 0x35 ; 06 e963a535 + db 0xa3 ; 07 9e6495a3 + db 0x32 ; 08 0edb8832 + db 0xa4 ; 09 79dcb8a4 + db 0x1e ; 0a e0d5e91e + db 0x88 ; 0b 97d2d988 + db 0x2b ; 0c 09b64c2b + db 0xbd ; 0d 7eb17cbd + db 0x07 ; 0e e7b82d07 + db 0x91 ; 0f 90bf1d91 + db 0x64 ; 10 1db71064 + db 0xf2 ; 11 6ab020f2 + db 0x48 ; 12 f3b97148 + db 0xde ; 13 84be41de + db 0x7d ; 14 1adad47d + db 0xeb ; 15 6ddde4eb + db 0x51 ; 16 f4d4b551 + db 0xc7 ; 17 83d385c7 + db 0x56 ; 18 136c9856 + db 0xc0 ; 19 646ba8c0 + db 0x7a ; 1a fd62f97a + db 0xec ; 1b 8a65c9ec + db 0x4f ; 1c 14015c4f + db 0xd9 ; 1d 63066cd9 + db 0x63 ; 1e fa0f3d63 + db 0xf5 ; 1f 8d080df5 + db 0xc8 ; 20 3b6e20c8 + db 0x5e ; 21 4c69105e + db 0xe4 ; 22 d56041e4 + db 0x72 ; 23 a2677172 + db 0xd1 ; 24 3c03e4d1 + db 0x47 ; 25 4b04d447 + db 0xfd ; 26 d20d85fd + db 0x6b ; 27 a50ab56b + db 0xfa ; 28 35b5a8fa + db 0x6c ; 29 42b2986c + db 0xd6 ; 2a dbbbc9d6 + db 0x40 ; 2b acbcf940 + db 0xe3 ; 2c 32d86ce3 + db 0x75 ; 2d 45df5c75 + db 0xcf ; 2e dcd60dcf + db 0x59 ; 2f abd13d59 + db 0xac ; 30 26d930ac + db 0x3a ; 31 51de003a + db 0x80 ; 32 c8d75180 + db 0x16 ; 33 bfd06116 + db 0xb5 ; 34 21b4f4b5 + db 0x23 ; 35 56b3c423 + db 0x99 ; 36 cfba9599 + db 0x0f ; 37 b8bda50f + db 0x9e ; 38 2802b89e + db 0x08 ; 39 5f058808 + db 0xb2 ; 3a c60cd9b2 + db 0x24 ; 3b b10be924 + db 0x87 ; 3c 2f6f7c87 + db 0x11 ; 3d 58684c11 + db 0xab ; 3e c1611dab + db 0x3d ; 3f b6662d3d + db 0x90 ; 40 76dc4190 + db 0x06 ; 41 01db7106 + db 0xbc ; 42 98d220bc + db 0x2a ; 43 efd5102a + db 0x89 ; 44 71b18589 + db 0x1f ; 45 06b6b51f + db 0xa5 ; 46 9fbfe4a5 + db 0x33 ; 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8f 7d079eb1 + db 0xf0 ; 90 f00f9344 + db 0x87 ; 91 8708a3d2 + db 0x1e ; 92 1e01f268 + db 0x69 ; 93 6906c2fe + db 0xf7 ; 94 f762575d + db 0x80 ; 95 806567cb + db 0x19 ; 96 196c3671 + db 0x6e ; 97 6e6b06e7 + db 0xfe ; 98 fed41b76 + db 0x89 ; 99 89d32be0 + db 0x10 ; 9a 10da7a5a + db 0x67 ; 9b 67dd4acc + db 0xf9 ; 9c f9b9df6f + db 0x8e ; 9d 8ebeeff9 + db 0x17 ; 9e 17b7be43 + db 0x60 ; 9f 60b08ed5 + db 0xd6 ; a0 d6d6a3e8 + db 0xa1 ; a1 a1d1937e + db 0x38 ; a2 38d8c2c4 + db 0x4f ; a3 4fdff252 + db 0xd1 ; a4 d1bb67f1 + db 0xa6 ; a5 a6bc5767 + db 0x3f ; a6 3fb506dd + db 0x48 ; a7 48b2364b + db 0xd8 ; a8 d80d2bda + db 0xaf ; a9 af0a1b4c + db 0x36 ; aa 36034af6 + db 0x41 ; ab 41047a60 + db 0xdf ; ac df60efc3 + db 0xa8 ; ad a867df55 + db 0x31 ; ae 316e8eef + db 0x46 ; af 4669be79 + db 0xcb ; b0 cb61b38c + db 0xbc ; b1 bc66831a + db 0x25 ; b2 256fd2a0 + db 0x52 ; b3 5268e236 + db 0xcc ; b4 cc0c7795 + db 0xbb ; b5 bb0b4703 + db 0x22 ; b6 220216b9 + db 0x55 ; b7 5505262f + db 0xc5 ; b8 c5ba3bbe + db 0xb2 ; b9 b2bd0b28 + db 0x2b ; ba 2bb45a92 + db 0x5c ; bb 5cb36a04 + db 0xc2 ; bc c2d7ffa7 + db 0xb5 ; bd b5d0cf31 + db 0x2c ; be 2cd99e8b + db 0x5b ; bf 5bdeae1d + db 0x9b ; c0 9b64c2b0 + db 0xec ; c1 ec63f226 + db 0x75 ; c2 756aa39c + db 0x02 ; c3 026d930a + db 0x9c ; c4 9c0906a9 + db 0xeb ; c5 eb0e363f + db 0x72 ; c6 72076785 + db 0x05 ; c7 05005713 + db 0x95 ; c8 95bf4a82 + db 0xe2 ; c9 e2b87a14 + db 0x7b ; ca 7bb12bae + db 0x0c ; cb 0cb61b38 + db 0x92 ; cc 92d28e9b + db 0xe5 ; cd e5d5be0d + db 0x7c ; ce 7cdcefb7 + db 0x0b ; cf 0bdbdf21 + db 0x86 ; d0 86d3d2d4 + db 0xf1 ; d1 f1d4e242 + db 0x68 ; d2 68ddb3f8 + db 0x1f ; d3 1fda836e + db 0x81 ; d4 81be16cd + db 0xf6 ; d5 f6b9265b + db 0x6f ; d6 6fb077e1 + db 0x18 ; d7 18b74777 + db 0x88 ; d8 88085ae6 + db 0xff ; d9 ff0f6a70 + db 0x66 ; da 66063bca + db 0x11 ; db 11010b5c + db 0x8f ; dc 8f659eff + db 0xf8 ; dd f862ae69 + db 0x61 ; de 616bffd3 + db 0x16 ; df 166ccf45 + db 0xa0 ; e0 a00ae278 + db 0xd7 ; e1 d70dd2ee + db 0x4e ; e2 4e048354 + db 0x39 ; e3 3903b3c2 + db 0xa7 ; e4 a7672661 + db 0xd0 ; e5 d06016f7 + db 0x49 ; e6 4969474d + db 0x3e ; e7 3e6e77db + db 0xae ; e8 aed16a4a + db 0xd9 ; e9 d9d65adc + db 0x40 ; ea 40df0b66 + db 0x37 ; eb 37d83bf0 + db 0xa9 ; ec a9bcae53 + db 0xde ; ed debb9ec5 + db 0x47 ; ee 47b2cf7f + db 0x30 ; ef 30b5ffe9 + db 0xbd ; f0 bdbdf21c + db 0xca ; f1 cabac28a + db 0x53 ; f2 53b39330 + db 0x24 ; f3 24b4a3a6 + db 0xba ; f4 bad03605 + db 0xcd ; f5 cdd70693 + db 0x54 ; f6 54de5729 + db 0x23 ; f7 23d967bf + db 0xb3 ; f8 b3667a2e + db 0xc4 ; f9 c4614ab8 + db 0x5d ; fa 5d681b02 + db 0x2a ; fb 2a6f2b94 + db 0xb4 ; fc b40bbe37 + db 0xc3 ; fd c30c8ea1 + db 0x5a ; fe 5a05df1b + db 0x2d ; ff 2d02ef8d + +; EOF ; diff --git a/OSBindings/Mac/Clock SignalTests/Patrik Rak Z80 Tests/src/idea.asm b/OSBindings/Mac/Clock SignalTests/Patrik Rak Z80 Tests/src/idea.asm new file mode 100644 index 000000000..89bc722f7 --- /dev/null +++ b/OSBindings/Mac/Clock SignalTests/Patrik Rak Z80 Tests/src/idea.asm @@ -0,0 +1,291 @@ +; The Z80 tester. +; +; Copyright (C) 2012 Patrik Rak (patrik@raxoft.cz) +; +; This source code is released under the MIT license, see included license.txt. + +opsize equ 4+postccf ; Size of the tested instruction sequence. +datasize equ 16 ; Size of the tested registers and data. +vecsize equ opsize+datasize ; Size of entire test vector. + +test: ld (.spptr+1),sp + + if maskflags ; Keep mask for official flags. + ld a,(hl) + ld (.flagptr+1),a + endif + + inc hl + + ld de,vector ; Init the test vector, counter and shifter. + ld bc,vecsize + call .copy + + add hl,bc + + call .copy + + call .copy + + add hl,bc + + ld (.valptr+1),de + + inc de + + call .clear + + ld (.maskptr+1),de + + xor a + ld (de),a + inc de + + call .copy + + ld a,0x07 ; Make sure we get 0 + out (0xfe),a ; on MIC bit when doing IN. + + ld a,0xa9 ; Set I,R,AF' to known values. + ld i,a + ld r,a + or a + ex af,af + + ld bc,65535 ; Init CRC. + ld d,b + ld e,c + exx + + ld sp,data.regs + + ; Test vector sequence combinator. + +.loop ld hl,counter + ld de,shifter+1 + ld bc,vector + + macro combine base,count,offset:0,last:1 + repeat count + ld a,(bc) + xor (hl) + ex de,hl + xor (hl) + ld (base+offset+@#),a + if ( @# < count-1 ) | ! last + inc c + inc e + inc l + endif + endrepeat + endm + + ld a,(bc) + xor (hl) + ex de,hl + xor (hl) + cp 0x76 ; Skip halt. + jp z,.next + ld (.opcode),a + inc c + inc e + inc l + + ld a,(bc) + xor (hl) + ex de,hl + xor (hl) + ld (.opcode+1),a + cp 0x76 ; Skip halt... + jp nz,.ok + ld a,(.opcode) + and 0xdf ; ... with IX/IY prefix. + cp 0xdd + jp z,.next +.ok inc c + inc e + inc l + + combine .opcode,opsize-2,2,0 + combine data,datasize + + ; The test itself. + + pop af + pop bc + pop de + pop hl + pop ix + pop iy + ld sp,(data.sp) + +.opcode ds opsize +.continue + if memptr + ld hl,data + bit 0,(hl) + endif + + ld (data.sp),sp + ld sp,data.regstop + push iy + push ix + push hl + push de + push bc + push af + + ld hl,data + + if maskflags + ld a,(hl) +.flagptr and 0xff + + if ! onlyflags + ld (hl),a + endif + + endif + + ; CRC update. + + if ! onlyflags + ld b,datasize + endif + + if ! ( onlyflags & maskflags ) +.crcloop ld a,(hl) + endif + + exx + xor e + + ld l,a + ld h,crctable/256 + + ld a,(hl) + xor d + ld e,a + inc h + + ld a,(hl) + xor c + ld d,a + inc h + + ld a,(hl) + xor b + ld c,a + inc h + + ld b,(hl) + + exx + + if ! onlyflags + inc hl + djnz .crcloop + endif + + ; Multibyte counter with arbitrary bit mask. + +.next ld hl,countmask + ld de,counter + ld b,vecsize +.countloop ld a,(de) + or a + jr z,.countnext + dec a + and (hl) + ld (de),a + jp .loop +.countnext ld a,(hl) + ld (de),a + inc l + inc e + djnz .countloop + + ; Multibyte shifter with arbitrary bit mask. + +.maskptr ld hl,shiftmask +.valptr ld de,shifter + ld a,(de) + add a,a + neg + add (hl) + xor (hl) + and (hl) + ld (de),a + jp nz,.loop +.shiftloop inc l + inc e + ld a,e + cp shiftend % 256 + jr z,.exit + ld a,(hl) + dec a + xor (hl) + and (hl) + jr z,.shiftloop + ld (de),a + ld (.maskptr+1),hl + ld (.valptr+1),de + jp .loop + +.exit exx +.spptr ld sp,0 + ret + + ; Misc helper routines. + +.copy push hl + push bc + ldir + pop bc + pop hl + ret + +.clear push hl + push bc + ld h,d + ld l,e + ld (hl),0 + inc de + dec bc + ldir + pop bc + pop hl + ret + + align 256 + + include crctab.asm + +; If this moves from 0x8800, all tests which use this address +; will need to have their CRCs updated, so don't move it. + + align 256 +data +.regs ds datasize-4 +.regstop +.mem ds 2 +.sp ds 2 + +.jump + if postccf + ccf + else + inc bc + endif + jp test.continue + +; This entire workspace must be kept within single 256 byte page. + +vector ds vecsize +counter ds vecsize +countmask ds vecsize +shifter ds 1+vecsize +shiftend +shiftmask ds 1+vecsize + +; EOF ; diff --git a/OSBindings/Mac/Clock SignalTests/Patrik Rak Z80 Tests/src/loader.bas b/OSBindings/Mac/Clock SignalTests/Patrik Rak Z80 Tests/src/loader.bas new file mode 100644 index 000000000..a3f7fbe29 --- /dev/null +++ b/OSBindings/Mac/Clock SignalTests/Patrik Rak Z80 Tests/src/loader.bas @@ -0,0 +1,2 @@ + 10 CLEAR 32767:LOAD "" CODE:CLS + 20 RANDOMIZE USR 32768 diff --git a/OSBindings/Mac/Clock SignalTests/Patrik Rak Z80 Tests/src/main.asm b/OSBindings/Mac/Clock SignalTests/Patrik Rak Z80 Tests/src/main.asm new file mode 100644 index 000000000..cb2833b05 --- /dev/null +++ b/OSBindings/Mac/Clock SignalTests/Patrik Rak Z80 Tests/src/main.asm @@ -0,0 +1,149 @@ +; Main driver for the Z80 tester. +; +; Copyright (C) 2012 Patrik Rak (patrik@raxoft.cz) +; +; This source code is released under the MIT license, see included license.txt. + + org 0x8000 + +main: di + push iy + exx + push hl + + call printinit + + call print + db "Z80 " + testname + db " test" + db 23,32-13,1,127," 2012 RAXOFT",13,13,0 + + ld bc,0 + ld hl,testtable + jr .entry + +.loop push hl + push bc + call .test + pop bc + pop hl + + add a,b + ld b,a + + inc c + +.entry ld e,(hl) + inc hl + ld d,(hl) + inc hl + + ld a,d + or e + jr nz,.loop + + call print + db 13,"Result: ",0 + + ld a,b + or a + jr z,.ok + + call printdeca + + call print + db " of ",0 + + ld a,c + call printdeca + + call print + db " tests failed.",13,0 + jr .done + +.ok call print + db "all tests passed.",13,0 + +.done pop hl + exx + pop iy + ei + ret + +.test ld hl,1+3*vecsize + add hl,de + push hl + + ld a,c + call printdeca + + ld a,' ' + call printchr + + ld hl,1+3*vecsize+4 + add hl,de + + call printhl + + ex de,hl + + call test + + ld hl,data+3 + + ld (hl),e + dec hl + ld (hl),d + dec hl + ld (hl),c + dec hl + ld (hl),b + + pop de + + ld b,4 + call .cmp + + jr nz,.mismatch + + call print + db 23,32-2,1,"OK",13,0 + + ret + +.mismatch call print + db 23,32-6,1,"FAILED",13 + db "CRC:",0 + + call printcrc + + call print + db " Expected:",0 + + ex de,hl + call printcrc + + ld a,13 + call printchr + + ld a,1 + ret + +.cmp push hl + push de +.cmploop ld a,(de) + xor (hl) + jr nz,.exit + inc de + inc hl + djnz .cmploop +.exit pop de + pop hl + ret + + include print.asm + include idea.asm + include tests.asm + +; EOF ; diff --git a/OSBindings/Mac/Clock SignalTests/Patrik Rak Z80 Tests/src/print.asm b/OSBindings/Mac/Clock SignalTests/Patrik Rak Z80 Tests/src/print.asm new file mode 100644 index 000000000..fe4c90cbd --- /dev/null +++ b/OSBindings/Mac/Clock SignalTests/Patrik Rak Z80 Tests/src/print.asm @@ -0,0 +1,82 @@ +; Simple printing module. +; +; Copyright (C) 2012 Patrik Rak (patrik@raxoft.cz) +; +; This source code is released under the MIT license, see included license.txt. + + +printinit: ld a,2 + jp 0x1601 ; CHAN-OPEN + + +print: ex (sp),hl + call printhl + ex (sp),hl + ret + +printhl: +.loop ld a,(hl) + inc hl + or a + ret z + call printchr + jr .loop + + +printdeca: ld h,a + ld b,-100 + call .digit + ld b,-10 + call .digit + ld b,-1 + +.digit ld a,h + ld l,'0'-1 +.loop inc l + add a,b + jr c,.loop + sub b + ld h,a + ld a,l + jr printchr + + +printcrc: ld b,4 + +printhexs: +.loop ld a,(hl) + inc hl + call printhexa + djnz .loop + ret + + +printhexa: push af + rrca + rrca + rrca + rrca + call .nibble + pop af + +.nibble or 0xf0 + daa + add a,0xa0 + adc a,0x40 + +printchr: push iy + ld iy,0x5c3a ; ERR-NR + push de + push bc + exx + ei + ; out (0xff),a + rst 0x10 + di + exx + pop bc + pop de + pop iy + ret + +; EOF ; diff --git a/OSBindings/Mac/Clock SignalTests/Patrik Rak Z80 Tests/src/testmacros.asm b/OSBindings/Mac/Clock SignalTests/Patrik Rak Z80 Tests/src/testmacros.asm new file mode 100644 index 000000000..92210bd31 --- /dev/null +++ b/OSBindings/Mac/Clock SignalTests/Patrik Rak Z80 Tests/src/testmacros.asm @@ -0,0 +1,103 @@ +; Macros for defining the test vectors. +; +; Copyright (C) 2012 Patrik Rak (patrik@raxoft.cz) +; +; This source code is released under the MIT license, see included license.txt. + + macro db8 b7,b6,b5,b4,b3,b2,b1,b0 + db (b7<<7)|(b6<<6)|(b5<<5)|(b4<<4)|(b3<<3)|(b2<<2)|(b1<<1)|b0 + endm + + macro ddbe n + db (n>>24)&0xff + db (n>>16)&0xff + db (n>>8)&0xff + db n&0xff + endm + + macro inst op1,op2,op3,op4,tail + ; Unfortunately, elseifidn doesn't seem to work properly. + ifidn op4,stop + db op1,op2,op3,tail,0 + else + ifidn op3,stop + db op1,op2,tail,op4,0 + else + ifidn op2,stop + db op1,tail,op3,op4,0 + else + db op1,op2,op3,op4,tail + endif + endif + endif + endm + + macro flags sn,s,zn,z,f5n,f5,hcn,hc,f3n,f3,pvn,pv,nn,n,cn,c + if maskflags + db8 s,z,f5,hc,f3,pv,n,c + else + db 0xff + endif + endm + +.veccount := 0 + + macro vec op1,op2,op3,op4,memn,mem,an,a,fn,f,bcn,bc,den,de,hln,hl,ixn,ix,iyn,iy,spn,sp + + if postccf + + if ( .@veccount % 3 ) == 0 + inst op1,op2,op3,op4,tail +.@areg := 0 + else + db op1,op2,op3,op4,0 +.@areg := .@areg | a + endif + + else + db op1,op2,op3,op4 + endif + + db f + + if postccf & ( ( .veccount % 3 ) == 2 ) + db a | ( ( ~ .@areg ) & 0x28 ) + else + db a + endif + + dw bc,de,hl,ix,iy + dw mem + dw sp + +.@veccount := .@veccount+1 + + endm + + macro crcs allflagsn,allflags,alln,all,docflagsn,docflags,docn,doc,ccfn,ccf,mptrn,mptr + if postccf + ddbe ccf + elseif memptr + ddbe mptr + else + if maskflags + if onlyflags + ddbe docflags + else + ddbe doc + endif + else + if onlyflags + ddbe allflags + else + ddbe all + endif + endif + endif + endm + + macro name n + dz n + endm + +; EOF ; diff --git a/OSBindings/Mac/Clock SignalTests/Patrik Rak Z80 Tests/src/tests.asm b/OSBindings/Mac/Clock SignalTests/Patrik Rak Z80 Tests/src/tests.asm new file mode 100644 index 000000000..08b50847c --- /dev/null +++ b/OSBindings/Mac/Clock SignalTests/Patrik Rak Z80 Tests/src/tests.asm @@ -0,0 +1,1379 @@ +; The test vectors themselves. +; +; Copyright (C) 2012 Patrik Rak (patrik@raxoft.cz) +; +; This source code is released under the MIT license, see included license.txt. + +selftests equ 0 ; Set to 1 to include detailed self tests. + +mem equ data.mem +meml equ mem%256 +memh equ mem/256 +memsp equ mem+2 + +jmp equ data.jump +jmpl equ jmp%256 +jmph equ jmp/256 + + if postccf +stop equ 256 +tail equ 0x3f + else +stop equ 0 +tail equ 0 + endif + +testtable: + if selftests + dw .crc + dw .counter + dw .shifter + endif + + dw .selftest + + dw .scf + dw .ccf + dw .scfccf + dw .ccfscf + + dw .daa + dw .cpl + dw .neg + dw .neg_ + + dw .add_a_n + dw .adc_a_n + dw .sub_a_n + dw .sbc_a_n + dw .and_n + dw .xor_n + dw .or_n + dw .cp_n + + dw .alo_a_a + dw .alo_a_b_c + dw .alo_a_d_e + dw .alo_a_h_l + dw .alo_a_hl + dw .alo_a_x + dw .alo_a_y + dw .alo_a_xyd + + dw .rlca + dw .rrca + dw .rla + dw .rra + + dw .rld + dw .rrd + + dw .rlc_a + dw .rrc_a + dw .rl_a + dw .rr_a + dw .sla_a + dw .sra_a + dw .slia_a + dw .srl_a + + dw .rlc_r + dw .rrc_r + dw .rl_r + dw .rr_r + dw .sla_r + dw .sra_r + dw .slia_r + dw .srl_r + + dw .sro_xyd + dw .sro_xyd_r + + dw .inc_a + dw .dec_a + dw .inc_r + dw .dec_r + dw .inc_x + dw .dec_x + dw .inc_xyd + dw .dec_xyd + + dw .inc_rr + dw .dec_rr + dw .inc_xy + dw .dec_xy + + dw .add_hl_rr + dw .add_ix_rr + dw .add_iy_rr + dw .adc_hl_rr + dw .sbc_hl_rr + + dw .bit_n_a + dw .bit_n_hl + dw .bit_n_r + dw .bit_n_xyd + dw .bit_n_xyd_ + + dw .set_n_a + dw .set_n_hl + dw .set_n_r + dw .set_n_xyd + dw .set_n_xyd_ + + dw .res_n_a + dw .res_n_hl + dw .res_n_r + dw .res_n_xyd + dw .res_n_xyd_ + + dw .ldi + dw .ldd + dw .ldir + dw .lddr + + dw .cpi + dw .cpd + dw .cpir + dw .cpdr + + dw .in_a_n + dw .in_r_c + dw .in_c + dw .ini + dw .ind + dw .inir + dw .indr + + dw .out_n_a + dw .out_c_r + dw .out_c_0 + dw .outi + dw .outd + dw .otir + dw .otdr + + dw .jp_nn + dw .jp_cc_nn + dw .jp_hl + dw .jp_xy + + dw .jr_n + dw .jr_cc_n + dw .djnz_n + + dw .call_nn + dw .call_cc_nn + + dw .ret + dw .ret_cc + dw .retn + dw .reti + dw .reti_retn + + dw .pushpop_rr + dw .poppush_af + dw .pushpop_xy + + dw .ex_de_hl + dw .ex_af_af + dw .exx + dw .ex_sp_hl + dw .ex_sp_xy + + dw .ld_r_r + dw .ld_x_x + dw .ld_r_xyd + dw .ld_xyd_r + dw .ld_r_n + dw .ld_x_n + dw .ld_xyd_n + dw .ld_a_rr + dw .ld_rr_a + dw .ld_a_mem + dw .ld_mem_a + + dw .ld_rr_nn + dw .ld_xy_nn + dw .ld_hl_mem + dw .ld_xy_mem + dw .ld_rr_mem + dw .ld_mem_hl + dw .ld_mem_xy + dw .ld_mem_rr + dw .ld_sp_hl + dw .ld_sp_xy + + dw .ld_i_a + dw .ld_r_a + dw .ld_a_i + dw .ld_a_r + + dw .ei_di + dw .im_n + + ; rst + ; halt + + dw 0 + + include testmacros.asm + + ; Test vector template. + ; + ; Each test consists of the following: + ; - Bitmask of which of the modified flags are officially documented. + ; - Three test vectors - base test vector, counter vector and shifter vector. + ; - The CRCs for each of the available test variants. + ; - Test name. + ; + ; The base test vectors specifies the instruction(s) to execute, + ; the initial value of the memory operand, and the initial + ; values of the Z80 registers. + ; + ; The counter vector specifies which combinations of bits shall + ; be toggled in the base test vectors. The test vector is + ; executed once for each possible combination. + ; + ; The shifter vector specifies which bits shall be toggled in + ; the test vector in sequence. After all the initial counter + ; combinations were executed, the whole process is repeated, but + ; now also toggling one of the specified shifter bits at a time. + + if 0 + flags s,1,z,1,f5,0,hc,1,f3,0,pv,1,n,1,c,1 + vec 0x00,0x00,0x00,0x00,mem,0x1234,a,0xaa,f,0xff,bc,0xbbcc,de,0xddee,hl,0x4411,ix,0xdd88,iy,0xfd77,sp,0xc000 + vec 0x00,0x00,0x00,0x00,mem,0x0000,a,0x00,f,0x00,bc,0x0000,de,0x0000,hl,0x0000,ix,0x0000,iy,0x0000,sp,0x0000 + vec 0x00,0x00,0x00,0x00,mem,0x0000,a,0x00,f,0x00,bc,0x0000,de,0x0000,hl,0x0000,ix,0x0000,iy,0x0000,sp,0x0000 + crcs allflags,0xaf0f0011,all,0xac0f0022,docflags,0xdf0f0033,doc,0xdc0f0044,ccf,0x0,mptr,0x0 + name " " + endif + + ; Various selftests. + + if selftests + +.crc flags s,1,z,1,f5,0,hc,1,f3,0,pv,1,n,1,c,1 + vec 0x00,0x00,0x00,0x00,mem,0x1234,a,0xaa,f,0xff,bc,0xbbcc,de,0xddee,hl,0x4411,ix,0xdd88,iy,0xfd77,sp,0xc000 + vec 0x00,0x00,0x00,0x00,mem,0x0000,a,0x00,f,0x00,bc,0x0000,de,0x0000,hl,0x0000,ix,0x0000,iy,0x0000,sp,0x0000 + vec 0x00,0x00,0x00,0x00,mem,0x0000,a,0x00,f,0x00,bc,0x0000,de,0x0000,hl,0x0000,ix,0x0000,iy,0x0000,sp,0x0000 + crcs allflags,0x00ffffff,all,0x2e26825b,docflags,0x354a5705,doc,0x4a0a6669,ccf,0xb062bcdf,mptr,0x4996b8b2 + name "CRC TEST" + +.counter flags s,1,z,1,f5,0,hc,1,f3,0,pv,1,n,1,c,1 + vec 0x00,0x00,0x00,0x00,mem,0x1234,a,0xaa,f,0xff,bc,0xbbcc,de,0xddee,hl,0x4411,ix,0xdd88,iy,0xfd77,sp,0xc000 + vec 0x00,0x00,0x00,0x00,mem,0x0000,a,0x01,f,0x00,bc,0x0000,de,0x0000,hl,0x0000,ix,0x0000,iy,0x0000,sp,0x8000 + vec 0x00,0x00,0x00,0x00,mem,0x0000,a,0x00,f,0x00,bc,0x0000,de,0x0000,hl,0x0000,ix,0x0000,iy,0x0000,sp,0x0000 + crcs allflags,0x00000000,all,0x65283e9d,docflags,0x3b3096d9,doc,0x70844659,ccf,0xa424358c,mptr,0x1f36a1d1 + name "COUNTER TEST" + +.shifter flags s,1,z,1,f5,0,hc,1,f3,0,pv,1,n,1,c,1 + vec 0x00,0x00,0x00,0x00,mem,0x1234,a,0xaa,f,0xff,bc,0xbbcc,de,0xddee,hl,0x4411,ix,0xdd88,iy,0xfd77,sp,0xc000 + vec 0x00,0x00,0x00,0x00,mem,0x0000,a,0x00,f,0x00,bc,0x0000,de,0x0000,hl,0x0000,ix,0x0000,iy,0x0000,sp,0x0000 + vec 0x00,0x00,0x00,0x00,mem,0x0000,a,0x41,f,0x00,bc,0x0000,de,0x0000,hl,0x0000,ix,0x0000,iy,0x0000,sp,0x8000 + crcs allflags,0x00000000,all,0xd690f8ac,docflags,0x3b3096d9,doc,0xc33c8068,ccf,0xddc5094f,mptr,0x1f36a1d1 + name "SHIFTER TEST" + + endif + +.selftest flags s,1,z,1,f5,0,hc,1,f3,0,pv,1,n,1,c,1 + vec 0x00,0x00,0x00,0x00,mem,0x1234,a,0xaa,f,0xff,bc,0xbbcc,de,0xddee,hl,0x4411,ix,0xdd88,iy,0xfd77,sp,0xc000 + vec 0x00,0x00,0x00,0x00,mem,0x0000,a,0x00,f,0x20,bc,0x0000,de,0x0000,hl,0x0000,ix,0x0000,iy,0x0000,sp,0x0000 + vec 0x00,0x00,0x00,0x00,mem,0x0000,a,0x00,f,0x08,bc,0x0000,de,0x0000,hl,0x0000,ix,0x0000,iy,0x0000,sp,0x0000 + crcs allflags,0xf3b489a6,all,0x1052d099,docflags,0x3b3096d9,doc,0x48e530ef,ccf,0x97bb028f,mptr,0x1f36a1d1 + name "SELF TEST" + + ; Flag manipulation. + +.scf flags s,1,z,1,f5,0,hc,1,f3,0,pv,1,n,1,c,1 + vec 0x37,stop,0x00,0x00,mem,0x1234,a,0xaa,f,0xff,bc,0xbbcc,de,0xddee,hl,0x4411,ix,0xdd88,iy,0xfd77,sp,0xc000 + vec 0x00,0x00,0x00,0x00,mem,0x0000,a,0x28,f,0xff,bc,0x0000,de,0x0000,hl,0x0000,ix,0x0000,iy,0x0000,sp,0x0000 + vec 0x00,0x00,0x00,0x00,mem,0x0000,a,0xd7,f,0x00,bc,0x0000,de,0x0000,hl,0x0000,ix,0x0000,iy,0x0000,sp,0x0000 + crcs allflags,0x3ec05634,all,0xd841bd8a,docflags,0xafbf608b,doc,0x2efb018b,ccf,0xe0d3c7bf,mptr,0x4fc0a073 + name "SCF" + +.ccf flags s,1,z,1,f5,0,hc,0,f3,0,pv,1,n,1,c,1 + vec 0x3f,stop,0x00,0x00,mem,0x1234,a,0xaa,f,0xff,bc,0xbbcc,de,0xddee,hl,0x4411,ix,0xdd88,iy,0xfd77,sp,0xc000 + vec 0x00,0x00,0x00,0x00,mem,0x0000,a,0x28,f,0xff,bc,0x0000,de,0x0000,hl,0x0000,ix,0x0000,iy,0x0000,sp,0x0000 + vec 0x00,0x00,0x00,0x00,mem,0x0000,a,0xd7,f,0x00,bc,0x0000,de,0x0000,hl,0x0000,ix,0x0000,iy,0x0000,sp,0x0000 + crcs allflags,0x5b2237ae,all,0x3fbb71dc,docflags,0x27b2462c,doc,0x96bd3c82,ccf,0x8531a625,mptr,0xc7cd86d4 + name "CCF" + +.scfccf flags s,1,z,1,f5,0,hc,0,f3,0,pv,1,n,1,c,1 + vec 0x37,0x3f,stop,0x00,mem,0x1234,a,0xaa,f,0xff,bc,0xbbcc,de,0xddee,hl,0x4411,ix,0xdd88,iy,0xfd77,sp,0xc000 + vec 0x00,0x00,0x00,0x00,mem,0x0000,a,0x28,f,0xff,bc,0x0000,de,0x0000,hl,0x0000,ix,0x0000,iy,0x0000,sp,0x0000 + vec 0x00,0x00,0x00,0x00,mem,0x0000,a,0xd7,f,0x00,bc,0x0000,de,0x0000,hl,0x0000,ix,0x0000,iy,0x0000,sp,0x0000 + crcs allflags,0xe0d3c7bf,all,0x9086496c,docflags,0x6f887d41,doc,0x3f044693,ccf,0x958e3e1e,mptr,0x8ff7bdb9 + name "SCF+CCF" + +.ccfscf flags s,1,z,1,f5,0,hc,1,f3,0,pv,1,n,1,c,1 + vec 0x3f,0x37,stop,0x00,mem,0x1234,a,0xaa,f,0xff,bc,0xbbcc,de,0xddee,hl,0x4411,ix,0xdd88,iy,0xfd77,sp,0xc000 + vec 0x00,0x00,0x00,0x00,mem,0x0000,a,0x28,f,0xff,bc,0x0000,de,0x0000,hl,0x0000,ix,0x0000,iy,0x0000,sp,0x0000 + vec 0x00,0x00,0x00,0x00,mem,0x0000,a,0xd7,f,0x00,bc,0x0000,de,0x0000,hl,0x0000,ix,0x0000,iy,0x0000,sp,0x0000 + crcs allflags,0x958e3e1e,all,0x45fc79b5,docflags,0xafbf608b,doc,0x2efb018b,ccf,0xe0d3c7bf,mptr,0x4fc0a073 + name "CCF+SCF" + + ; 8 bit arithmetics. + +.daa flags s,1,z,1,f5,0,hc,1,f3,0,pv,1,n,1,c,1 + vec 0x27,stop,0x00,0x00,mem,0x1234,a,0xaa,f,0xff,bc,0xbbcc,de,0xddee,hl,0x4411,ix,0xdd88,iy,0xfd77,sp,0xc000 + vec 0x00,0x00,0x00,0x00,mem,0x0000,a,0xff,f,0x13,bc,0x0000,de,0x0000,hl,0x0000,ix,0x0000,iy,0x0000,sp,0x0000 + vec 0x00,0x00,0x00,0x00,mem,0x0000,a,0x00,f,0xec,bc,0x0000,de,0x0000,hl,0x0000,ix,0x0000,iy,0x0000,sp,0x0000 + crcs allflags,0x4fa2a2d3,all,0xe994c6c4,docflags,0x39bd9b50,doc,0xce050987,ccf,0xf664ae86,mptr,0xb43e3905 + name "DAA" + +.cpl flags s,1,z,1,f5,0,hc,1,f3,0,pv,1,n,1,c,1 + vec 0x2f,stop,0x00,0x00,mem,0x1234,a,0xaa,f,0xff,bc,0xbbcc,de,0xddee,hl,0x4411,ix,0xdd88,iy,0xfd77,sp,0xc000 + vec 0x00,0x00,0x00,0x00,mem,0x0000,a,0xff,f,0x00,bc,0x0000,de,0x0000,hl,0x0000,ix,0x0000,iy,0x0000,sp,0x0000 + vec 0x00,0x00,0x00,0x00,mem,0x0000,a,0x00,f,0xff,bc,0x0000,de,0x0000,hl,0x0000,ix,0x0000,iy,0x0000,sp,0x0000 + crcs allflags,0x23dcd704,all,0xe39927d0,docflags,0x9c2c0c93,doc,0xe028b087,ccf,0x169b61fe,mptr,0xbd959484 + name "CPL" + +.neg flags s,1,z,1,f5,0,hc,1,f3,0,pv,1,n,1,c,1 + vec 0xed,0x44,stop,0x00,mem,0x1234,a,0xaa,f,0xff,bc,0xbbcc,de,0xddee,hl,0x4411,ix,0xdd88,iy,0xfd77,sp,0xc000 + vec 0x00,0x00,0x00,0x00,mem,0x0000,a,0xff,f,0x00,bc,0x0000,de,0x0000,hl,0x0000,ix,0x0000,iy,0x0000,sp,0x0000 + vec 0x00,0x00,0x00,0x00,mem,0x0000,a,0x00,f,0xff,bc,0x0000,de,0x0000,hl,0x0000,ix,0x0000,iy,0x0000,sp,0x0000 + crcs allflags,0xed3cb45e,all,0x953a7650,docflags,0xe5ea9a83,doc,0xe6ed5f0d,ccf,0xb88dd2d9,mptr,0x44007b37 + name "NEG" + +.neg_ flags s,1,z,1,f5,0,hc,1,f3,0,pv,1,n,1,c,1 + vec 0xed,0x44,stop,0x00,mem,0x1234,a,0xaa,f,0xff,bc,0xbbcc,de,0xddee,hl,0x4411,ix,0xdd88,iy,0xfd77,sp,0xc000 + vec 0x00,0x38,0x00,0x00,mem,0x0000,a,0x00,f,0x00,bc,0x0000,de,0x0000,hl,0x0000,ix,0x0000,iy,0x0000,sp,0x0000 + vec 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Tests/src/z80ccf.asm new file mode 100644 index 000000000..8b5d96a89 --- /dev/null +++ b/OSBindings/Mac/Clock SignalTests/Patrik Rak Z80 Tests/src/z80ccf.asm @@ -0,0 +1,18 @@ +; Z80 test - post CCF version. +; +; Copyright (C) 2012 Patrik Rak (patrik@raxoft.cz) +; +; This source code is released under the MIT license, see included license.txt. + + macro testname + db "CCF" + endm + +maskflags equ 0 +onlyflags equ 1 +postccf equ 1 +memptr equ 0 + + include main.asm + +; EOF ; diff --git a/OSBindings/Mac/Clock SignalTests/Patrik Rak Z80 Tests/src/z80doc.asm b/OSBindings/Mac/Clock SignalTests/Patrik Rak Z80 Tests/src/z80doc.asm new file mode 100644 index 000000000..c6b73bb48 --- /dev/null +++ b/OSBindings/Mac/Clock SignalTests/Patrik Rak Z80 Tests/src/z80doc.asm @@ -0,0 +1,18 @@ +; Z80 test - officially documented flags version. +; +; Copyright (C) 2012 Patrik Rak (patrik@raxoft.cz) +; +; This source code is released under the MIT license, see included license.txt. + + macro testname + db "doc" + endm + +maskflags equ 1 +onlyflags equ 0 +postccf equ 0 +memptr equ 0 + + include main.asm + +; EOF ; diff --git a/OSBindings/Mac/Clock SignalTests/Patrik Rak Z80 Tests/src/z80docflags.asm b/OSBindings/Mac/Clock SignalTests/Patrik Rak Z80 Tests/src/z80docflags.asm new file mode 100644 index 000000000..389e0bc58 --- /dev/null +++ b/OSBindings/Mac/Clock SignalTests/Patrik Rak Z80 Tests/src/z80docflags.asm @@ -0,0 +1,18 @@ +; Z80 test - officially documented flags, flags only version. +; +; Copyright (C) 2012 Patrik Rak (patrik@raxoft.cz) +; +; This source code is released under the MIT license, see included license.txt. + + macro testname + db "doc flags" + endm + +maskflags equ 1 +onlyflags equ 1 +postccf equ 0 +memptr equ 0 + + include main.asm + +; EOF ; diff --git a/OSBindings/Mac/Clock SignalTests/Patrik Rak Z80 Tests/src/z80flags.asm b/OSBindings/Mac/Clock SignalTests/Patrik Rak Z80 Tests/src/z80flags.asm new file mode 100644 index 000000000..a36e751eb --- /dev/null +++ b/OSBindings/Mac/Clock SignalTests/Patrik Rak Z80 Tests/src/z80flags.asm @@ -0,0 +1,18 @@ +; Z80 test - flags only version. +; +; Copyright (C) 2012 Patrik Rak (patrik@raxoft.cz) +; +; This source code is released under the MIT license, see included license.txt. + + macro testname + db "flags" + endm + +maskflags equ 0 +onlyflags equ 1 +postccf equ 0 +memptr equ 0 + + include main.asm + +; EOF ; diff --git a/OSBindings/Mac/Clock SignalTests/Patrik Rak Z80 Tests/src/z80full.asm b/OSBindings/Mac/Clock SignalTests/Patrik Rak Z80 Tests/src/z80full.asm new file mode 100644 index 000000000..579c2463f --- /dev/null +++ b/OSBindings/Mac/Clock SignalTests/Patrik Rak Z80 Tests/src/z80full.asm @@ -0,0 +1,18 @@ +; Z80 test - the full version. +; +; Copyright (C) 2012 Patrik Rak (patrik@raxoft.cz) +; +; This source code is released under the MIT license, see included license.txt. + + macro testname + db "full" + endm + +maskflags equ 0 +onlyflags equ 0 +postccf equ 0 +memptr equ 0 + + include main.asm + +; EOF ; diff --git a/OSBindings/Mac/Clock SignalTests/Patrik Rak Z80 Tests/src/z80memptr.asm b/OSBindings/Mac/Clock SignalTests/Patrik Rak Z80 Tests/src/z80memptr.asm new file mode 100644 index 000000000..3efac221c --- /dev/null +++ b/OSBindings/Mac/Clock SignalTests/Patrik Rak Z80 Tests/src/z80memptr.asm @@ -0,0 +1,21 @@ +; Z80 test - MEMPTR version. +; +; However note that the current set of tests was not designed to stress test MEMPTR +; particularly, so it doesn't detect much - I may eventually add such specific tests later. +; +; Copyright (C) 2012 Patrik Rak (patrik@raxoft.cz) +; +; This source code is released under the MIT license, see included license.txt. + + macro testname + db "MEMPTR" + endm + +maskflags equ 0 +onlyflags equ 1 +postccf equ 0 +memptr equ 1 + + include main.asm + +; EOF ; diff --git a/OSBindings/Mac/Clock SignalTests/Patrik Rak Z80 Tests/z80ccf.tap b/OSBindings/Mac/Clock SignalTests/Patrik Rak Z80 Tests/z80ccf.tap new file mode 100644 index 0000000000000000000000000000000000000000..59d8d367ad4c07beb67173994ae8548982ba6e5a GIT binary patch literal 14219 zcmds-dt6NU|HnU5Nvi2eTDP5COJk+Aw4scdu100b%3YF36j@npDyzmVmqhLqNvM=A zM3QT32i+u$gjnl4?poH?`F=j<%sFS~bY{P){r&Sh9?tok&pGFLUhm82b|!NGz;Xw> zz`!{?xD5pQU?Awl2N=-r44S^RA3kij5dhdK;P|R{?<~j9T+rDFd@4Z~9N+~I4Y=#g z0nnxqgNMUPuxZF}>|IksZG)^+jLaxzvV$E@D0Jm535rBN)y#8`>I zSF+AAFJ!Y~thA*Owu@~S*@ld5|%<{3at*Ipd&v0PAwirqM_0uQl^h%1x`9f52Z zu7k&OSr#4?xFl${BX|MpoVbwc#3^g2?v}~ZG4EsYvAn*_N$VoV;xT;BR3F*s7?V$BAB^E9^N4xV_Nhj7)qNOQY9 zWz6Usb#!9isC4hXuC-Q9Qd1kLZkKKa*1Dt8%r5Sai8AB&FnMh?PipEb?G~>P#bu_M zmF|z>_gK+9&)PIJG0*RVo?m>?ab|HxQPGnyY2il zUv2s>)&5W~sqMLrTV}s?fAI5*@mGH+S^gjI+Q1LjraxI+?$$K_uh840AOCoB(s9RV zi@ZKNjrZy0^o=(?Hfpo(*@0`nKKyOU&;-k(K|46_XWj8qthg}oiq9V_>pb2C`QKRb zNKmujbI9MWw;~#5l#R?ViR+i!X}?i&?^9i4Mx5Z~8}9l(tIKM$U!2kn_6|5Hs+ik6 z?fRl;OCL`DE$ox9`uC_yk~hKfv3JFdGcQhf_0xuK2ZkkSpB`Lny;bMPko7&Y`|r^| z>b%B0wsWS#Zf=29)tHY9WmD=SpN9WB6`NP-vh1Z_X~3W3?s?vy^V;|Fs^>k{*`;+z zv^oDxq1LwH2fJ?sb^+rry+52JEqq=pUOA|z32%|0>Pg<314)P9U#fjx zDD63Dr8rHYIsY2l!r;+2a8CcL~gRZl*ZC8v+#P7Ph1`>4V#vcHAFh>*!Q zvCMsmsc%as1`pHiZoAyG?p1L@YGUcz;EB4!Y`c3de^r-IoV&W>QKXwi{}Be0L$I6s zGE3j4Ch86gp6I#UwtGVHtGbFuxvMSuN4iZ88DX$56TA7SVs&nR3%AIS$p#}b_ua(a zmL{eS)14T++_SrFaYEfI(9x*Vf{?)3_wH9$7{`ta=pp#L^g4u!dLxX1N za`cR|3yM$6?^agj=xD6R(VZ0(I=`y&uKaXyLH6zPJ9R~8^K!WQ+B!3X7tRZq6E@e-K&!)< zbEk4^Zq+`R9T>8plTk--zVKvzMfLrAl~wY)#iz3i^o(^mL9^zE>T`9pgJ;fLSbn?i z&e@`zymM!APu;3{P&+4JZkT~#2Q3i!a%acz=lhI)dbp!g)U(Y!L*D(;ZNdB1=ChmD zbq@S%;|Ote%E+-5hrb(h@3_6o{bT*dUpsI0!_7kL8COmY_P>z7l#~2wk?#KAmlHHpR-iCIM{Saif{_j~`HhdoEm|EpI>QJR{=!v_cZ!_dR1B%Ng@=o8FZj*g= z(l-Sqie1`E{@AM%@pv0|`IAKbpI^uKn)he)R|}ihngoAJ=sNTEK?m>hG-vlaS;GW% z=|fzvpY134t*G~e%Q?1FOY`_scK_!`tvxRmcSw4)!f&3HuWMNO0V=ZqwaOHk(&$mTm5_ zC1^|Lmc}hkTjRFg*lL+LEAd$3`$VU0(ruO7dL}JQI-g{`ea80e?VKIHI}Yu5vtxAf zy5y?lemj@$EZM2QYvQg$yI$>b+`VS^t=+x$gzh=BM{n;BdsFtl*(=(YxbMk6yZx*7 zSM0Ysu=qgn0q((>2eS@>6!(JXMTbux)=C?jwlnQn z+IL5yj$A!rl0GRtHT`w^$fMGu=G@0_u@yKb^BDGyzsoD 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OK\n\r" + + "..................... OK\n\r" + + "........... OK\n\r" + + "shf/rot (+1)........... OK\n\r" + + "shf/rot .. OK\n\r" + + " n,..... OK\n\r" + + " n,(+1)....... OK\n\r" + + "ld (+1),...... OK\n\r" + + "ld (+1),.......... OK\n\r" + + "ld (+1),a.............. OK\n\r" + + "ld (),a................ OK\n\r" + + "Tests complete\n\r" + XCTAssertEqual(targetOutput, output); + } + } + } + + func testCCF() { + runTest("z80ccf") + } + + func testMachine(_ testMachine: CSTestMachine, didTrapAtAddress address: UInt16) { + let testMachineZ80 = testMachine as! CSTestMachineZ80 + switch address { + case 0x0010: + print("TODO") + + let cRegister = testMachineZ80.value(for: .C) + var textToAppend = "" + switch cRegister { + case 9: + var address = testMachineZ80.value(for: .DE) + var character: Character = " " + while true { + character = Character(UnicodeScalar(testMachineZ80.value(atAddress: address))) + if character == "$" { + break + } + textToAppend += String(character) + address = address + 1 + } + case 5: + textToAppend = String(describing: UnicodeScalar(testMachineZ80.value(for: .E))) + case 0: + done = true + default: + break + } + output += textToAppend + print(textToAppend) + + case 0x7003: + done = true + + default: + break + } + } +} From cf7ab97451e6ccad143c0f9dbd4c898d21ec0237 Mon Sep 17 00:00:00 2001 From: Thomas Harte Date: Sat, 22 Feb 2020 18:42:23 -0500 Subject: [PATCH 04/28] Gets the first test to run (and terminate). --- .../Clock Signal.xcodeproj/project.pbxproj | 32 +++++ .../Clock SignalTests/PatrikRakTests.swift | 127 +++--------------- 2 files changed, 50 insertions(+), 109 deletions(-) diff --git a/OSBindings/Mac/Clock Signal.xcodeproj/project.pbxproj b/OSBindings/Mac/Clock Signal.xcodeproj/project.pbxproj index 9bf6104c7..ed74f9c91 100644 --- a/OSBindings/Mac/Clock Signal.xcodeproj/project.pbxproj +++ b/OSBindings/Mac/Clock Signal.xcodeproj/project.pbxproj @@ -225,6 +225,12 @@ 4B643F3F1D77B88000D431D6 /* DocumentController.swift in Sources */ = {isa = PBXBuildFile; fileRef = 4B643F3E1D77B88000D431D6 /* DocumentController.swift */; }; 4B65086022F4CF8D009C1100 /* Keyboard.cpp in Sources */ = {isa = PBXBuildFile; fileRef = 4B65085F22F4CF8D009C1100 /* Keyboard.cpp */; }; 4B65086122F4CFE0009C1100 /* Keyboard.cpp in Sources */ = {isa = PBXBuildFile; fileRef = 4B65085F22F4CF8D009C1100 /* Keyboard.cpp */; }; + 4B670A9B2401CB8400D4E002 /* z80memptr.tap in Resources */ = {isa = PBXBuildFile; fileRef = 4B670A832401CB8400D4E002 /* z80memptr.tap */; }; + 4B670A9D2401CB8400D4E002 /* z80ccf.tap in Resources */ = {isa = PBXBuildFile; fileRef = 4B670A852401CB8400D4E002 /* z80ccf.tap */; }; + 4B670A9F2401CB8400D4E002 /* z80flags.tap in Resources */ = {isa = PBXBuildFile; fileRef = 4B670A872401CB8400D4E002 /* z80flags.tap */; }; + 4B670AA12401CB8400D4E002 /* z80doc.tap in Resources */ = {isa = PBXBuildFile; fileRef = 4B670A892401CB8400D4E002 /* z80doc.tap */; }; + 4B670AB02401CB8400D4E002 /* z80full.tap in Resources */ = {isa = PBXBuildFile; fileRef = 4B670A992401CB8400D4E002 /* z80full.tap */; }; + 4B670AB12401CB8400D4E002 /* z80docflags.tap in Resources */ = {isa = PBXBuildFile; fileRef = 4B670A9A2401CB8400D4E002 /* z80docflags.tap */; }; 4B680CE223A5553100451D43 /* 68000ComparativeTests.mm in Sources */ = {isa = PBXBuildFile; fileRef = 4B680CE123A5553100451D43 /* 68000ComparativeTests.mm */; }; 4B680CE423A555CA00451D43 /* 68000 Comparative Tests in Resources */ = {isa = PBXBuildFile; fileRef = 4B680CE323A555CA00451D43 /* 68000 Comparative Tests */; }; 4B69FB3D1C4D908A00B5F0AA /* Tape.cpp in Sources */ = {isa = PBXBuildFile; fileRef = 4B69FB3B1C4D908A00B5F0AA /* Tape.cpp */; }; @@ -1133,6 +1139,12 @@ 4B643F3E1D77B88000D431D6 /* DocumentController.swift */ = {isa = PBXFileReference; fileEncoding = 4; lastKnownFileType = sourcecode.swift; path = DocumentController.swift; sourceTree = ""; }; 4B644ED023F0FB55006C0CC5 /* ScanSynchroniser.hpp */ = {isa = PBXFileReference; lastKnownFileType = sourcecode.cpp.h; path = ScanSynchroniser.hpp; sourceTree = ""; }; 4B65085F22F4CF8D009C1100 /* Keyboard.cpp */ = {isa = PBXFileReference; lastKnownFileType = sourcecode.cpp.cpp; path = Keyboard.cpp; sourceTree = ""; }; + 4B670A832401CB8400D4E002 /* z80memptr.tap */ = {isa = PBXFileReference; lastKnownFileType = file; path = z80memptr.tap; sourceTree = ""; }; + 4B670A852401CB8400D4E002 /* z80ccf.tap */ = {isa = PBXFileReference; lastKnownFileType = file; path = z80ccf.tap; sourceTree = ""; }; + 4B670A872401CB8400D4E002 /* z80flags.tap */ = {isa = PBXFileReference; lastKnownFileType = file; path = z80flags.tap; sourceTree = ""; }; + 4B670A892401CB8400D4E002 /* z80doc.tap */ = {isa = PBXFileReference; lastKnownFileType = file; path = z80doc.tap; sourceTree = ""; }; + 4B670A992401CB8400D4E002 /* z80full.tap */ = {isa = PBXFileReference; lastKnownFileType = file; path = z80full.tap; sourceTree = ""; }; + 4B670A9A2401CB8400D4E002 /* z80docflags.tap */ = {isa = PBXFileReference; lastKnownFileType = file; path = z80docflags.tap; sourceTree = ""; }; 4B680CE123A5553100451D43 /* 68000ComparativeTests.mm */ = {isa = PBXFileReference; lastKnownFileType = sourcecode.cpp.objcpp; path = 68000ComparativeTests.mm; sourceTree = ""; }; 4B680CE323A555CA00451D43 /* 68000 Comparative Tests */ = {isa = PBXFileReference; lastKnownFileType = folder; path = "68000 Comparative Tests"; sourceTree = ""; }; 4B698D1A1FE768A100696C91 /* SampleSource.hpp */ = {isa = PBXFileReference; lastKnownFileType = sourcecode.cpp.h; path = SampleSource.hpp; sourceTree = ""; }; @@ -1926,6 +1938,7 @@ 4B1414631B588A1100E04248 /* Test Binaries */ = { isa = PBXGroup; children = ( + 4B670A822401CB8400D4E002 /* Patrik Rak Z80 Tests */, 4B680CE323A555CA00451D43 /* 68000 Comparative Tests */, 4B85322B227793CA00F26553 /* TOS Startup */, 4B9252CD1E74D28200B76AF1 /* Atari ROMs */, @@ -2435,6 +2448,19 @@ path = "Document Controller"; sourceTree = ""; }; + 4B670A822401CB8400D4E002 /* Patrik Rak Z80 Tests */ = { + isa = PBXGroup; + children = ( + 4B670A852401CB8400D4E002 /* z80ccf.tap */, + 4B670A892401CB8400D4E002 /* z80doc.tap */, + 4B670A9A2401CB8400D4E002 /* z80docflags.tap */, + 4B670A872401CB8400D4E002 /* z80flags.tap */, + 4B670A992401CB8400D4E002 /* z80full.tap */, + 4B670A832401CB8400D4E002 /* z80memptr.tap */, + ); + path = "Patrik Rak Z80 Tests"; + sourceTree = ""; + }; 4B69FB391C4D908A00B5F0AA /* Storage */ = { isa = PBXGroup; children = ( @@ -3957,6 +3983,7 @@ 4BB299551B587D8400A49093 /* eoriy in Resources */, 4BB298F91B587D8400A49093 /* adczx in Resources */, 4BB299F21B587D8400A49093 /* trap6 in Resources */, + 4B670A9B2401CB8400D4E002 /* z80memptr.tap in Resources */, 4BB299A91B587D8400A49093 /* plpn in Resources */, 4BB299671B587D8400A49093 /* inxn in Resources */, 4BB2998C1B587D8400A49093 /* lsez in Resources */, @@ -3998,6 +4025,7 @@ 4BB299B01B587D8400A49093 /* rlazx in Resources */, 4BB2999F1B587D8400A49093 /* oraax in Resources */, 4BB299B71B587D8400A49093 /* rorax in Resources */, + 4B670AB02401CB8400D4E002 /* z80full.tap in Resources */, 4BB299DB1B587D8400A49093 /* staz in Resources */, 4BB299961B587D8400A49093 /* nmi in Resources */, 4BB299241B587D8400A49093 /* cia1ta in Resources */, @@ -4011,6 +4039,7 @@ 4BB299B11B587D8400A49093 /* rola in Resources */, 4BB299CE1B587D8400A49093 /* secn in Resources */, 4BB298F31B587D8400A49093 /* adcax in Resources */, + 4B670A9F2401CB8400D4E002 /* z80flags.tap in Resources */, 4BB299641B587D8400A49093 /* insiy in Resources */, 4BB299E61B587D8400A49093 /* trap10 in Resources */, 4BB299651B587D8400A49093 /* insz in Resources */, @@ -4051,6 +4080,7 @@ 4BB299251B587D8400A49093 /* cia1tab in Resources */, 4BB299C21B587D8400A49093 /* rtin in Resources */, 4BB299071B587D8400A49093 /* aslax in Resources */, + 4B670AB12401CB8400D4E002 /* z80docflags.tap in Resources */, 4BB299D51B587D8400A49093 /* shyax in Resources */, 4BB2992F1B587D8400A49093 /* clin in Resources */, 4BB299D21B587D8400A49093 /* shaiy in Resources */, @@ -4078,6 +4108,7 @@ 4BB299DD1B587D8400A49093 /* stxa in Resources */, 4BB299051B587D8400A49093 /* arrb in Resources */, 4BB299DC1B587D8400A49093 /* stazx in Resources */, + 4B670A9D2401CB8400D4E002 /* z80ccf.tap in Resources */, 4BB299C41B587D8400A49093 /* sbca in Resources */, 4BB298F41B587D8400A49093 /* adcay in Resources */, 4B44EBF51DC987AF00A7820C /* AllSuiteA.bin in Resources */, @@ -4108,6 +4139,7 @@ 4BB2991E1B587D8400A49093 /* branchwrap in Resources */, 4BB299121B587D8400A49093 /* axsa in Resources */, 4BB299561B587D8400A49093 /* eorz in Resources */, + 4B670AA12401CB8400D4E002 /* z80doc.tap in Resources */, 4BB299941B587D8400A49093 /* mmu in Resources */, 4BB299E11B587D8400A49093 /* styz in Resources */, 4BB299BA1B587D8400A49093 /* rorzx in Resources */, diff --git a/OSBindings/Mac/Clock SignalTests/PatrikRakTests.swift b/OSBindings/Mac/Clock SignalTests/PatrikRakTests.swift index 59d9c7602..cc6e4a831 100644 --- a/OSBindings/Mac/Clock SignalTests/PatrikRakTests.swift +++ b/OSBindings/Mac/Clock SignalTests/PatrikRakTests.swift @@ -14,28 +14,36 @@ class PatrikRakTests: XCTestCase, CSTestMachineTrapHandler { fileprivate var done = false fileprivate var output = "" - private func runTest(_ name: String) { + private func runTest(_ name: String, targetOutput: String) { if let filename = Bundle(for: type(of: self)).path(forResource: name, ofType: "tap") { if let testData = try? Data(contentsOf: URL(fileURLWithPath: filename)) { // Do a minor parsing of the TAP file to find the final file. var dataPointer = 0 + var finalBlock = 0 while dataPointer < testData.count { let blockSize = Int(testData[dataPointer]) + Int(testData[dataPointer+1]) << 8 - + finalBlock = dataPointer + 2 dataPointer += 2 + blockSize - break } + assert(dataPointer == testData.count) + // Create a machine. let machine = CSTestMachineZ80() - machine.setData(testData, atAddress: 0x0100) + + // Copy everything from finalBlock+1 to the end of the file to $8000. + let fileContents = testData.subdata(in: finalBlock+1 ..< testData.count) + machine.setData(fileContents, atAddress: 0x8000) // Add a RET and a trap at 10h, this is the Spectrum's system call for outputting text. machine.setValue(0xc9, atAddress: 0x0010) machine.addTrapAddress(0x0010); machine.trapHandler = self + // Also add a RET at $1601, which is where the Spectrum puts 'channel open'. + machine.setValue(0xc9, atAddress: 0x1601) + // Add a call to $8000 and then an infinite loop; these tests load at $8000 and RET when done. machine.setValue(0xcd, atAddress: 0x7000) machine.setValue(0x00, atAddress: 0x7001) @@ -43,133 +51,34 @@ class PatrikRakTests: XCTestCase, CSTestMachineTrapHandler { machine.setValue(0xc3, atAddress: 0x7003) machine.setValue(0x03, atAddress: 0x7004) machine.setValue(0x70, atAddress: 0x7005) + machine.addTrapAddress(0x7003); // seed execution at 0x7000 machine.setValue(0x7000, for: .programCounter) // run! let cyclesPerIteration: Int32 = 400_000_000 - var cyclesToDate: TimeInterval = 0 - let startDate = Date() - var printDate = Date() - let printMhz = false while !done { machine.runForNumber(ofCycles: cyclesPerIteration) - cyclesToDate += TimeInterval(cyclesPerIteration) - if printMhz && printDate.timeIntervalSinceNow < -5.0 { - print("\(cyclesToDate / -startDate.timeIntervalSinceNow) Mhz") - printDate = Date() - } } - let targetOutput = - "Z80doc instruction exerciser\n\r" + - " hl,.... OK\n\r" + - "add hl,.......... OK\n\r" + - "add ix,.......... OK\n\r" + - "add iy,.......... OK\n\r" + - "aluop a,nn.................... OK\n\r" + - "aluop a,.. OK\n\r" + - "aluop a,..... OK\n\r" + - "aluop a,(+1)........... OK\n\r" + - "bit n,(+1)............. OK\n\r" + - "bit n,.... OK\n\r" + - "cpd........................ OK\n\r" + - "cpi........................ OK\n\r" + - "............. OK\n\r" + - " a................... OK\n\r" + - " b................... OK\n\r" + - " bc.................. OK\n\r" + - " c................... OK\n\r" + - " d................... OK\n\r" + - " de.................. OK\n\r" + - " e................... OK\n\r" + - " h................... OK\n\r" + - " hl.................. OK\n\r" + - " ix.................. OK\n\r" + - " iy.................. OK\n\r" + - " l................... OK\n\r" + - " (hl)................ OK\n\r" + - " sp.................. OK\n\r" + - " (+1)......... OK\n\r" + - " ixh................. OK\n\r" + - " ixl................. OK\n\r" + - " iyh................. OK\n\r" + - " iyl................. OK\n\r" + - "ld ,(nnnn)............. OK\n\r" + - "ld hl,(nnnn).................. OK\n\r" + - "ld sp,(nnnn).................. OK\n\r" + - "ld ,(nnnn)............. OK\n\r" + - "ld (nnnn),............. OK\n\r" + - "ld (nnnn),hl.................. OK\n\r" + - "ld (nnnn),sp.................. OK\n\r" + - "ld (nnnn),............. OK\n\r" + - "ld ,nnnn......... OK\n\r" + - "ld ,nnnn............... OK\n\r" + - "ld a,<(bc),(de)>.............. OK\n\r" + - "ld ,nn.... OK\n\r" + - "ld (+1),nn............. OK\n\r" + - "ld ,(+1)...... OK\n\r" + - "ld ,(+1).......... OK\n\r" + - "ld a,(+1).............. OK\n\r" + - "ld ,nn....... OK\n\r" + - "ld ,........ OK\n\r" + - "ld ,........ OK\n\r" + - "ld a,(nnnn) / ld (nnnn),a..... OK\n\r" + - "ldd (1).................... OK\n\r" + - "ldd (2).................... OK\n\r" + - "ldi (1).................... OK\n\r" + - "ldi (2).................... OK\n\r" + - "neg........................... OK\n\r" + - "..................... OK\n\r" + - "........... OK\n\r" + - "shf/rot (+1)........... OK\n\r" + - "shf/rot .. OK\n\r" + - " n,..... OK\n\r" + - " n,(+1)....... OK\n\r" + - "ld (+1),...... OK\n\r" + - "ld (+1),.......... OK\n\r" + - "ld (+1),a.............. OK\n\r" + - "ld (),a................ OK\n\r" + - "Tests complete\n\r" XCTAssertEqual(targetOutput, output); } } } func testCCF() { - runTest("z80ccf") + let targetOutput = "???" + runTest("z80ccf", targetOutput: targetOutput) } func testMachine(_ testMachine: CSTestMachine, didTrapAtAddress address: UInt16) { let testMachineZ80 = testMachine as! CSTestMachineZ80 switch address { case 0x0010: - print("TODO") - - let cRegister = testMachineZ80.value(for: .C) - var textToAppend = "" - switch cRegister { - case 9: - var address = testMachineZ80.value(for: .DE) - var character: Character = " " - while true { - character = Character(UnicodeScalar(testMachineZ80.value(atAddress: address))) - if character == "$" { - break - } - textToAppend += String(character) - address = address + 1 - } - case 5: - textToAppend = String(describing: UnicodeScalar(testMachineZ80.value(for: .E))) - case 0: - done = true - default: - break - } - output += textToAppend - print(textToAppend) + let textToAppend = UnicodeScalar(testMachineZ80.value(for: .A))! + output += String(textToAppend) + print(textToAppend, terminator:"") case 0x7003: done = true From da0a9113d4ed2844e2c29aee74aced5dca19790a Mon Sep 17 00:00:00 2001 From: Thomas Harte Date: Sat, 22 Feb 2020 18:44:15 -0500 Subject: [PATCH 05/28] Introduces the full range of tests. Albeit that I don't know the correct output yet. --- .../Clock SignalTests/PatrikRakTests.swift | 20 +++++++++++++++++++ 1 file changed, 20 insertions(+) diff --git a/OSBindings/Mac/Clock SignalTests/PatrikRakTests.swift b/OSBindings/Mac/Clock SignalTests/PatrikRakTests.swift index cc6e4a831..a03005068 100644 --- a/OSBindings/Mac/Clock SignalTests/PatrikRakTests.swift +++ b/OSBindings/Mac/Clock SignalTests/PatrikRakTests.swift @@ -72,6 +72,26 @@ class PatrikRakTests: XCTestCase, CSTestMachineTrapHandler { runTest("z80ccf", targetOutput: targetOutput) } + func testDoc() { + let targetOutput = "???" + runTest("z80doc", targetOutput: targetOutput) + } + + func testDocFlags() { + let targetOutput = "???" + runTest("z80docflags", targetOutput: targetOutput) + } + + func testFull() { + let targetOutput = "???" + runTest("z80full", targetOutput: targetOutput) + } + + func testMemptr() { + let targetOutput = "???" + runTest("z80memptr", targetOutput: targetOutput) + } + func testMachine(_ testMachine: CSTestMachine, didTrapAtAddress address: UInt16) { let testMachineZ80 = testMachine as! CSTestMachineZ80 switch address { From e0475343f5e0ef32d2f4307e71ba200bf5e7fe53 Mon Sep 17 00:00:00 2001 From: Thomas Harte Date: Sat, 22 Feb 2020 18:58:24 -0500 Subject: [PATCH 06/28] Makes collated text easier to read. --- OSBindings/Mac/Clock SignalTests/PatrikRakTests.swift | 9 ++++++++- 1 file changed, 8 insertions(+), 1 deletion(-) diff --git a/OSBindings/Mac/Clock SignalTests/PatrikRakTests.swift b/OSBindings/Mac/Clock SignalTests/PatrikRakTests.swift index a03005068..80c0350c1 100644 --- a/OSBindings/Mac/Clock SignalTests/PatrikRakTests.swift +++ b/OSBindings/Mac/Clock SignalTests/PatrikRakTests.swift @@ -96,7 +96,14 @@ class PatrikRakTests: XCTestCase, CSTestMachineTrapHandler { let testMachineZ80 = testMachine as! CSTestMachineZ80 switch address { case 0x0010: - let textToAppend = UnicodeScalar(testMachineZ80.value(for: .A))! + var characterCode = testMachineZ80.value(for: .A) + + // Of the control codes, retain only new line. Map the rest to space. + if characterCode < 32 && characterCode != 13 { + characterCode = 32 + } + + let textToAppend = UnicodeScalar(characterCode)! output += String(textToAppend) print(textToAppend, terminator:"") From 989628a0248f3dc7a6d7c06e6dd3ba056e015cb2 Mon Sep 17 00:00:00 2001 From: Thomas Harte Date: Sat, 22 Feb 2020 23:07:14 -0500 Subject: [PATCH 07/28] Switches to looking for "Result: all tests passed." as a success/failure test. --- .../Clock SignalTests/PatrikRakTests.swift | 30 +++++++++++-------- 1 file changed, 17 insertions(+), 13 deletions(-) diff --git a/OSBindings/Mac/Clock SignalTests/PatrikRakTests.swift b/OSBindings/Mac/Clock SignalTests/PatrikRakTests.swift index 80c0350c1..c0e419ea5 100644 --- a/OSBindings/Mac/Clock SignalTests/PatrikRakTests.swift +++ b/OSBindings/Mac/Clock SignalTests/PatrikRakTests.swift @@ -14,7 +14,7 @@ class PatrikRakTests: XCTestCase, CSTestMachineTrapHandler { fileprivate var done = false fileprivate var output = "" - private func runTest(_ name: String, targetOutput: String) { + private func runTest(_ name: String) { if let filename = Bundle(for: type(of: self)).path(forResource: name, ofType: "tap") { if let testData = try? Data(contentsOf: URL(fileURLWithPath: filename)) { @@ -62,34 +62,34 @@ class PatrikRakTests: XCTestCase, CSTestMachineTrapHandler { machine.runForNumber(ofCycles: cyclesPerIteration) } - XCTAssertEqual(targetOutput, output); + let successRange = output.range(of: "Result: all tests passed.") + XCTAssertNotEqual(successRange, nil) + + if successRange == nil { + print("Output was: \(output)") + } } } } func testCCF() { - let targetOutput = "???" - runTest("z80ccf", targetOutput: targetOutput) + runTest("z80ccf") } func testDoc() { - let targetOutput = "???" - runTest("z80doc", targetOutput: targetOutput) + runTest("z80doc") } func testDocFlags() { - let targetOutput = "???" - runTest("z80docflags", targetOutput: targetOutput) + runTest("z80docflags") } func testFull() { - let targetOutput = "???" - runTest("z80full", targetOutput: targetOutput) + runTest("z80full") } func testMemptr() { - let targetOutput = "???" - runTest("z80memptr", targetOutput: targetOutput) + runTest("z80memptr") } func testMachine(_ testMachine: CSTestMachine, didTrapAtAddress address: UInt16) { @@ -103,9 +103,13 @@ class PatrikRakTests: XCTestCase, CSTestMachineTrapHandler { characterCode = 32 } + // Similarly, map down unprintables. + if characterCode >= 127 { + characterCode = 32 + } + let textToAppend = UnicodeScalar(characterCode)! output += String(textToAppend) - print(textToAppend, terminator:"") case 0x7003: done = true From 3f3229851b84feffe95f8ee1533c19894ea215b5 Mon Sep 17 00:00:00 2001 From: Thomas Harte Date: Sun, 23 Feb 2020 00:32:33 -0500 Subject: [PATCH 08/28] Implements MEMPTR for IN. --- OSBindings/Mac/Clock SignalTests/PatrikRakTests.swift | 2 ++ OSBindings/Mac/Clock SignalTests/Z80MemptrTests.swift | 6 +++++- Processors/Z80/Implementation/Z80Implementation.hpp | 2 ++ Processors/Z80/Implementation/Z80Storage.cpp | 2 +- 4 files changed, 10 insertions(+), 2 deletions(-) diff --git a/OSBindings/Mac/Clock SignalTests/PatrikRakTests.swift b/OSBindings/Mac/Clock SignalTests/PatrikRakTests.swift index c0e419ea5..9f9250605 100644 --- a/OSBindings/Mac/Clock SignalTests/PatrikRakTests.swift +++ b/OSBindings/Mac/Clock SignalTests/PatrikRakTests.swift @@ -90,6 +90,7 @@ class PatrikRakTests: XCTestCase, CSTestMachineTrapHandler { func testMemptr() { runTest("z80memptr") + // Result: 102 of 152 tests failed. } func testMachine(_ testMachine: CSTestMachine, didTrapAtAddress address: UInt16) { @@ -110,6 +111,7 @@ class PatrikRakTests: XCTestCase, CSTestMachineTrapHandler { let textToAppend = UnicodeScalar(characterCode)! output += String(textToAppend) +// print(textToAppend, terminator:"") case 0x7003: done = true diff --git a/OSBindings/Mac/Clock SignalTests/Z80MemptrTests.swift b/OSBindings/Mac/Clock SignalTests/Z80MemptrTests.swift index 7ef2513f4..8a815c6d5 100644 --- a/OSBindings/Mac/Clock SignalTests/Z80MemptrTests.swift +++ b/OSBindings/Mac/Clock SignalTests/Z80MemptrTests.swift @@ -279,18 +279,22 @@ class Z80MemptrTests: XCTestCase { */ /* TODO: - JP(except JP rp)/CALL addr (even in case of conditional call/jp, independantly on condition satisfied or not) + JP(except JP rp)/CALL addr (even in case of conditional call/jp, independently on condition satisfied or not) MEMPTR = addr */ /* TODO: IN A,(port) MEMPTR = (A_before_operation << 8) + port + 1 + + (implemented, not tested) */ /* TODO: IN A,(C) MEMPTR = BC + 1 + + (implemented, not tested) */ /* TODO: diff --git a/Processors/Z80/Implementation/Z80Implementation.hpp b/Processors/Z80/Implementation/Z80Implementation.hpp index 7ef132313..12d52e834 100644 --- a/Processors/Z80/Implementation/Z80Implementation.hpp +++ b/Processors/Z80/Implementation/Z80Implementation.hpp @@ -804,6 +804,7 @@ template < class T, sign_result_ = zero_result_ = bit53_result_ = *static_cast(operation->source); set_parity(sign_result_); set_did_compute_flags(); + memptr_.full = bc_.full + 1; break; case MicroOp::SetAFlags: @@ -840,6 +841,7 @@ template < class T, case MicroOp::RETN: iff1_ = iff2_; if(irq_line_ && iff1_) request_status_ |= Interrupt::IRQ; + memptr_ = pc_; break; case MicroOp::HALT: diff --git a/Processors/Z80/Implementation/Z80Storage.cpp b/Processors/Z80/Implementation/Z80Storage.cpp index e18836614..ed45f6d9a 100644 --- a/Processors/Z80/Implementation/Z80Storage.cpp +++ b/Processors/Z80/Implementation/Z80Storage.cpp @@ -487,7 +487,7 @@ void ProcessorStorage::assemble_base_page(InstructionPage &target, RegisterPair1 /* 0xd6 SUB n */ StdInstr(ReadInc(pc_, temp8_), {MicroOp::SUB8, &temp8_}), /* 0xd7 RST 10h */ RST(), /* 0xd8 RET C */ RET(TestC), /* 0xd9 EXX */ StdInstr({MicroOp::EXX}), - /* 0xda JP C */ JP(TestC), /* 0xdb IN A, (n) */StdInstr(ReadInc(pc_, temp16_.halves.low), {MicroOp::Move8, &a_, &temp16_.halves.high}, Input(temp16_, a_)), + /* 0xda JP C */ JP(TestC), /* 0xdb IN A, (n) */StdInstr(ReadInc(pc_, memptr_.halves.low), {MicroOp::Move8, &a_, &memptr_.halves.high}, Input(memptr_, a_), Inc16(memptr_)), /* 0xdc CALL C */ CALL(TestC), /* 0xdd [DD page] */StdInstr({MicroOp::SetInstructionPage, &dd_page_}), /* 0xde SBC A, n */ StdInstr(ReadInc(pc_, temp8_), {MicroOp::SBC8, &temp8_}), /* 0xdf RST 18h */ RST(), From 79dd402bc8d9c23374fcb8cc177f3ea42b1a9895 Mon Sep 17 00:00:00 2001 From: Thomas Harte Date: Sun, 23 Feb 2020 16:12:28 -0500 Subject: [PATCH 09/28] Consolidates different test port input selection. --- .../Bridges/TestMachineZ80.h | 7 ++++++ .../Bridges/TestMachineZ80.mm | 24 +++++++++++++++++++ .../Mac/Clock SignalTests/FUSETests.swift | 1 + .../Clock SignalTests/PatrikRakTests.swift | 3 ++- Processors/Z80/AllRAM/Z80AllRAM.cpp | 8 +++---- Processors/Z80/AllRAM/Z80AllRAM.hpp | 14 ++++++++--- 6 files changed, 48 insertions(+), 9 deletions(-) diff --git a/OSBindings/Mac/Clock SignalTests/Bridges/TestMachineZ80.h b/OSBindings/Mac/Clock SignalTests/Bridges/TestMachineZ80.h index 0d29f6af8..1a2300604 100644 --- a/OSBindings/Mac/Clock SignalTests/Bridges/TestMachineZ80.h +++ b/OSBindings/Mac/Clock SignalTests/Bridges/TestMachineZ80.h @@ -46,6 +46,11 @@ typedef NS_ENUM(NSInteger, CSTestMachineZ80Register) { CSTestMachineZ80RegisterMemPtr }; +typedef NS_ENUM(NSInteger, CSTestMachinePortLogic) { + CSTestMachinePortLogicReturnUpperByte, + CSTestMachinePortLogicReturn191 +}; + @interface CSTestMachineZ80 : CSTestMachine - (void)setData:(nonnull NSData *)data atAddress:(uint16_t)startAddress; @@ -67,4 +72,6 @@ typedef NS_ENUM(NSInteger, CSTestMachineZ80Register) { @property(nonatomic) BOOL irqLine; @property(nonatomic) BOOL waitLine; +@property(nonatomic) CSTestMachinePortLogic portLogic; + @end diff --git a/OSBindings/Mac/Clock SignalTests/Bridges/TestMachineZ80.mm b/OSBindings/Mac/Clock SignalTests/Bridges/TestMachineZ80.mm index 2e967f255..a95a215c1 100644 --- a/OSBindings/Mac/Clock SignalTests/Bridges/TestMachineZ80.mm +++ b/OSBindings/Mac/Clock SignalTests/Bridges/TestMachineZ80.mm @@ -70,6 +70,16 @@ static CPU::Z80::Register registerForRegister(CSTestMachineZ80Register reg) { } } +#pragma mark - Port Logic + +struct PortAccessDelegateTopByte: public CPU::Z80::AllRAMProcessor::PortAccessDelegate { + uint8_t z80_all_ram_processor_input(uint16_t port) final { return port >> 8; } +}; + +struct PortAccessDelegate191: public CPU::Z80::AllRAMProcessor::PortAccessDelegate { + uint8_t z80_all_ram_processor_input(uint16_t port) final { return 191; } +}; + #pragma mark - Capture class @interface CSTestMachineZ80BusOperationCapture() @@ -104,6 +114,9 @@ static CPU::Z80::Register registerForRegister(CSTestMachineZ80Register reg) { NSMutableArray *_busOperationCaptures; int _timeSeekingReadOpcode; + + PortAccessDelegateTopByte _topBytePortDelegate; + PortAccessDelegate191 _value191PortDelegate; } #pragma mark - Lifecycle @@ -114,6 +127,7 @@ static CPU::Z80::Register registerForRegister(CSTestMachineZ80Register reg) { _processor->reset_power_on(); _busOperationHandler = new BusOperationHandler(self); _busOperationCaptures = [[NSMutableArray alloc] init]; + self.portLogic = CSTestMachinePortLogicReturnUpperByte; } return self; } @@ -173,6 +187,16 @@ static CPU::Z80::Register registerForRegister(CSTestMachineZ80Register reg) { _processor->set_wait_line(waitLine ? true : false); } +- (void)setPortLogic:(CSTestMachinePortLogic)portLogic { + _portLogic = portLogic; + + if(_portLogic == CSTestMachinePortLogicReturn191) { + _processor->set_port_access_delegate(&_value191PortDelegate); + } else { + _processor->set_port_access_delegate(&_topBytePortDelegate); + } +} + - (CPU::AllRAMProcessor *)processor { return _processor; } diff --git a/OSBindings/Mac/Clock SignalTests/FUSETests.swift b/OSBindings/Mac/Clock SignalTests/FUSETests.swift index b79c313e0..c41450627 100644 --- a/OSBindings/Mac/Clock SignalTests/FUSETests.swift +++ b/OSBindings/Mac/Clock SignalTests/FUSETests.swift @@ -176,6 +176,7 @@ class FUSETests: XCTestCase { let targetState = RegisterState(dictionary: outputDictionary["state"] as! [String: Any]) let machine = CSTestMachineZ80() + machine.portLogic = .returnUpperByte machine.captureBusActivity = true initialState.set(onMachine: machine) diff --git a/OSBindings/Mac/Clock SignalTests/PatrikRakTests.swift b/OSBindings/Mac/Clock SignalTests/PatrikRakTests.swift index 9f9250605..87e4249a7 100644 --- a/OSBindings/Mac/Clock SignalTests/PatrikRakTests.swift +++ b/OSBindings/Mac/Clock SignalTests/PatrikRakTests.swift @@ -31,6 +31,7 @@ class PatrikRakTests: XCTestCase, CSTestMachineTrapHandler { // Create a machine. let machine = CSTestMachineZ80() + machine.portLogic = .return191 // Copy everything from finalBlock+1 to the end of the file to $8000. let fileContents = testData.subdata(in: finalBlock+1 ..< testData.count) @@ -90,7 +91,7 @@ class PatrikRakTests: XCTestCase, CSTestMachineTrapHandler { func testMemptr() { runTest("z80memptr") - // Result: 102 of 152 tests failed. + // Current status: 101 of 152 tests failed. } func testMachine(_ testMachine: CSTestMachine, didTrapAtAddress address: UInt16) { diff --git a/Processors/Z80/AllRAM/Z80AllRAM.cpp b/Processors/Z80/AllRAM/Z80AllRAM.cpp index 0da164330..603a0d1d7 100644 --- a/Processors/Z80/AllRAM/Z80AllRAM.cpp +++ b/Processors/Z80/AllRAM/Z80AllRAM.cpp @@ -36,9 +36,7 @@ class ConcreteAllRAMProcessor: public AllRAMProcessor, public BusHandler { case PartialMachineCycle::Output: break; case PartialMachineCycle::Input: - // This logic is selected specifically because it seems to match - // the FUSE unit tests. It might need factoring out. - *cycle.value = address >> 8; + *cycle.value = port_delegate_ ? port_delegate_->z80_all_ram_processor_input(address) : 0xff; break; case PartialMachineCycle::Internal: @@ -55,8 +53,8 @@ class ConcreteAllRAMProcessor: public AllRAMProcessor, public BusHandler { break; } - if(delegate_ != nullptr) { - delegate_->z80_all_ram_processor_did_perform_bus_operation(*this, cycle.operation, address, cycle.value ? *cycle.value : 0x00, timestamp_); + if(memory_delegate_ != nullptr) { + memory_delegate_->z80_all_ram_processor_did_perform_bus_operation(*this, cycle.operation, address, cycle.value ? *cycle.value : 0x00, timestamp_); } return HalfCycles(0); diff --git a/Processors/Z80/AllRAM/Z80AllRAM.hpp b/Processors/Z80/AllRAM/Z80AllRAM.hpp index 505d73c2c..1d55f9dea 100644 --- a/Processors/Z80/AllRAM/Z80AllRAM.hpp +++ b/Processors/Z80/AllRAM/Z80AllRAM.hpp @@ -25,7 +25,14 @@ class AllRAMProcessor: virtual void z80_all_ram_processor_did_perform_bus_operation(CPU::Z80::AllRAMProcessor &processor, CPU::Z80::PartialMachineCycle::Operation operation, uint16_t address, uint8_t value, HalfCycles time_stamp) = 0; }; inline void set_memory_access_delegate(MemoryAccessDelegate *delegate) { - delegate_ = delegate; + memory_delegate_ = delegate; + } + + struct PortAccessDelegate { + virtual uint8_t z80_all_ram_processor_input(uint16_t port) { return 0xff; } + }; + inline void set_port_access_delegate(PortAccessDelegate *delegate) { + port_delegate_ = delegate; } virtual void run_for(const Cycles cycles) = 0; @@ -39,8 +46,9 @@ class AllRAMProcessor: virtual void set_wait_line(bool value) = 0; protected: - MemoryAccessDelegate *delegate_; - AllRAMProcessor() : ::CPU::AllRAMProcessor(65536), delegate_(nullptr) {} + MemoryAccessDelegate *memory_delegate_ = nullptr; + PortAccessDelegate *port_delegate_ = nullptr; + AllRAMProcessor() : ::CPU::AllRAMProcessor(65536) {} }; } From 7959d243f6b7b28fe890415fefa4f05597f2aa55 Mon Sep 17 00:00:00 2001 From: Thomas Harte Date: Mon, 24 Feb 2020 23:31:42 -0500 Subject: [PATCH 10/28] Adds single-stepping. Of a kind. --- .../Bridges/TestMachineZ80.h | 1 + .../Bridges/TestMachineZ80.mm | 4 +++ Processors/Z80/AllRAM/Z80AllRAM.cpp | 35 ++++++++++++++----- Processors/Z80/AllRAM/Z80AllRAM.hpp | 1 + Processors/Z80/Implementation/Z80Storage.cpp | 25 ++++++++----- Processors/Z80/Z80.hpp | 7 ++++ 6 files changed, 56 insertions(+), 17 deletions(-) diff --git a/OSBindings/Mac/Clock SignalTests/Bridges/TestMachineZ80.h b/OSBindings/Mac/Clock SignalTests/Bridges/TestMachineZ80.h index 1a2300604..720b25170 100644 --- a/OSBindings/Mac/Clock SignalTests/Bridges/TestMachineZ80.h +++ b/OSBindings/Mac/Clock SignalTests/Bridges/TestMachineZ80.h @@ -58,6 +58,7 @@ typedef NS_ENUM(NSInteger, CSTestMachinePortLogic) { - (uint8_t)valueAtAddress:(uint16_t)address; - (void)runForNumberOfCycles:(int)cycles; +- (void)runForInstruction; - (void)setValue:(uint16_t)value forRegister:(CSTestMachineZ80Register)reg; - (uint16_t)valueForRegister:(CSTestMachineZ80Register)reg; diff --git a/OSBindings/Mac/Clock SignalTests/Bridges/TestMachineZ80.mm b/OSBindings/Mac/Clock SignalTests/Bridges/TestMachineZ80.mm index a95a215c1..65ec87bc7 100644 --- a/OSBindings/Mac/Clock SignalTests/Bridges/TestMachineZ80.mm +++ b/OSBindings/Mac/Clock SignalTests/Bridges/TestMachineZ80.mm @@ -146,6 +146,10 @@ struct PortAccessDelegate191: public CPU::Z80::AllRAMProcessor::PortAccessDelega _processor->run_for(Cycles(cycles)); } +- (void)runForInstruction { + _processor->run_for_instruction(); +} + - (void)setValue:(uint16_t)value forRegister:(CSTestMachineZ80Register)reg { _processor->set_value_of_register(registerForRegister(reg), value); } diff --git a/Processors/Z80/AllRAM/Z80AllRAM.cpp b/Processors/Z80/AllRAM/Z80AllRAM.cpp index 603a0d1d7..9c6c22958 100644 --- a/Processors/Z80/AllRAM/Z80AllRAM.cpp +++ b/Processors/Z80/AllRAM/Z80AllRAM.cpp @@ -60,40 +60,59 @@ class ConcreteAllRAMProcessor: public AllRAMProcessor, public BusHandler { return HalfCycles(0); } - void run_for(const Cycles cycles) { + void run_for(const Cycles cycles) final { z80_.run_for(cycles); } - uint16_t get_value_of_register(Register r) { + void run_for_instruction() final { + int toggles = 0; + int cycles = 0; + + // Run: + // (1) until is_starting_new_instruction is true; + // (2) until it is false again; and + // (3) until it is true again. + while(true) { + if(z80_.is_starting_new_instruction() != (toggles&1)) { + ++toggles; + if(toggles == 3) break; + } + z80_.run_for(Cycles(1)); + ++cycles; + } + } + + uint16_t get_value_of_register(Register r) final { return z80_.get_value_of_register(r); } - void set_value_of_register(Register r, uint16_t value) { + void set_value_of_register(Register r, uint16_t value) final { z80_.set_value_of_register(r, value); } - bool get_halt_line() { + bool get_halt_line() final { return z80_.get_halt_line(); } - void reset_power_on() { + void reset_power_on() final { return z80_.reset_power_on(); } - void set_interrupt_line(bool value) { + void set_interrupt_line(bool value) final { z80_.set_interrupt_line(value); } - void set_non_maskable_interrupt_line(bool value) { + void set_non_maskable_interrupt_line(bool value) final { z80_.set_non_maskable_interrupt_line(value); } - void set_wait_line(bool value) { + void set_wait_line(bool value) final { z80_.set_wait_line(value); } private: CPU::Z80::Processor z80_; + bool was_m1_ = false; }; } diff --git a/Processors/Z80/AllRAM/Z80AllRAM.hpp b/Processors/Z80/AllRAM/Z80AllRAM.hpp index 1d55f9dea..c8f160a20 100644 --- a/Processors/Z80/AllRAM/Z80AllRAM.hpp +++ b/Processors/Z80/AllRAM/Z80AllRAM.hpp @@ -36,6 +36,7 @@ class AllRAMProcessor: } virtual void run_for(const Cycles cycles) = 0; + virtual void run_for_instruction() = 0; virtual uint16_t get_value_of_register(Register r) = 0; virtual void set_value_of_register(Register r, uint16_t value) = 0; virtual bool get_halt_line() = 0; diff --git a/Processors/Z80/Implementation/Z80Storage.cpp b/Processors/Z80/Implementation/Z80Storage.cpp index ed45f6d9a..0dc59eec4 100644 --- a/Processors/Z80/Implementation/Z80Storage.cpp +++ b/Processors/Z80/Implementation/Z80Storage.cpp @@ -80,6 +80,7 @@ ProcessorStorage::ProcessorStorage() { /* The following are helper macros that define common parts of instructions */ #define Inc16(r) {(&r == &pc_) ? MicroOp::IncrementPC : MicroOp::Increment16, &r.full} +#define Inc8NoFlags(r) {MicroOp::Increment8NoFlags, &r} #define ReadInc(addr, val) Read3(addr, val), Inc16(addr) #define Read4Inc(addr, val) Read4(addr, val), Inc16(addr) @@ -104,10 +105,10 @@ ProcessorStorage::ProcessorStorage() { /* The following are actual instructions */ #define NOP Sequence(BusOp(Refresh(4))) -#define JP(cc) StdInstr(Read16Inc(pc_, temp16_), {MicroOp::cc, nullptr}, {MicroOp::Move16, &temp16_.full, &pc_.full}) -#define CALL(cc) StdInstr(ReadInc(pc_, temp16_.halves.low), {MicroOp::cc, conditional_call_untaken_program_.data()}, Read4Inc(pc_, temp16_.halves.high), Push(pc_), {MicroOp::Move16, &temp16_.full, &pc_.full}) +#define JP(cc) StdInstr(Read16Inc(pc_, memptr_), {MicroOp::cc, nullptr}, {MicroOp::Move16, &memptr_.full, &pc_.full}) +#define CALL(cc) StdInstr(ReadInc(pc_, memptr_.halves.low), {MicroOp::cc, conditional_call_untaken_program_.data()}, Read4Inc(pc_, memptr_.halves.high), Push(pc_), {MicroOp::Move16, &memptr_.full, &pc_.full}) #define RET(cc) Instr(6, {MicroOp::cc, nullptr}, Pop(memptr_), {MicroOp::Move16, &memptr_.full, &pc_.full}) -#define JR(cc) StdInstr(ReadInc(pc_, temp8_), {MicroOp::cc, nullptr}, InternalOperation(10), {MicroOp::CalculateIndexAddress, &pc_.full}, {MicroOp::Move16, &memptr_.full, &pc_.full}) +#define JR(cc) StdInstr(ReadInc(pc_, temp8_), {MicroOp::Move16, &pc_.full, &memptr_.full}, {MicroOp::cc, nullptr}, InternalOperation(10), {MicroOp::CalculateIndexAddress, &pc_.full}, {MicroOp::Move16, &memptr_.full, &pc_.full}) #define RST() Instr(6, {MicroOp::CalculateRSTDestination}, Push(pc_), {MicroOp::Move16, &memptr_.full, &pc_.full}) #define LD(a, b) StdInstr({MicroOp::Move8, &b, &a}) @@ -166,7 +167,7 @@ ProcessorStorage::ProcessorStorage() { #define SBC16(d, s) StdInstr(InternalOperation(8), InternalOperation(6), {MicroOp::SBC16, &s.full, &d.full}) void ProcessorStorage::install_default_instruction_set() { - MicroOp conditional_call_untaken_program[] = Sequence(ReadInc(pc_, temp16_.halves.high)); + MicroOp conditional_call_untaken_program[] = Sequence(ReadInc(pc_, memptr_.halves.high)); copy_program(conditional_call_untaken_program, conditional_call_untaken_program_); assemble_base_page(base_page_, hl_, false, cb_page_); @@ -244,7 +245,7 @@ void ProcessorStorage::install_default_instruction_set() { void ProcessorStorage::assemble_ed_page(InstructionPage &target) { #define IN_C(r) StdInstr(Input(bc_, r), {MicroOp::SetInFlags, &r}) -#define OUT_C(r) StdInstr(Output(bc_, r)) +#define OUT_C(r) StdInstr(Output(bc_, r), {MicroOp::SetOutFlags, &r}) #define IN_OUT(r) IN_C(r), OUT_C(r) #define NOP_ROW() NOP, NOP, NOP, NOP, NOP, NOP, NOP, NOP, NOP, NOP, NOP, NOP, NOP, NOP, NOP, NOP @@ -370,7 +371,7 @@ void ProcessorStorage::assemble_base_page(InstructionPage &target, RegisterPair1 DEC_INC_DEC_LD(bc_, bc_.halves.low), /* 0x0f RRCA */ StdInstr({MicroOp::RRCA}), - /* 0x10 DJNZ */ Instr(6, ReadInc(pc_, temp8_), {MicroOp::DJNZ}, InternalOperation(10), {MicroOp::CalculateIndexAddress, &pc_.full}, {MicroOp::Move16, &memptr_.full, &pc_.full}), + /* 0x10 DJNZ */ Instr(6, ReadInc(pc_, temp8_), {MicroOp::Move16, &pc_.full, &memptr_.full}, {MicroOp::DJNZ}, InternalOperation(10), {MicroOp::CalculateIndexAddress, &pc_.full}, {MicroOp::Move16, &memptr_.full, &pc_.full}), /* 0x11 LD DE, nn */ StdInstr(Read16Inc(pc_, de_)), /* 0x12 LD (DE), A */ StdInstr({MicroOp::SetAddrAMemptr, &de_.full}, Write3(de_, a_)), @@ -476,13 +477,13 @@ void ProcessorStorage::assemble_base_page(InstructionPage &target, RegisterPair1 /* 0xc4 CALL NZ */ CALL(TestNZ), /* 0xc5 PUSH BC */ Instr(6, Push(bc_)), /* 0xc6 ADD A, n */ StdInstr(ReadInc(pc_, temp8_), {MicroOp::ADD8, &temp8_}), /* 0xc7 RST 00h */ RST(), - /* 0xc8 RET Z */ RET(TestZ), /* 0xc9 RET */ StdInstr(Pop(pc_)), + /* 0xc8 RET Z */ RET(TestZ), /* 0xc9 RET */ StdInstr(Pop(memptr_), {MicroOp::Move16, &memptr_.full, &pc_.full}), /* 0xca JP Z */ JP(TestZ), /* 0xcb [CB page] */StdInstr(FINDEX(), {MicroOp::SetInstructionPage, &cb_page}), - /* 0xcc CALL Z */ CALL(TestZ), /* 0xcd CALL */ StdInstr(ReadInc(pc_, temp16_.halves.low), Read4Inc(pc_, temp16_.halves.high), Push(pc_), {MicroOp::Move16, &temp16_.full, &pc_.full}), + /* 0xcc CALL Z */ CALL(TestZ), /* 0xcd CALL */ StdInstr(ReadInc(pc_, memptr_.halves.low), Read4Inc(pc_, memptr_.halves.high), Push(pc_), {MicroOp::Move16, &memptr_.full, &pc_.full}), /* 0xce ADC A, n */ StdInstr(ReadInc(pc_, temp8_), {MicroOp::ADC8, &temp8_}), /* 0xcf RST 08h */ RST(), /* 0xd0 RET NC */ RET(TestNC), /* 0xd1 POP DE */ StdInstr(Pop(de_)), - /* 0xd2 JP NC */ JP(TestNC), /* 0xd3 OUT (n), A */StdInstr(ReadInc(pc_, temp16_.halves.low), {MicroOp::Move8, &a_, &temp16_.halves.high}, Output(temp16_, a_)), + /* 0xd2 JP NC */ JP(TestNC), /* 0xd3 OUT (n), A */StdInstr(ReadInc(pc_, memptr_.halves.low), {MicroOp::Move8, &a_, &memptr_.halves.high}, Output(memptr_, a_), Inc8NoFlags(memptr_.halves.low)), /* 0xd4 CALL NC */ CALL(TestNC), /* 0xd5 PUSH DE */ Instr(6, Push(de_)), /* 0xd6 SUB n */ StdInstr(ReadInc(pc_, temp8_), {MicroOp::SUB8, &temp8_}), /* 0xd7 RST 10h */ RST(), @@ -543,3 +544,9 @@ void ProcessorStorage::assemble_fetch_decode_execute(InstructionPage &target, in copy_program((length == 4) ? normal_fetch_decode_execute : short_fetch_decode_execute, target.fetch_decode_execute); target.fetch_decode_execute_data = target.fetch_decode_execute.data(); } + +bool ProcessorBase::is_starting_new_instruction() { + return + current_instruction_page_ == &base_page_ && + scheduled_program_counter_ == &base_page_.fetch_decode_execute[0]; +} diff --git a/Processors/Z80/Z80.hpp b/Processors/Z80/Z80.hpp index 55cb4080d..d0ee4a1a9 100644 --- a/Processors/Z80/Z80.hpp +++ b/Processors/Z80/Z80.hpp @@ -224,6 +224,13 @@ class ProcessorBase: public ProcessorStorage { reset at the first opportunity. Use @c reset_power_on to disable that behaviour. */ void reset_power_on(); + + /*! + @returns @c true if the Z80 is currently beginning to fetch a new instruction; @c false otherwise. + + This is not a speedy operation. + */ + bool is_starting_new_instruction(); }; /*! From 3097c4ccae8afe06929304948a847a0b375382d1 Mon Sep 17 00:00:00 2001 From: Thomas Harte Date: Mon, 24 Feb 2020 23:32:18 -0500 Subject: [PATCH 11/28] Improves MEMPTR testing and some results. --- .../Clock SignalTests/PatrikRakTests.swift | 2 + .../Clock SignalTests/Z80MemptrTests.swift | 273 ++++++++++++++++-- .../Z80/Implementation/Z80Implementation.hpp | 25 +- Processors/Z80/Implementation/Z80Storage.hpp | 21 +- 4 files changed, 277 insertions(+), 44 deletions(-) diff --git a/OSBindings/Mac/Clock SignalTests/PatrikRakTests.swift b/OSBindings/Mac/Clock SignalTests/PatrikRakTests.swift index 87e4249a7..c3760f0b2 100644 --- a/OSBindings/Mac/Clock SignalTests/PatrikRakTests.swift +++ b/OSBindings/Mac/Clock SignalTests/PatrikRakTests.swift @@ -87,6 +87,8 @@ class PatrikRakTests: XCTestCase, CSTestMachineTrapHandler { func testFull() { runTest("z80full") + // Current status: 002 of 152 tests failed. + // Specifically: BIT N,(HL) and BIT N,[R,(HL)], i.e. MEMPTR by proxy. } func testMemptr() { diff --git a/OSBindings/Mac/Clock SignalTests/Z80MemptrTests.swift b/OSBindings/Mac/Clock SignalTests/Z80MemptrTests.swift index 8a815c6d5..5e0d37ad2 100644 --- a/OSBindings/Mac/Clock SignalTests/Z80MemptrTests.swift +++ b/OSBindings/Mac/Clock SignalTests/Z80MemptrTests.swift @@ -8,10 +8,10 @@ import XCTest -class Z80MemptrTests: XCTestCase { - private let machine = CSTestMachineZ80() +class Z80MemptrTester: XCTestCase { + let machine = CSTestMachineZ80() - private func test(program : [UInt8], length : Int32, initialValue : UInt16) -> UInt16 { + private func test(program : [UInt8], initialValue : UInt16) -> UInt16 { // Create a machine and install the supplied program at address 0, setting the PC to run from there machine.setValue(0x0000, for: .programCounter) machine.setData(Data(_: program), atAddress: 0x0000) @@ -19,15 +19,114 @@ class Z80MemptrTests: XCTestCase { // Set the initial value of memptr, run for the requested number of cycles, // return the new value machine.setValue(initialValue, for: .memPtr) - machine.runForNumber(ofCycles: length) + machine.runForInstruction() return machine.value(for: .memPtr) } - fileprivate func insert16(program: inout [UInt8], address: Int, offset: size_t) { + private func testPage(_ prefix: UInt8, exclusions: [Int]) { + for opcode in 0 ..< 256 { + if exclusions.contains(opcode) { + continue + } + + var program: [UInt8] = [ + (prefix != 0) ? prefix : UInt8(opcode), UInt8(opcode), 0, 0 + ] + + let argumentPosition = (prefix != 0) ? 2 : 1 + for _ in 0 ..< 10 { + let random = arc4random_uniform(65536) + program[argumentPosition + 0] = UInt8(random & 0x00ff) + program[argumentPosition + 1] = UInt8(random >> 8) + + let expectedResult = UInt16(arc4random_uniform(65536)) + + let result = test(program: program, initialValue: expectedResult) + XCTAssertEqual(result, expectedResult, "Failed for opcode \(String(opcode, radix:16))") + + // One failure will do. + if result != expectedResult { + break + } + } + } + } + + private func insert16(program: inout [UInt8], address: Int, offset: size_t) { program[offset] = UInt8(address & 0x00ff) program[offset + 1] = UInt8(address >> 8) } + /// Tests that everything not listed in the documentation has no effect upon MEMPTR. + func testStandardPageOthers() { + testPage(0, exclusions: [ + 0x02, // LD (BC), A + 0x09, // ADD HL, BC + 0x0a, // LD A, (BC) + 0x10, // DJNZ + 0x12, // LD (DE), A + 0x18, // JR + 0x19, // ADD HL, DE + 0x1a, // LD A, (DE) + 0x20, // JR NZ + 0x22, // LD (nn), HL + 0x28, // JR Z + 0x29, // ADD HL, HL + 0x30, // JR NC + 0x32, // LD (nn), A + 0x38, // JR C + 0x39, // ADD HL, SP + 0x3a, // LD A, (nn) + + 0xcb, // CB page + 0xdd, // DD page + 0xed, // ED page + 0xfd, // FD page + ]) + } + + func testEDPageOthers() { + testPage(0xed, exclusions: [ + 0x42, // SBC HL, BC + 0x43, // LD (nn), HL + 0x45, // RETN (??) + 0x4a, // ADC HL, BC + 0x4d, // RETI + 0x52, // SBC HL, DE + 0x53, // LD (nn), DE + 0x55, // RETN (??) + 0x5a, // ADC HL, DE + 0x5d, // RETN (??) + 0x62, // SBC HL, HL + 0x63, // LD (nn), HL + 0x65, // RETN (??) + 0x67, // RRD + 0x6a, // ADC HL, HL + 0x6d, // RETN (??) + 0x6f, // RLD + 0x72, // SBC HL, SP + 0x73, // LD (nn), SP + 0x75, // RETN (??) + 0x78, // IN A, (C) + 0x79, // OUT (C), A + 0x7a, // ADC HL, SP + 0x7d, // RETN (??) + 0xa1, // CPI + 0xa2, // INI + 0xa3, // OUTI + 0xa9, // CPD + 0xaa, // IND + 0xab, // OUTD + 0xb1, // CPIR + 0xb3, // OUIR + 0xb9, // CPDR + 0xbb // OTDR + ]) +// testPage(0xcb, exclusions: []) +// testPage(0xdd, exclusions: []) +// testPage(0xfd, exclusions: []) + } + /* Re: comments below: All the CPU chips tested give the same results except KP1858BM1 and T34BM1 slices noted as "BM1". @@ -44,7 +143,7 @@ class Z80MemptrTests: XCTestCase { program[2] = UInt8(addr >> 8) let expectedResult = UInt16((addr + 1) & 0xffff) - let result = test(program: program, length: 13, initialValue: 0xffff) + let result = test(program: program, initialValue: 0xffff) XCTAssertEqual(result, expectedResult) } } @@ -73,9 +172,9 @@ class Z80MemptrTests: XCTestCase { let expectedResult = UInt16(((addr + 1) & 0xff) + (a << 8)) - let bcResult = test(program: bcProgram, length: 7, initialValue: 0xffff) - let deResult = test(program: deProgram, length: 7, initialValue: 0xffff) - let nnResult = test(program: nnProgram, length: 13, initialValue: 0xffff) + let bcResult = test(program: bcProgram, initialValue: 0xffff) + let deResult = test(program: deProgram, initialValue: 0xffff) + let nnResult = test(program: nnProgram, initialValue: 0xffff) XCTAssertEqual(bcResult, expectedResult) XCTAssertEqual(deResult, expectedResult) @@ -99,8 +198,8 @@ class Z80MemptrTests: XCTestCase { let expectedResult = UInt16((addr + 1) & 0xffff) - let bcResult = test(program: bcProgram, length: 7, initialValue: 0xffff) - let deResult = test(program: deProgram, length: 7, initialValue: 0xffff) + let bcResult = test(program: bcProgram, initialValue: 0xffff) + let deResult = test(program: deProgram, initialValue: 0xffff) XCTAssertEqual(bcResult, expectedResult) XCTAssertEqual(deResult, expectedResult) @@ -135,11 +234,11 @@ class Z80MemptrTests: XCTestCase { let expectedResult = UInt16((addr + 1) & 0xffff) - XCTAssertEqual(test(program: ldnnhlBaseProgram, length: 16, initialValue: expectedResult ^ 1), expectedResult) - XCTAssertEqual(test(program: ldnnbcEDProgram, length: 20, initialValue: expectedResult ^ 1), expectedResult) - XCTAssertEqual(test(program: ldnndeEDProgram, length: 20, initialValue: expectedResult ^ 1), expectedResult) - XCTAssertEqual(test(program: ldnnhlEDProgram, length: 20, initialValue: expectedResult ^ 1), expectedResult) - XCTAssertEqual(test(program: ldnnspEDProgram, length: 20, initialValue: expectedResult ^ 1), expectedResult) + XCTAssertEqual(test(program: ldnnhlBaseProgram, initialValue: expectedResult ^ 1), expectedResult) + XCTAssertEqual(test(program: ldnnbcEDProgram, initialValue: expectedResult ^ 1), expectedResult) + XCTAssertEqual(test(program: ldnndeEDProgram, initialValue: expectedResult ^ 1), expectedResult) + XCTAssertEqual(test(program: ldnnhlEDProgram, initialValue: expectedResult ^ 1), expectedResult) + XCTAssertEqual(test(program: ldnnspEDProgram, initialValue: expectedResult ^ 1), expectedResult) } } @@ -190,15 +289,15 @@ class Z80MemptrTests: XCTestCase { let expectedResult = UInt16((addr + 1) & 0xffff) - XCTAssertEqual(test(program: hlBaseProgram, length: 16, initialValue: 0xffff), expectedResult) + XCTAssertEqual(test(program: hlBaseProgram, initialValue: 0xffff), expectedResult) - XCTAssertEqual(test(program: bcEDProgram, length: 20, initialValue: 0xffff), expectedResult) - XCTAssertEqual(test(program: deEDProgram, length: 20, initialValue: 0xffff), expectedResult) - XCTAssertEqual(test(program: hlEDProgram, length: 20, initialValue: 0xffff), expectedResult) - XCTAssertEqual(test(program: spEDProgram, length: 20, initialValue: 0xffff), expectedResult) + XCTAssertEqual(test(program: bcEDProgram, initialValue: 0xffff), expectedResult) + XCTAssertEqual(test(program: deEDProgram, initialValue: 0xffff), expectedResult) + XCTAssertEqual(test(program: hlEDProgram, initialValue: 0xffff), expectedResult) + XCTAssertEqual(test(program: spEDProgram, initialValue: 0xffff), expectedResult) - XCTAssertEqual(test(program: ixProgram, length: 20, initialValue: 0xffff), expectedResult) - XCTAssertEqual(test(program: iyProgram, length: 20, initialValue: 0xffff), expectedResult) + XCTAssertEqual(test(program: ixProgram, initialValue: 0xffff), expectedResult) + XCTAssertEqual(test(program: iyProgram, initialValue: 0xffff), expectedResult) } } @@ -225,9 +324,9 @@ class Z80MemptrTests: XCTestCase { iyProgram[2] = UInt8(addr & 0x00ff) iyProgram[3] = UInt8(addr >> 8) - XCTAssertEqual(test(program: hlProgram, length: 19, initialValue: 0xffff), UInt16(addr)) - XCTAssertEqual(test(program: ixProgram, length: 23, initialValue: 0xffff), UInt16(addr)) - XCTAssertEqual(test(program: iyProgram, length: 23, initialValue: 0xffff), UInt16(addr)) + XCTAssertEqual(test(program: hlProgram, initialValue: 0xffff), UInt16(addr)) + XCTAssertEqual(test(program: ixProgram, initialValue: 0xffff), UInt16(addr)) + XCTAssertEqual(test(program: iyProgram, initialValue: 0xffff), UInt16(addr)) } } @@ -248,9 +347,9 @@ class Z80MemptrTests: XCTestCase { let expectedResult = UInt16((addr + 1) & 0xffff) machine.setValue(UInt16(addr), for: .HL) - XCTAssertEqual(test(program: addProgram, length: 11, initialValue: 0xffff), expectedResult) - XCTAssertEqual(test(program: adcProgram, length: 15, initialValue: 0xffff), expectedResult) - XCTAssertEqual(test(program: sbcProgram, length: 15, initialValue: 0xffff), expectedResult) + XCTAssertEqual(test(program: addProgram, initialValue: 0xffff), expectedResult) + XCTAssertEqual(test(program: adcProgram, initialValue: 0xffff), expectedResult) + XCTAssertEqual(test(program: sbcProgram, initialValue: 0xffff), expectedResult) } } @@ -268,20 +367,132 @@ class Z80MemptrTests: XCTestCase { let expectedResult = UInt16((addr + 1) & 0xffff) machine.setValue(UInt16(addr), for: .HL) - XCTAssertEqual(test(program: rldProgram, length: 18, initialValue: 0xffff), expectedResult) - XCTAssertEqual(test(program: rrdProgram, length: 18, initialValue: 0xffff), expectedResult) + XCTAssertEqual(test(program: rldProgram, initialValue: 0xffff), expectedResult) + XCTAssertEqual(test(program: rrdProgram, initialValue: 0xffff), expectedResult) } } /* TODO: JR/DJNZ/RET/RETI/RST (jumping to addr) MEMPTR = addr + + (implemented in principle) */ + func testJR() { + var jrProgram: [UInt8] = [ + 0x18, 0x00 + ] + + for offset in 0 ..< 256 { + jrProgram[1] = UInt8(offset) + let result = test(program: jrProgram, initialValue: 0xffff) + XCTAssertEqual(result, machine.value(for: .programCounter)) + } + } + + func testJRcc() { + func testJR(instruction: UInt8) { + var program: [UInt8] = [ + instruction, 0x00 + ] + + for offset in 0 ..< 256 { + program[1] = UInt8(offset) + let result = test(program: program, initialValue: 0xffff) + XCTAssertEqual(result, machine.value(for: .programCounter)) + } + } + + // JR NZ. + machine.setValue(0x00, for: .AF) + testJR(instruction: 0x20) + + machine.setValue(0xff, for: .AF) + testJR(instruction: 0x20) + + // JR NC + machine.setValue(0x00, for: .AF) + testJR(instruction: 0x30) + + machine.setValue(0xff, for: .AF) + testJR(instruction: 0x30) + + // JR Z + machine.setValue(0x00, for: .AF) + testJR(instruction: 0x28) + + machine.setValue(0x01, for: .AF) + testJR(instruction: 0x28) + + // JR C + machine.setValue(0x00, for: .AF) + testJR(instruction: 0x38) + + machine.setValue(0x01, for: .AF) + testJR(instruction: 0x38) + } + + func testRST() { + var rstProgram: [UInt8] = [ + 0x00 + ] + + for offset in 0 ..< 8 { + rstProgram[0] = UInt8(offset << 3) + 0xc7 + let result = test(program: rstProgram, initialValue: 0xffff) + XCTAssertEqual(result, machine.value(for: .programCounter)) + } + } + + func testRET() { + let retProgram: [UInt8] = [ + 0xc9 + ] + + for addr in 0 ..< 65536 { + let stackContents: [UInt8] = [ + UInt8(addr & 0xff), UInt8(addr >> 8) + ] + + machine.setData(Data(stackContents), atAddress: 0xf001) + machine.setValue(0xf000, for: .stackPointer) + let result = test(program: retProgram, initialValue: 0xffff) + XCTAssertEqual(result, machine.value(for: .programCounter)) + } + } + func testRETI() { + let retiProgram: [UInt8] = [ + 0xed, 0x4d + ] + + for addr in 0 ..< 65536 { + let stackContents: [UInt8] = [ + UInt8(addr & 0xff), UInt8(addr >> 8) + ] + + machine.setData(Data(stackContents), atAddress: 0xf001) + machine.setValue(0xf000, for: .stackPointer) + let result = test(program: retiProgram, initialValue: 0xffff) + XCTAssertEqual(result, machine.value(for: .programCounter)) + } + } /* TODO: JP(except JP rp)/CALL addr (even in case of conditional call/jp, independently on condition satisfied or not) MEMPTR = addr */ + func testCALL() { + var callProgram: [UInt8] = [ + 0xcd, 0x00, 0x00 + ] + + for offset in 0 ..< 65536 { + callProgram[1] = UInt8(offset & 0xff) + callProgram[2] = UInt8(offset >> 8) + let result = test(program: callProgram, initialValue: 0xffff) + XCTAssertEqual(result, machine.value(for: .programCounter)) + } + } /* TODO: IN A,(port) diff --git a/Processors/Z80/Implementation/Z80Implementation.hpp b/Processors/Z80/Implementation/Z80Implementation.hpp index 12d52e834..1e40f2ed4 100644 --- a/Processors/Z80/Implementation/Z80Implementation.hpp +++ b/Processors/Z80/Implementation/Z80Implementation.hpp @@ -101,9 +101,10 @@ template < class T, scheduled_program_counter_ = current_instruction_page_->instructions[operation_ & halt_mask_]; break; - case MicroOp::Increment16: (*static_cast(operation->source))++; break; + case MicroOp::Increment8NoFlags: ++ *static_cast(operation->source); break; + case MicroOp::Increment16: ++ *static_cast(operation->source); break; case MicroOp::IncrementPC: pc_.full += pc_increment_; break; - case MicroOp::Decrement16: (*static_cast(operation->source))--; break; + case MicroOp::Decrement16: -- *static_cast(operation->source); break; case MicroOp::Move8: *static_cast(operation->destination) = *static_cast(operation->source); break; case MicroOp::Move16: *static_cast(operation->destination) = *static_cast(operation->source); break; @@ -180,6 +181,7 @@ template < class T, case MicroOp::DJNZ: bc_.halves.high--; if(!bc_.halves.high) { + memptr_.full = pc_.full; advance_operation(); } break; @@ -480,7 +482,8 @@ template < class T, if(test) { \ pc_.full -= 2; \ } else { \ - advance_operation(); \ + memptr_.full = pc_.full - 1; \ + advance_operation(); \ } #define LDxR_STEP(dir) \ @@ -514,9 +517,10 @@ template < class T, #undef LDxR_STEP -#define CPxR_STEP(dir) \ - hl_.full += dir; \ - bc_.full--; \ +#define CPxR_STEP(dir) \ + hl_.full += dir; \ + memptr_.full += dir; \ + bc_.full--; \ \ uint8_t result = a_ - temp8_; \ const uint8_t halfResult = (a_&0xf) - (temp8_&0xf); \ @@ -541,12 +545,10 @@ template < class T, } break; case MicroOp::CPD: { - memptr_.full--; CPxR_STEP(-1); } break; case MicroOp::CPI: { - memptr_.full++; CPxR_STEP(1); } break; @@ -636,6 +638,7 @@ template < class T, case MicroOp::BIT: { const uint8_t result = *static_cast(operation->source) & (1 << ((operation_ >> 3)&7)); + // Leak MEMPTR into bits 5 and 3 if this is either BIT n,(HL) or BIT n,(IX/IY+d). if(current_instruction_page_->is_indexed || ((operation_&0x07) == 6)) { bit53_result_ = memptr_.halves.high; } else { @@ -797,13 +800,15 @@ template < class T, } break; -// MARK: - Input +// MARK: - Input and Output case MicroOp::SetInFlags: subtract_flag_ = half_carry_result_ = 0; sign_result_ = zero_result_ = bit53_result_ = *static_cast(operation->source); set_parity(sign_result_); - set_did_compute_flags(); + set_did_compute_flags(); // deliberate fallthrough + case MicroOp::SetOutFlags: + memptr_.full = bc_.full + 1; break; diff --git a/Processors/Z80/Implementation/Z80Storage.hpp b/Processors/Z80/Implementation/Z80Storage.hpp index bc1a89cd7..1008a2819 100644 --- a/Processors/Z80/Implementation/Z80Storage.hpp +++ b/Processors/Z80/Implementation/Z80Storage.hpp @@ -20,6 +20,7 @@ class ProcessorStorage { DecodeOperationNoRChange, MoveToNextProgram, + Increment8NoFlags, Increment8, Increment16, Decrement8, @@ -73,31 +74,45 @@ class ProcessorStorage { JumpTo66, HALT, + /// Decrements BC; if BC is 0 then moves to the next instruction. Otherwise allows this instruction to finish. DJNZ, + DAA, CPL, SCF, CCF, + /// Resets the bit in @c source implied by @c operation_ . RES, + /// Tests the bit in @c source implied by @c operation_ . BIT, + /// Sets the bit in @c source implied by @c operation_ . SET, + /// Sets @c memptr_ to the target address implied by @c operation_ . CalculateRSTDestination, + /// Resets subtract and carry, sets sign, zero, five and three according to the value of @c a_ and sets parity to the value of @c IFF2 . SetAFlags, + /// Resets subtract and carry, sets sign, zero, five and three according to the value of @c operation and sets parity the same as sign. SetInFlags, + /// Sets @c memptr_ to @c bc_.full+1 . + SetOutFlags, + /// Sets @c temp8_ to 0. SetZero, + /// A no-op; used in instruction lists to indicate where an index calculation should go if this is an I[X/Y]+d operation. IndexedPlaceHolder, + /// Sets @c memptr_ to (a_ << 8) + ((source_ + 1) & 0xff) SetAddrAMemptr, + /// Resets: IFF1, IFF2, interrupt mode, the PC, I and R; sets all flags, the SP to 0xffff and a_ to 0xff. Reset }; Type type; - void *source; - void *destination; + void *source = nullptr; + void *destination = nullptr; PartialMachineCycle machine_cycle; }; @@ -105,7 +120,7 @@ class ProcessorStorage { std::vector instructions; std::vector all_operations; std::vector fetch_decode_execute; - MicroOp *fetch_decode_execute_data; + MicroOp *fetch_decode_execute_data = nullptr; uint8_t r_step; bool is_indexed; From e4887c0c568fb1af61a7150f03d9e2db41215251 Mon Sep 17 00:00:00 2001 From: Thomas Harte Date: Mon, 24 Feb 2020 23:36:05 -0500 Subject: [PATCH 12/28] Corrects JR cc tests. --- OSBindings/Mac/Clock SignalTests/Z80MemptrTests.swift | 4 ++-- 1 file changed, 2 insertions(+), 2 deletions(-) diff --git a/OSBindings/Mac/Clock SignalTests/Z80MemptrTests.swift b/OSBindings/Mac/Clock SignalTests/Z80MemptrTests.swift index 5e0d37ad2..b8941d922 100644 --- a/OSBindings/Mac/Clock SignalTests/Z80MemptrTests.swift +++ b/OSBindings/Mac/Clock SignalTests/Z80MemptrTests.swift @@ -421,14 +421,14 @@ class Z80MemptrTester: XCTestCase { machine.setValue(0x00, for: .AF) testJR(instruction: 0x28) - machine.setValue(0x01, for: .AF) + machine.setValue(0xff, for: .AF) testJR(instruction: 0x28) // JR C machine.setValue(0x00, for: .AF) testJR(instruction: 0x38) - machine.setValue(0x01, for: .AF) + machine.setValue(0xff, for: .AF) testJR(instruction: 0x38) } From 604bb50adf6cffe73a2ab573b8d4266bc2e01b4b Mon Sep 17 00:00:00 2001 From: Thomas Harte Date: Tue, 25 Feb 2020 23:15:27 -0500 Subject: [PATCH 13/28] Imports and converts updated FUSE tests. Now with added MEMPTR. --- .../FUSE/converters/expectedconverter.cpp | 143 + .../FUSE/converters/inconverter.cpp | 102 + .../Mac/Clock SignalTests/FUSE/readme.txt | 4 +- .../Mac/Clock SignalTests/FUSE/tests.expected | 3190 ++++---- .../FUSE/tests.expected.json | 4717 +++++++++--- .../Mac/Clock SignalTests/FUSE/tests.in | 2816 +++---- .../Mac/Clock SignalTests/FUSE/tests.in.json | 6636 +++++++++++------ 7 files changed, 11401 insertions(+), 6207 deletions(-) create mode 100644 OSBindings/Mac/Clock SignalTests/FUSE/converters/expectedconverter.cpp create mode 100644 OSBindings/Mac/Clock SignalTests/FUSE/converters/inconverter.cpp diff --git a/OSBindings/Mac/Clock SignalTests/FUSE/converters/expectedconverter.cpp b/OSBindings/Mac/Clock SignalTests/FUSE/converters/expectedconverter.cpp new file mode 100644 index 000000000..198a48c22 --- /dev/null +++ b/OSBindings/Mac/Clock SignalTests/FUSE/converters/expectedconverter.cpp @@ -0,0 +1,143 @@ +#include +#include + +/* + Converter for FUSE-style tests.expected that writes JSON out. Hacky, barely tested, + not reliable, but seemed to work long enough to produce a JSON object, for which + robust parsers are widely available. + + Intended usage: expectedconverter < tests.in > tests.in.json +*/ + +int main(void) { + std::cout << '['; + + bool isFirstObject = true; + while(true) { + // Name is always present. + std::string name; + std::cin >> name; + + // Exit if a whole test wasn't found. + // SUPER HACK HERE. I can't be bothered working out why + if(std::cin.eof() || name == "5505") break; + + // Close previous object, if there was one and output the name. + if(!isFirstObject) std::cout << "}," << std::endl; + isFirstObject = false; + std::cout << "{" << std::endl; + std::cout << "\t\"name\" : \"" << name << "\"," << std::endl; + + // There are now arbitrarily many events, and at least one. + // + // I suspect you're supposed to distinguish the end of events by indentation, + // but I'm going to do it by string length. Hack attack! + std::cout << "\t\"busActivity\" : [" << std::endl; + std::string time; + bool isFirstEvent = true; + while(true) { + std::cin >> time; + if(time.size() == 4) break; + + std::string type, address, data; + std::cin >> type >> address; + + if(!isFirstEvent) std::cout << "," << std::endl; + isFirstEvent = false; + + std::cout << "\t\t{ \"time\" : " << time << ", "; // Arbitrarily, FUSE switches to base 10 for these numbers. + std::cout << "\"type\" : \"" << type << "\", "; + std::cout << "\"address\" : " << strtol(address.c_str(), nullptr, 16); + + // Memory type can be used to determine whether there's a value at the end. + if(type == "MR" || type == "MW" || type == "PR" || type == "PW") { + std::string value; + std::cin >> value; + std::cout << ", \"value\" : " << strtol(value.c_str(), nullptr, 16); + } + std::cout << " }"; + } + std::cout << std::endl << "\t]," << std::endl; + + // Okay, now for the closing machine state. + std::string af, bc, de, hl, afDash, bcDash, deDash, hlDash, ix, iy, sp, pc, memptr; + std::string i, r, iff1, iff2, im, halted, tStates; + + af = time; + std::cin >> bc >> de >> hl >> afDash >> bcDash >> deDash >> hlDash >> ix >> iy >> sp >> pc >> memptr; + std::cin >> i >> r >> iff1 >> iff2 >> im >> halted >> tStates; + + // Output the state + std::cout << "\t\"state\" : {" << std::endl; + +#define OUTPUTnbr(name) std::cout << "\t\t\"" << #name << "\" : " << strtol(name.c_str(), nullptr, 16) +#define OUTPUT(name) OUTPUTnbr(name) << "," << std::endl +#define OUTPUTb(name) std::cout << "\t\t\"" << #name << "\" : " << ((name == "0") ? "false" : "true") << "," << std::endl + + OUTPUT(af); + OUTPUT(bc); + OUTPUT(de); + OUTPUT(hl); + OUTPUT(afDash); + OUTPUT(bcDash); + OUTPUT(deDash); + OUTPUT(hlDash); + OUTPUT(ix); + OUTPUT(iy); + OUTPUT(sp); + OUTPUT(pc); + OUTPUT(memptr); + OUTPUT(i); + OUTPUT(r); + OUTPUTb(iff1); + OUTPUTb(iff2); + OUTPUT(im); + OUTPUTb(halted); + OUTPUTnbr(tStates) << std::endl; + +#undef OUTPUTb +#undef OUTPUT +#undef OUTPUTnbr + std::cout << "\t}"; + + + // A memory list may or may not follow. If it does it'll be terminated + // in the usual way. If not, it just won't be there. Hassle! + char nextChar; + std::cin.rdbuf()->sbumpc(); + nextChar = std::cin.rdbuf()->sgetc(); + if(nextChar == '\n') { + std::cout << std::endl; + continue; + } + + // Parse and transcode the memory list. + // There's only ever one memory block. + std::cout << "," << std::endl; + std::cout << "\t\"memory\" : [" << std::endl; + + std::string address; + std::cin >> address; + + std::cout << "\t\t{ \"address\" : " << strtol(address.c_str(), nullptr, 16) << ", \"data\" : ["; + bool isFirstValue = true; + while(true) { + std::string value; + std::cin >> value; + if(value == "-1") break; + + if(!isFirstValue) std::cout << ", "; + isFirstValue = false; + + std::cout << strtol(value.c_str(), nullptr, 16); + } + std::cout << "] }"; + + // Close the object. + std::cout << std::endl << "\t]" << std::endl; + } + + std::cout << "}]" << std::endl; + + return 0; +} diff --git a/OSBindings/Mac/Clock SignalTests/FUSE/converters/inconverter.cpp b/OSBindings/Mac/Clock SignalTests/FUSE/converters/inconverter.cpp new file mode 100644 index 000000000..cd9afa370 --- /dev/null +++ b/OSBindings/Mac/Clock SignalTests/FUSE/converters/inconverter.cpp @@ -0,0 +1,102 @@ +#include +#include + +/* + Converter for FUSE-style tests.in that writes JSON out. Hacky, barely tested, not reliable, + but seemed to work long enough to produce a JSON object, for which robust parsers are + widely available. + + Intended usage: inconverter < tests.in > tests.in.json +*/ + +int main(void) { + std::cout << '['; + + bool isFirstObject = true; + while(true) { + std::string name; + std::string af, bc, de, hl, afDash, bcDash, deDash, hlDash, ix, iy, sp, pc, memptr; + std::string i, r, iff1, iff2, im, halted, tStates; + + // Read the fixed part of this test. + std::cin >> name; + std::cin >> af >> bc >> de >> hl >> afDash >> bcDash >> deDash >> hlDash >> ix >> iy >> sp >> pc >> memptr; + std::cin >> i >> r >> iff1 >> iff2 >> im >> halted >> tStates; + + // Exit if a whole test wasn't found. + if(std::cin.eof()) break; + + if(!isFirstObject) std::cout << "}," << std::endl; + isFirstObject = false; + + // Output that much. + std::cout << "{" << std::endl; + std::cout << "\t\"name\" : \"" << name << "\"," << std::endl; + std::cout << "\t\"state\" : {" << std::endl; + +#define OUTPUTnbr(name) std::cout << "\t\t\"" << #name << "\" : " << strtol(name.c_str(), nullptr, 16) +#define OUTPUT(name) OUTPUTnbr(name) << "," << std::endl +#define OUTPUTb(name) std::cout << "\t\t\"" << #name << "\" : " << ((name == "0") ? "false" : "true") << "," << std::endl + + OUTPUT(af); + OUTPUT(bc); + OUTPUT(de); + OUTPUT(hl); + OUTPUT(afDash); + OUTPUT(bcDash); + OUTPUT(deDash); + OUTPUT(hlDash); + OUTPUT(ix); + OUTPUT(iy); + OUTPUT(sp); + OUTPUT(pc); + OUTPUT(memptr); + OUTPUT(i); + OUTPUT(r); + OUTPUTb(iff1); + OUTPUTb(iff2); + OUTPUT(im); + OUTPUTb(halted); + OUTPUTnbr(tStates) << std::endl; + +#undef OUTPUTb +#undef OUTPUT +#undef OUTPUTnbr + + std::cout << "\t}," << std::endl; + + // Parse and transcode the memory list. + std::cout << "\t\"memory\" : [" << std::endl; + + bool isFirstBlock = true; + while(true) { + std::string address; + std::cin >> address; + if(address == "-1") break; + + if(!isFirstBlock) std::cout << "," << std::endl; + isFirstBlock = false; + + std::cout << "\t\t{ \"address\" : " << strtol(address.c_str(), nullptr, 16) << ", \"data\" : ["; + bool isFirstValue = true; + while(true) { + std::string value; + std::cin >> value; + if(value == "-1") break; + + if(!isFirstValue) std::cout << ", "; + isFirstValue = false; + + std::cout << strtol(value.c_str(), nullptr, 16); + } + std::cout << "] }"; + } + + // Close the object. + std::cout << std::endl << "\t]" << std::endl; + } + + std::cout << "}]" << std::endl; + + return 0; +} \ No newline at end of file diff --git a/OSBindings/Mac/Clock SignalTests/FUSE/readme.txt b/OSBindings/Mac/Clock SignalTests/FUSE/readme.txt index 891b29628..d68952f17 100644 --- a/OSBindings/Mac/Clock SignalTests/FUSE/readme.txt +++ b/OSBindings/Mac/Clock SignalTests/FUSE/readme.txt @@ -1,5 +1,5 @@ tests.expected and tests.in are sourced from FUSE, the For UNIX Spectrum Emulator. FUSE is GPL software, and can be found at: -https://github.com/tom-seddon/fuse-emulator-code/ +https://sourceforge.net/projects/fuse-emulator/ -tests.exepected.json and tests.in.json are direct derivatives of those files and therefore are also offered under the GPL. \ No newline at end of file +tests.exepected.json and tests.in.json are direct derivatives of those files and therefore are also offered under the GPL. See the converters directory for the hacky means I used to generate those from the originals. \ No newline at end of file diff --git a/OSBindings/Mac/Clock SignalTests/FUSE/tests.expected b/OSBindings/Mac/Clock SignalTests/FUSE/tests.expected index 20451da4d..65b96578d 100644 --- a/OSBindings/Mac/Clock SignalTests/FUSE/tests.expected +++ b/OSBindings/Mac/Clock SignalTests/FUSE/tests.expected @@ -1,7 +1,7 @@ 00 0 MC 0000 4 MR 0000 00 -0000 0000 0000 0000 0000 0000 0000 0000 0000 0000 0000 0001 +0000 0000 0000 0000 0000 0000 0000 0000 0000 0000 0000 0001 0000 00 01 0 0 0 0 4 01 @@ -11,7 +11,7 @@ 7 MR 0001 12 7 MC 0002 10 MR 0002 34 -0000 3412 0000 0000 0000 0000 0000 0000 0000 0000 0000 0003 +0000 3412 0000 0000 0000 0000 0000 0000 0000 0000 0000 0003 0000 00 01 0 0 0 0 10 02 @@ -19,28 +19,37 @@ 4 MR 0000 02 4 MC 0001 7 MW 0001 56 -5600 0001 0000 0000 0000 0000 0000 0000 0000 0000 0000 0001 +5600 0001 0000 0000 0000 0000 0000 0000 0000 0000 0000 0001 5602 00 01 0 0 0 0 7 0001 56 -1 +02_1 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-8902,7 +9476,7 @@ { "time" : 11, "type" : "MC", "address" : 44451 } ], "state" : { - "af" : 9752, + "af" : 9744, "bc" : 37383, "de" : 17818, "hl" : 44451, @@ -8914,13 +9488,14 @@ "iy" : 0, "sp" : 0, "pc" : 2, + "memptr" : 0, "i" : 0, "r" : 2, "iff1" : false, "iff2" : false, "im" : 0, "halted" : false, - "tStates" : 12 + "tStates" : 18 } }, { @@ -8944,6 +9519,7 @@ "iy" : 0, "sp" : 0, "pc" : 2, + "memptr" : 0, "i" : 0, "r" : 2, "iff1" : false, @@ -8974,6 +9550,7 @@ "iy" : 0, "sp" : 0, "pc" : 2, + "memptr" : 0, "i" : 0, "r" : 2, "iff1" : false, @@ -9004,6 +9581,7 @@ "iy" : 0, "sp" : 0, "pc" : 2, + "memptr" : 0, "i" : 0, "r" : 2, "iff1" : false, @@ -9034,6 +9612,7 @@ "iy" : 0, "sp" : 0, "pc" : 2, + "memptr" : 0, "i" : 0, "r" : 2, "iff1" : false, @@ -9064,6 +9643,7 @@ "iy" : 0, "sp" : 0, "pc" : 2, + "memptr" : 0, "i" : 0, "r" : 2, "iff1" : false, @@ -9094,6 +9674,7 @@ "iy" : 0, "sp" : 0, "pc" : 2, + "memptr" : 0, "i" : 0, "r" : 2, "iff1" : false, @@ -9124,6 +9705,7 @@ "iy" : 0, "sp" : 0, "pc" : 2, + "memptr" : 0, "i" : 0, "r" : 2, "iff1" : false, @@ -9154,6 +9736,7 @@ "iy" : 0, "sp" : 0, "pc" : 2, + "memptr" : 0, "i" : 0, "r" : 2, "iff1" : false, @@ -9187,13 +9770,14 @@ "iy" : 0, "sp" : 0, "pc" : 2, + "memptr" : 0, "i" : 0, "r" : 2, "iff1" : false, "iff2" : false, "im" : 0, "halted" : false, - "tStates" : 12 + "tStates" : 18 } }, { @@ -9217,6 +9801,7 @@ "iy" : 0, "sp" : 0, "pc" : 2, + "memptr" : 0, "i" : 0, "r" : 2, "iff1" : false, @@ -9247,6 +9832,7 @@ "iy" : 0, "sp" : 0, "pc" : 2, + "memptr" : 0, "i" : 0, "r" : 2, "iff1" : false, @@ -9277,6 +9863,7 @@ "iy" : 0, "sp" : 0, "pc" : 2, + "memptr" : 0, "i" : 0, "r" : 2, "iff1" : false, @@ -9307,6 +9894,7 @@ "iy" : 0, "sp" : 0, "pc" : 2, + "memptr" : 0, "i" : 0, "r" : 2, "iff1" : false, @@ -9337,6 +9925,7 @@ "iy" : 0, "sp" : 0, "pc" : 2, + "memptr" : 0, "i" : 0, "r" : 2, "iff1" : false, @@ -9367,6 +9956,7 @@ "iy" : 0, "sp" : 0, "pc" : 2, + "memptr" : 0, "i" : 0, "r" : 2, "iff1" : false, @@ -9397,6 +9987,7 @@ "iy" : 0, "sp" : 0, "pc" : 2, + "memptr" : 0, "i" : 0, "r" : 2, "iff1" : false, @@ -9427,6 +10018,7 @@ "iy" : 0, "sp" : 0, "pc" : 2, + "memptr" : 0, "i" : 0, "r" : 2, "iff1" : false, @@ -9448,7 +10040,7 @@ { "time" : 11, "type" : "MC", "address" : 13466 } ], "state" : { - "af" : 12344, + "af" : 12304, "bc" : 44355, "de" : 5825, "hl" : 13466, @@ -9460,13 +10052,14 @@ "iy" : 0, "sp" : 0, "pc" : 2, + "memptr" : 0, "i" : 0, "r" : 2, "iff1" : false, "iff2" : false, "im" : 0, "halted" : false, - "tStates" : 12 + "tStates" : 18 } }, { @@ -9490,6 +10083,7 @@ "iy" : 0, "sp" : 0, "pc" : 2, + "memptr" : 0, "i" : 0, "r" : 2, "iff1" : false, @@ -9520,6 +10114,7 @@ "iy" : 0, "sp" : 0, "pc" : 2, + "memptr" : 0, "i" : 0, "r" : 2, "iff1" : false, @@ -9550,6 +10145,7 @@ "iy" : 0, "sp" : 0, "pc" : 2, + "memptr" : 0, "i" : 0, "r" : 2, "iff1" : false, @@ -9580,6 +10176,7 @@ "iy" : 0, "sp" : 0, "pc" : 2, + "memptr" : 0, "i" : 0, "r" : 2, "iff1" : false, @@ -9610,6 +10207,7 @@ "iy" : 0, "sp" : 0, "pc" : 2, + "memptr" : 0, "i" : 0, "r" : 2, "iff1" : false, @@ -9640,6 +10238,7 @@ "iy" : 0, "sp" : 0, "pc" : 2, + "memptr" : 0, "i" : 0, "r" : 2, "iff1" : false, @@ -9670,6 +10269,7 @@ "iy" : 0, "sp" : 0, "pc" : 2, + "memptr" : 0, "i" : 0, "r" : 2, "iff1" : false, @@ -9700,6 +10300,7 @@ "iy" : 0, "sp" : 0, "pc" : 2, + "memptr" : 0, "i" : 0, "r" : 2, "iff1" : false, @@ -9733,13 +10334,14 @@ "iy" : 0, "sp" : 0, "pc" : 2, + "memptr" : 0, "i" : 0, "r" : 2, "iff1" : false, "iff2" : false, "im" : 0, "halted" : false, - "tStates" : 12 + "tStates" : 18 } }, { @@ -9763,6 +10365,7 @@ "iy" : 0, "sp" : 0, "pc" : 2, + "memptr" : 0, "i" : 0, "r" : 2, "iff1" : false, @@ -9793,6 +10396,7 @@ "iy" : 0, "sp" : 0, "pc" : 2, + "memptr" : 0, "i" : 0, "r" : 2, "iff1" : false, @@ -9823,6 +10427,7 @@ "iy" : 0, "sp" : 0, "pc" : 2, + "memptr" : 0, "i" : 0, "r" : 2, "iff1" : false, @@ -9853,6 +10458,7 @@ "iy" : 0, "sp" : 0, "pc" : 2, + "memptr" : 0, "i" : 0, "r" : 2, "iff1" : false, @@ -9883,6 +10489,7 @@ "iy" : 0, "sp" : 0, "pc" : 2, + "memptr" : 0, "i" : 0, "r" : 2, "iff1" : false, @@ -9913,6 +10520,7 @@ "iy" : 0, "sp" : 0, "pc" : 2, + "memptr" : 0, "i" : 0, "r" : 2, "iff1" : false, @@ -9943,6 +10551,7 @@ "iy" : 0, "sp" : 0, "pc" : 2, + "memptr" : 0, "i" : 0, "r" : 2, "iff1" : false, @@ -9973,6 +10582,7 @@ "iy" : 0, "sp" : 0, "pc" : 2, + "memptr" : 0, "i" : 0, "r" : 2, "iff1" : false, @@ -9994,7 +10604,7 @@ { "time" : 11, "type" : "MC", "address" : 55482 } ], "state" : { - "af" : 18992, + "af" : 18960, "bc" : 2249, "de" : 33143, "hl" : 55482, @@ -10006,13 +10616,14 @@ "iy" : 0, "sp" : 0, "pc" : 2, + "memptr" : 0, "i" : 0, "r" : 2, "iff1" : false, "iff2" : false, "im" : 0, "halted" : false, - "tStates" : 12 + "tStates" : 18 } }, { @@ -10036,6 +10647,7 @@ "iy" : 0, "sp" : 0, "pc" : 2, + "memptr" : 0, "i" : 0, "r" : 2, "iff1" : false, @@ -10066,6 +10678,7 @@ "iy" : 0, "sp" : 0, "pc" : 2, + "memptr" : 0, "i" : 0, "r" : 2, "iff1" : false, @@ -10096,6 +10709,7 @@ "iy" : 0, "sp" : 0, "pc" : 2, + "memptr" : 0, "i" : 0, "r" : 2, "iff1" : false, @@ -10126,6 +10740,7 @@ "iy" : 0, "sp" : 0, "pc" : 2, + "memptr" : 0, "i" : 0, "r" : 2, "iff1" : false, @@ -10156,6 +10771,7 @@ "iy" : 0, "sp" : 0, "pc" : 2, + "memptr" : 0, "i" : 0, "r" : 2, "iff1" : false, @@ -10186,6 +10802,7 @@ "iy" : 0, "sp" : 0, "pc" : 2, + "memptr" : 0, "i" : 0, "r" : 2, "iff1" : false, @@ -10216,6 +10833,7 @@ "iy" : 0, "sp" : 0, "pc" : 2, + "memptr" : 0, "i" : 0, "r" : 2, "iff1" : false, @@ -10246,6 +10864,7 @@ "iy" : 0, "sp" : 0, "pc" : 2, + "memptr" : 0, "i" : 0, "r" : 2, "iff1" : false, @@ -10267,7 +10886,7 @@ { "time" : 11, "type" : "MC", "address" : 48241 } ], "state" : { - "af" : 63580, + "af" : 63572, "bc" : 12375, "de" : 13865, "hl" : 48241, @@ -10279,13 +10898,14 @@ "iy" : 0, "sp" : 0, "pc" : 2, + "memptr" : 0, "i" : 0, "r" : 2, "iff1" : false, "iff2" : false, "im" : 0, "halted" : false, - "tStates" : 12 + "tStates" : 18 } }, { @@ -10309,6 +10929,7 @@ "iy" : 0, "sp" : 0, "pc" : 2, + "memptr" : 0, "i" : 0, "r" : 2, "iff1" : false, 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Of course it is. --- .../FUSE/converters/expectedconverter.cpp | 3 +- .../FUSE/converters/inconverter.cpp | 5 +- .../FUSE/tests.expected.json | 1622 ++++++++--------- 3 files changed, 816 insertions(+), 814 deletions(-) diff --git a/OSBindings/Mac/Clock SignalTests/FUSE/converters/expectedconverter.cpp b/OSBindings/Mac/Clock SignalTests/FUSE/converters/expectedconverter.cpp index 198a48c22..1609d2daa 100644 --- a/OSBindings/Mac/Clock SignalTests/FUSE/converters/expectedconverter.cpp +++ b/OSBindings/Mac/Clock SignalTests/FUSE/converters/expectedconverter.cpp @@ -71,6 +71,7 @@ int main(void) { std::cout << "\t\"state\" : {" << std::endl; #define OUTPUTnbr(name) std::cout << "\t\t\"" << #name << "\" : " << strtol(name.c_str(), nullptr, 16) +#define OUTPUT10(name) std::cout << "\t\t\"" << #name << "\" : " << name #define OUTPUT(name) OUTPUTnbr(name) << "," << std::endl #define OUTPUTb(name) std::cout << "\t\t\"" << #name << "\" : " << ((name == "0") ? "false" : "true") << "," << std::endl @@ -93,7 +94,7 @@ int main(void) { OUTPUTb(iff2); OUTPUT(im); OUTPUTb(halted); - OUTPUTnbr(tStates) << std::endl; + OUTPUT10(tStates) << std::endl; #undef OUTPUTb #undef OUTPUT diff --git a/OSBindings/Mac/Clock SignalTests/FUSE/converters/inconverter.cpp b/OSBindings/Mac/Clock SignalTests/FUSE/converters/inconverter.cpp index cd9afa370..7f1c603a6 100644 --- a/OSBindings/Mac/Clock SignalTests/FUSE/converters/inconverter.cpp +++ b/OSBindings/Mac/Clock SignalTests/FUSE/converters/inconverter.cpp @@ -35,6 +35,7 @@ int main(void) { std::cout << "\t\"state\" : {" << std::endl; #define OUTPUTnbr(name) std::cout << "\t\t\"" << #name << "\" : " << strtol(name.c_str(), nullptr, 16) +#define OUTPUT10(name) std::cout << "\t\t\"" << #name << "\" : " << name #define OUTPUT(name) OUTPUTnbr(name) << "," << std::endl #define OUTPUTb(name) std::cout << "\t\t\"" << #name << "\" : " << ((name == "0") ? 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NSNumber).intValue isHalted = (dictionary["halted"] as! NSNumber).boolValue + memptr = UInt16(truncating: dictionary["memptr"] as! NSNumber) tStates = (dictionary["tStates"] as! NSNumber).intValue } @@ -115,6 +118,7 @@ fileprivate struct RegisterState { isHalted = machine.isHalted tStates = 0 // TODO (?) + memptr = machine.value(for: .memPtr) } } @@ -138,7 +142,8 @@ fileprivate func ==(lhs: RegisterState, rhs: RegisterState) -> Bool { lhs.iff1 == rhs.iff1 && lhs.iff2 == rhs.iff2 && lhs.interruptMode == rhs.interruptMode && - lhs.isHalted == rhs.isHalted + lhs.isHalted == rhs.isHalted && + lhs.memptr == rhs.memptr } class FUSETests: XCTestCase { @@ -167,7 +172,7 @@ class FUSETests: XCTestCase { let name = itemDictionary["name"] as! String -// if name != "02" { +// if name != "01" { // continue; // } // print("\(name)") From 88783963392734c7dec820f109bb3725aa7a7b97 Mon Sep 17 00:00:00 2001 From: Thomas Harte Date: Wed, 26 Feb 2020 21:42:31 -0500 Subject: [PATCH 16/28] Corrects DJNZ memptr behaviour. --- OSBindings/Mac/Clock SignalTests/FUSETests.swift | 2 +- Processors/Z80/Implementation/Z80Implementation.hpp | 3 +-- Processors/Z80/Implementation/Z80Storage.cpp | 2 +- 3 files changed, 3 insertions(+), 4 deletions(-) diff --git a/OSBindings/Mac/Clock SignalTests/FUSETests.swift b/OSBindings/Mac/Clock SignalTests/FUSETests.swift index 14c331634..3cf824546 100644 --- a/OSBindings/Mac/Clock SignalTests/FUSETests.swift +++ b/OSBindings/Mac/Clock SignalTests/FUSETests.swift @@ -172,7 +172,7 @@ class FUSETests: XCTestCase { let name = itemDictionary["name"] as! String -// if name != "01" { +// if name != "10" { // continue; // } // print("\(name)") diff --git a/Processors/Z80/Implementation/Z80Implementation.hpp b/Processors/Z80/Implementation/Z80Implementation.hpp index 1e40f2ed4..517cc57ea 100644 --- a/Processors/Z80/Implementation/Z80Implementation.hpp +++ b/Processors/Z80/Implementation/Z80Implementation.hpp @@ -181,7 +181,6 @@ template < class T, case MicroOp::DJNZ: bc_.halves.high--; if(!bc_.halves.high) { - memptr_.full = pc_.full; advance_operation(); } break; @@ -873,7 +872,7 @@ template < class T, break; case MicroOp::CalculateIndexAddress: - memptr_.full = static_cast(*static_cast(operation->source) + (int8_t)temp8_); + memptr_.full = static_cast(*static_cast(operation->source) + int8_t(temp8_)); break; case MicroOp::SetAddrAMemptr: diff --git a/Processors/Z80/Implementation/Z80Storage.cpp b/Processors/Z80/Implementation/Z80Storage.cpp index 0dc59eec4..3878b3be2 100644 --- a/Processors/Z80/Implementation/Z80Storage.cpp +++ b/Processors/Z80/Implementation/Z80Storage.cpp @@ -371,7 +371,7 @@ void ProcessorStorage::assemble_base_page(InstructionPage &target, RegisterPair1 DEC_INC_DEC_LD(bc_, bc_.halves.low), /* 0x0f RRCA */ StdInstr({MicroOp::RRCA}), - /* 0x10 DJNZ */ Instr(6, ReadInc(pc_, temp8_), {MicroOp::Move16, &pc_.full, &memptr_.full}, {MicroOp::DJNZ}, InternalOperation(10), {MicroOp::CalculateIndexAddress, &pc_.full}, {MicroOp::Move16, &memptr_.full, &pc_.full}), + /* 0x10 DJNZ */ Instr(6, ReadInc(pc_, temp8_), {MicroOp::DJNZ}, InternalOperation(10), {MicroOp::CalculateIndexAddress, &pc_.full}, {MicroOp::Move16, &memptr_.full, &pc_.full}), /* 0x11 LD DE, nn */ StdInstr(Read16Inc(pc_, de_)), /* 0x12 LD (DE), A */ StdInstr({MicroOp::SetAddrAMemptr, &de_.full}, Write3(de_, a_)), From b64de89d2da0d62615760c02b857cbaa83840079 Mon Sep 17 00:00:00 2001 From: Thomas Harte Date: Wed, 26 Feb 2020 21:47:34 -0500 Subject: [PATCH 17/28] Corrects JR memptrs. --- Processors/Z80/Implementation/Z80Storage.cpp | 2 +- 1 file changed, 1 insertion(+), 1 deletion(-) diff --git a/Processors/Z80/Implementation/Z80Storage.cpp b/Processors/Z80/Implementation/Z80Storage.cpp index 3878b3be2..a23aa905e 100644 --- a/Processors/Z80/Implementation/Z80Storage.cpp +++ b/Processors/Z80/Implementation/Z80Storage.cpp @@ -108,7 +108,7 @@ ProcessorStorage::ProcessorStorage() { #define JP(cc) StdInstr(Read16Inc(pc_, memptr_), {MicroOp::cc, nullptr}, {MicroOp::Move16, &memptr_.full, &pc_.full}) #define CALL(cc) StdInstr(ReadInc(pc_, memptr_.halves.low), {MicroOp::cc, conditional_call_untaken_program_.data()}, Read4Inc(pc_, memptr_.halves.high), Push(pc_), {MicroOp::Move16, &memptr_.full, &pc_.full}) #define RET(cc) Instr(6, {MicroOp::cc, nullptr}, Pop(memptr_), {MicroOp::Move16, &memptr_.full, &pc_.full}) -#define JR(cc) StdInstr(ReadInc(pc_, temp8_), {MicroOp::Move16, &pc_.full, &memptr_.full}, {MicroOp::cc, nullptr}, InternalOperation(10), {MicroOp::CalculateIndexAddress, &pc_.full}, {MicroOp::Move16, &memptr_.full, &pc_.full}) +#define JR(cc) StdInstr(ReadInc(pc_, temp8_), {MicroOp::cc, nullptr}, InternalOperation(10), {MicroOp::CalculateIndexAddress, &pc_.full}, {MicroOp::Move16, &memptr_.full, &pc_.full}) #define RST() Instr(6, {MicroOp::CalculateRSTDestination}, Push(pc_), {MicroOp::Move16, &memptr_.full, &pc_.full}) #define LD(a, b) StdInstr({MicroOp::Move8, &b, &a}) From 7058dbc3cc89eac8c797aa13abc0b931a8fb2b20 Mon Sep 17 00:00:00 2001 From: Thomas Harte Date: Wed, 26 Feb 2020 21:54:49 -0500 Subject: [PATCH 18/28] Corrects memptr for LD HL, (nn). --- Processors/Z80/Implementation/Z80Storage.cpp | 2 +- 1 file changed, 1 insertion(+), 1 deletion(-) diff --git a/Processors/Z80/Implementation/Z80Storage.cpp b/Processors/Z80/Implementation/Z80Storage.cpp index a23aa905e..3d53e1513 100644 --- a/Processors/Z80/Implementation/Z80Storage.cpp +++ b/Processors/Z80/Implementation/Z80Storage.cpp @@ -395,7 +395,7 @@ void ProcessorStorage::assemble_base_page(InstructionPage &target, RegisterPair1 /* 0x27 DAA */ StdInstr({MicroOp::DAA}), /* 0x28 JR Z */ JR(TestZ), /* 0x29 ADD HL, HL */ ADD16(index, index), - /* 0x2a LD HL, (nn) */ StdInstr(Read16Inc(pc_, temp16_), Read16(temp16_, index)), + /* 0x2a LD HL, (nn) */ StdInstr(Read16Inc(pc_, memptr_), Read16(memptr_, index)), /* 0x2b DEC HL; 0x2c INC L; 0x2d DEC L; 0x2e LD L, n */ DEC_INC_DEC_LD(index, index.halves.low), From 3b0df172a73dce8bcd961f9247094ba1efe314f6 Mon Sep 17 00:00:00 2001 From: Thomas Harte Date: Wed, 26 Feb 2020 22:02:15 -0500 Subject: [PATCH 19/28] Corrects memptr behaviour of JP nn. --- OSBindings/Mac/Clock SignalTests/FUSETests.swift | 7 +++++++ OSBindings/Mac/Clock SignalTests/PatrikRakTests.swift | 2 +- Processors/Z80/Implementation/Z80Storage.cpp | 2 +- 3 files changed, 9 insertions(+), 2 deletions(-) diff --git a/OSBindings/Mac/Clock SignalTests/FUSETests.swift b/OSBindings/Mac/Clock SignalTests/FUSETests.swift index 3cf824546..9856fc7a3 100644 --- a/OSBindings/Mac/Clock SignalTests/FUSETests.swift +++ b/OSBindings/Mac/Clock SignalTests/FUSETests.swift @@ -172,6 +172,13 @@ class FUSETests: XCTestCase { let name = itemDictionary["name"] as! String + // Provisionally skip the FUSE HALT test. It tests PC during a HALT; this emulator advances + // it only upon interrupt, FUSE seems to increment it and then stay still. I need to find + // out which of those is correct. + if name == "76" { + continue + } + // if name != "10" { // continue; // } diff --git a/OSBindings/Mac/Clock SignalTests/PatrikRakTests.swift b/OSBindings/Mac/Clock SignalTests/PatrikRakTests.swift index c3760f0b2..a10ca73e9 100644 --- a/OSBindings/Mac/Clock SignalTests/PatrikRakTests.swift +++ b/OSBindings/Mac/Clock SignalTests/PatrikRakTests.swift @@ -93,7 +93,7 @@ class PatrikRakTests: XCTestCase, CSTestMachineTrapHandler { func testMemptr() { runTest("z80memptr") - // Current status: 101 of 152 tests failed. + // Current status: 91 of 152 tests failed. } func testMachine(_ testMachine: CSTestMachine, didTrapAtAddress address: UInt16) { diff --git a/Processors/Z80/Implementation/Z80Storage.cpp b/Processors/Z80/Implementation/Z80Storage.cpp index 3d53e1513..841eb626b 100644 --- a/Processors/Z80/Implementation/Z80Storage.cpp +++ b/Processors/Z80/Implementation/Z80Storage.cpp @@ -473,7 +473,7 @@ void ProcessorStorage::assemble_base_page(InstructionPage &target, RegisterPair1 READ_OP_GROUP(CP8), /* 0xc0 RET NZ */ RET(TestNZ), /* 0xc1 POP BC */ StdInstr(Pop(bc_)), - /* 0xc2 JP NZ */ JP(TestNZ), /* 0xc3 JP nn */ StdInstr(Read16(pc_, temp16_), {MicroOp::Move16, &temp16_.full, &pc_.full}), + /* 0xc2 JP NZ */ JP(TestNZ), /* 0xc3 JP nn */ StdInstr(Read16(pc_, memptr_), {MicroOp::Move16, &memptr_.full, &pc_.full}), /* 0xc4 CALL NZ */ CALL(TestNZ), /* 0xc5 PUSH BC */ Instr(6, Push(bc_)), /* 0xc6 ADD A, n */ StdInstr(ReadInc(pc_, temp8_), {MicroOp::ADD8, &temp8_}), /* 0xc7 RST 00h */ RST(), From ec82c075be6cd7419321a7c219ce894afa92a7e2 Mon Sep 17 00:00:00 2001 From: Thomas Harte Date: Wed, 26 Feb 2020 22:19:37 -0500 Subject: [PATCH 20/28] Fixes memptr for IN C, (C). --- .../Z80/Implementation/Z80Implementation.hpp | 14 ++++++++++++-- Processors/Z80/Implementation/Z80Storage.cpp | 2 +- 2 files changed, 13 insertions(+), 3 deletions(-) diff --git a/Processors/Z80/Implementation/Z80Implementation.hpp b/Processors/Z80/Implementation/Z80Implementation.hpp index 517cc57ea..c9c0a58aa 100644 --- a/Processors/Z80/Implementation/Z80Implementation.hpp +++ b/Processors/Z80/Implementation/Z80Implementation.hpp @@ -805,9 +805,19 @@ template < class T, subtract_flag_ = half_carry_result_ = 0; sign_result_ = zero_result_ = bit53_result_ = *static_cast(operation->source); set_parity(sign_result_); - set_did_compute_flags(); // deliberate fallthrough - case MicroOp::SetOutFlags: + set_did_compute_flags(); + if(operation_ == 0xdb) { + // IN A, (n) + memptr_.full = bc_.full + 1; + } else { + // IN r, (C) + // TODO: this surely isn't right? + ++memptr_.full; + } + break; + + case MicroOp::SetOutFlags: memptr_.full = bc_.full + 1; break; diff --git a/Processors/Z80/Implementation/Z80Storage.cpp b/Processors/Z80/Implementation/Z80Storage.cpp index 841eb626b..37cb8db9a 100644 --- a/Processors/Z80/Implementation/Z80Storage.cpp +++ b/Processors/Z80/Implementation/Z80Storage.cpp @@ -244,7 +244,7 @@ void ProcessorStorage::install_default_instruction_set() { } void ProcessorStorage::assemble_ed_page(InstructionPage &target) { -#define IN_C(r) StdInstr(Input(bc_, r), {MicroOp::SetInFlags, &r}) +#define IN_C(r) StdInstr({MicroOp::Move16, &bc_.full, &memptr_.full}, Input(bc_, r), {MicroOp::SetInFlags, &r}) #define OUT_C(r) StdInstr(Output(bc_, r), {MicroOp::SetOutFlags, &r}) #define IN_OUT(r) IN_C(r), OUT_C(r) From 06163165d981a9a2af78c278e94340eca219006a Mon Sep 17 00:00:00 2001 From: Thomas Harte Date: Wed, 26 Feb 2020 22:22:54 -0500 Subject: [PATCH 21/28] Corrects memptr effect of LD rr, (nn). --- Processors/Z80/Implementation/Z80Storage.cpp | 8 ++++---- 1 file changed, 4 insertions(+), 4 deletions(-) diff --git a/Processors/Z80/Implementation/Z80Storage.cpp b/Processors/Z80/Implementation/Z80Storage.cpp index 37cb8db9a..2b0e4b42f 100644 --- a/Processors/Z80/Implementation/Z80Storage.cpp +++ b/Processors/Z80/Implementation/Z80Storage.cpp @@ -259,7 +259,7 @@ void ProcessorStorage::assemble_ed_page(InstructionPage &target) { /* 0x44 NEG */ StdInstr({MicroOp::NEG}), /* 0x45 RETN */ StdInstr(Pop(pc_), {MicroOp::RETN}), /* 0x46 IM 0 */ StdInstr({MicroOp::IM}), /* 0x47 LD I, A */ Instr(6, {MicroOp::Move8, &a_, &ir_.halves.high}), /* 0x48 IN C, (C); 0x49 OUT (C), C */ IN_OUT(bc_.halves.low), - /* 0x4a ADC HL, BC */ ADC16(hl_, bc_), /* 0x4b LD BC, (nn) */ StdInstr(Read16Inc(pc_, temp16_), Read16(temp16_, bc_)), + /* 0x4a ADC HL, BC */ ADC16(hl_, bc_), /* 0x4b LD BC, (nn) */ StdInstr(Read16Inc(pc_, memptr_), Read16(memptr_, bc_)), /* 0x4c NEG */ StdInstr({MicroOp::NEG}), /* 0x4d RETI */ StdInstr(Pop(pc_), {MicroOp::RETN}), /* 0x4e IM 0/1 */ StdInstr({MicroOp::IM}), /* 0x4f LD R, A */ Instr(6, {MicroOp::Move8, &a_, &ir_.halves.low}), /* 0x50 IN D, (C); 0x51 OUT (C), D */ IN_OUT(de_.halves.high), @@ -267,7 +267,7 @@ void ProcessorStorage::assemble_ed_page(InstructionPage &target) { /* 0x54 NEG */ StdInstr({MicroOp::NEG}), /* 0x55 RETN */ StdInstr(Pop(pc_), {MicroOp::RETN}), /* 0x56 IM 1 */ StdInstr({MicroOp::IM}), /* 0x57 LD A, I */ Instr(6, {MicroOp::Move8, &ir_.halves.high, &a_}, {MicroOp::SetAFlags}), /* 0x58 IN E, (C); 0x59 OUT (C), E */ IN_OUT(de_.halves.low), - /* 0x5a ADC HL, DE */ ADC16(hl_, de_), /* 0x5b LD DE, (nn) */ StdInstr(Read16Inc(pc_, temp16_), Read16(temp16_, de_)), + /* 0x5a ADC HL, DE */ ADC16(hl_, de_), /* 0x5b LD DE, (nn) */ StdInstr(Read16Inc(pc_, memptr_), Read16(memptr_, de_)), /* 0x5c NEG */ StdInstr({MicroOp::NEG}), /* 0x5d RETN */ StdInstr(Pop(pc_), {MicroOp::RETN}), /* 0x5e IM 2 */ StdInstr({MicroOp::IM}), /* 0x5f LD A, R */ Instr(6, {MicroOp::Move8, &ir_.halves.low, &a_}, {MicroOp::SetAFlags}), /* 0x60 IN H, (C); 0x61 OUT (C), H */ IN_OUT(hl_.halves.high), @@ -275,7 +275,7 @@ void ProcessorStorage::assemble_ed_page(InstructionPage &target) { /* 0x64 NEG */ StdInstr({MicroOp::NEG}), /* 0x65 RETN */ StdInstr(Pop(pc_), {MicroOp::RETN}), /* 0x66 IM 0 */ StdInstr({MicroOp::IM}), /* 0x67 RRD */ StdInstr(Read3(hl_, temp8_), InternalOperation(8), {MicroOp::RRD}, Write3(hl_, temp8_)), /* 0x68 IN L, (C); 0x69 OUT (C), L */ IN_OUT(hl_.halves.low), - /* 0x6a ADC HL, HL */ ADC16(hl_, hl_), /* 0x6b LD HL, (nn) */ StdInstr(Read16Inc(pc_, temp16_), Read16(temp16_, hl_)), + /* 0x6a ADC HL, HL */ ADC16(hl_, hl_), /* 0x6b LD HL, (nn) */ StdInstr(Read16Inc(pc_, memptr_), Read16(memptr_, hl_)), /* 0x6c NEG */ StdInstr({MicroOp::NEG}), /* 0x6d RETN */ StdInstr(Pop(pc_), {MicroOp::RETN}), /* 0x6e IM 0/1 */ StdInstr({MicroOp::IM}), /* 0x6f RLD */ StdInstr(Read3(hl_, temp8_), InternalOperation(8), {MicroOp::RLD}, Write3(hl_, temp8_)), /* 0x70 IN (C) */ IN_C(temp8_), /* 0x71 OUT (C), 0 */ StdInstr({MicroOp::SetZero}, Output(bc_, temp8_)), @@ -283,7 +283,7 @@ void ProcessorStorage::assemble_ed_page(InstructionPage &target) { /* 0x74 NEG */ StdInstr({MicroOp::NEG}), /* 0x75 RETN */ StdInstr(Pop(pc_), {MicroOp::RETN}), /* 0x76 IM 1 */ StdInstr({MicroOp::IM}), /* 0x77 XX */ NOP, /* 0x78 IN A, (C); 0x79 OUT (C), A */ IN_OUT(a_), - /* 0x7a ADC HL, SP */ ADC16(hl_, sp_), /* 0x7b LD SP, (nn) */ StdInstr(Read16Inc(pc_, temp16_), Read16(temp16_, sp_)), + /* 0x7a ADC HL, SP */ ADC16(hl_, sp_), /* 0x7b LD SP, (nn) */ StdInstr(Read16Inc(pc_, memptr_), Read16(memptr_, sp_)), /* 0x7c NEG */ StdInstr({MicroOp::NEG}), /* 0x7d RETN */ StdInstr(Pop(pc_), {MicroOp::RETN}), /* 0x7e IM 2 */ StdInstr({MicroOp::IM}), /* 0x7f XX */ NOP, NOP_ROW(), /* 0x80 ... 0x8f */ From a366077509264b83dae23100b19b29bb4b602c81 Mon Sep 17 00:00:00 2001 From: Thomas Harte Date: Wed, 26 Feb 2020 22:26:23 -0500 Subject: [PATCH 22/28] Updates failure count. --- OSBindings/Mac/Clock SignalTests/PatrikRakTests.swift | 2 +- 1 file changed, 1 insertion(+), 1 deletion(-) diff --git a/OSBindings/Mac/Clock SignalTests/PatrikRakTests.swift b/OSBindings/Mac/Clock SignalTests/PatrikRakTests.swift index a10ca73e9..c779d06c6 100644 --- a/OSBindings/Mac/Clock SignalTests/PatrikRakTests.swift +++ b/OSBindings/Mac/Clock SignalTests/PatrikRakTests.swift @@ -93,7 +93,7 @@ class PatrikRakTests: XCTestCase, CSTestMachineTrapHandler { func testMemptr() { runTest("z80memptr") - // Current status: 91 of 152 tests failed. + // Current status: 6 of 152 tests failed. } func testMachine(_ testMachine: CSTestMachine, didTrapAtAddress address: UInt16) { From 87474d5916e02269d955b43ed0c9d1bdf5a16c38 Mon Sep 17 00:00:00 2001 From: Thomas Harte Date: Thu, 27 Feb 2020 20:38:27 -0500 Subject: [PATCH 23/28] Corrects memptr behaviour of `OUT (C), 0`. --- .../xcshareddata/xcschemes/Clock Signal.xcscheme | 2 +- OSBindings/Mac/Clock SignalTests/PatrikRakTests.swift | 2 +- Processors/Z80/Implementation/Z80Implementation.hpp | 10 +--------- Processors/Z80/Implementation/Z80Storage.cpp | 4 ++-- 4 files changed, 5 insertions(+), 13 deletions(-) diff --git a/OSBindings/Mac/Clock Signal.xcodeproj/xcshareddata/xcschemes/Clock Signal.xcscheme b/OSBindings/Mac/Clock Signal.xcodeproj/xcshareddata/xcschemes/Clock Signal.xcscheme index 63be2c037..a99eb0a5d 100644 --- a/OSBindings/Mac/Clock Signal.xcodeproj/xcshareddata/xcschemes/Clock Signal.xcscheme +++ b/OSBindings/Mac/Clock Signal.xcodeproj/xcshareddata/xcschemes/Clock Signal.xcscheme @@ -67,7 +67,7 @@ (operation->source); set_parity(sign_result_); set_did_compute_flags(); - - if(operation_ == 0xdb) { - // IN A, (n) - memptr_.full = bc_.full + 1; - } else { - // IN r, (C) - // TODO: this surely isn't right? - ++memptr_.full; - } + ++memptr_.full; break; case MicroOp::SetOutFlags: diff --git a/Processors/Z80/Implementation/Z80Storage.cpp b/Processors/Z80/Implementation/Z80Storage.cpp index 2b0e4b42f..66c13cb62 100644 --- a/Processors/Z80/Implementation/Z80Storage.cpp +++ b/Processors/Z80/Implementation/Z80Storage.cpp @@ -245,7 +245,7 @@ void ProcessorStorage::install_default_instruction_set() { void ProcessorStorage::assemble_ed_page(InstructionPage &target) { #define IN_C(r) StdInstr({MicroOp::Move16, &bc_.full, &memptr_.full}, Input(bc_, r), {MicroOp::SetInFlags, &r}) -#define OUT_C(r) StdInstr(Output(bc_, r), {MicroOp::SetOutFlags, &r}) +#define OUT_C(r) StdInstr(Output(bc_, r), {MicroOp::SetOutFlags}) #define IN_OUT(r) IN_C(r), OUT_C(r) #define NOP_ROW() NOP, NOP, NOP, NOP, NOP, NOP, NOP, NOP, NOP, NOP, NOP, NOP, NOP, NOP, NOP, NOP @@ -278,7 +278,7 @@ void ProcessorStorage::assemble_ed_page(InstructionPage &target) { /* 0x6a ADC HL, HL */ ADC16(hl_, hl_), /* 0x6b LD HL, (nn) */ StdInstr(Read16Inc(pc_, memptr_), Read16(memptr_, hl_)), /* 0x6c NEG */ StdInstr({MicroOp::NEG}), /* 0x6d RETN */ StdInstr(Pop(pc_), {MicroOp::RETN}), /* 0x6e IM 0/1 */ StdInstr({MicroOp::IM}), /* 0x6f RLD */ StdInstr(Read3(hl_, temp8_), InternalOperation(8), {MicroOp::RLD}, Write3(hl_, temp8_)), - /* 0x70 IN (C) */ IN_C(temp8_), /* 0x71 OUT (C), 0 */ StdInstr({MicroOp::SetZero}, Output(bc_, temp8_)), + /* 0x70 IN (C) */ IN_C(temp8_), /* 0x71 OUT (C), 0 */ StdInstr({MicroOp::SetZero}, Output(bc_, temp8_), {MicroOp::SetOutFlags}), /* 0x72 SBC HL, SP */ SBC16(hl_, sp_), /* 0x73 LD (nn), SP */ StdInstr(Read16Inc(pc_, memptr_), Write16(memptr_, sp_)), /* 0x74 NEG */ StdInstr({MicroOp::NEG}), /* 0x75 RETN */ StdInstr(Pop(pc_), {MicroOp::RETN}), /* 0x76 IM 1 */ StdInstr({MicroOp::IM}), /* 0x77 XX */ NOP, From 26de5be07c09890ab6c822f2e9b4056a1429ad9e Mon Sep 17 00:00:00 2001 From: Thomas Harte Date: Thu, 27 Feb 2020 20:44:53 -0500 Subject: [PATCH 24/28] Corrects memptr behaviour of LDIR/LDDR and CPIR/CPDR. --- OSBindings/Mac/Clock SignalTests/PatrikRakTests.swift | 2 +- Processors/Z80/Implementation/Z80Implementation.hpp | 2 +- 2 files changed, 2 insertions(+), 2 deletions(-) diff --git a/OSBindings/Mac/Clock SignalTests/PatrikRakTests.swift b/OSBindings/Mac/Clock SignalTests/PatrikRakTests.swift index 37cf1a20e..381022223 100644 --- a/OSBindings/Mac/Clock SignalTests/PatrikRakTests.swift +++ b/OSBindings/Mac/Clock SignalTests/PatrikRakTests.swift @@ -93,7 +93,7 @@ class PatrikRakTests: XCTestCase, CSTestMachineTrapHandler { func testMemptr() { runTest("z80memptr") - // Current status: 4 of 152 tests failed. + // Current status: 2 of 152 tests failed. } func testMachine(_ testMachine: CSTestMachine, didTrapAtAddress address: UInt16) { diff --git a/Processors/Z80/Implementation/Z80Implementation.hpp b/Processors/Z80/Implementation/Z80Implementation.hpp index 4cc1daf8d..dc2b6582c 100644 --- a/Processors/Z80/Implementation/Z80Implementation.hpp +++ b/Processors/Z80/Implementation/Z80Implementation.hpp @@ -480,8 +480,8 @@ template < class T, #define REPEAT(test) \ if(test) { \ pc_.full -= 2; \ + memptr_.full = pc_.full + 1; \ } else { \ - memptr_.full = pc_.full - 1; \ advance_operation(); \ } From 01faffd5bf533b4f06f236ffdcabe67419bf6626 Mon Sep 17 00:00:00 2001 From: Thomas Harte Date: Thu, 27 Feb 2020 20:55:43 -0500 Subject: [PATCH 25/28] Corrects memptr behaviour of OTIR/OTDR and INIR/INDR. This seemingly perfects memptr. --- .../Mac/Clock SignalTests/PatrikRakTests.swift | 7 ++++--- .../Z80/Implementation/Z80Implementation.hpp | 14 ++++++++++---- 2 files changed, 14 insertions(+), 7 deletions(-) diff --git a/OSBindings/Mac/Clock SignalTests/PatrikRakTests.swift b/OSBindings/Mac/Clock SignalTests/PatrikRakTests.swift index 381022223..0328d23eb 100644 --- a/OSBindings/Mac/Clock SignalTests/PatrikRakTests.swift +++ b/OSBindings/Mac/Clock SignalTests/PatrikRakTests.swift @@ -85,15 +85,16 @@ class PatrikRakTests: XCTestCase, CSTestMachineTrapHandler { runTest("z80docflags") } + func testFlags() { + runTest("z80flags") + } + func testFull() { runTest("z80full") - // Current status: 002 of 152 tests failed. - // Specifically: BIT N,(HL) and BIT N,[R,(HL)], i.e. MEMPTR by proxy. } func testMemptr() { runTest("z80memptr") - // Current status: 2 of 152 tests failed. } func testMachine(_ testMachine: CSTestMachine, didTrapAtAddress address: UInt16) { diff --git a/Processors/Z80/Implementation/Z80Implementation.hpp b/Processors/Z80/Implementation/Z80Implementation.hpp index dc2b6582c..ef2fca726 100644 --- a/Processors/Z80/Implementation/Z80Implementation.hpp +++ b/Processors/Z80/Implementation/Z80Implementation.hpp @@ -553,7 +553,16 @@ template < class T, #undef CPxR_STEP +#undef REPEAT +#define REPEAT(test) \ + if(test) { \ + pc_.full -= 2; \ + } else { \ + advance_operation(); \ + } + #define INxR_STEP(dir) \ + memptr_.full = uint16_t(bc_.full + dir); \ bc_.halves.high--; \ hl_.full += dir; \ \ @@ -586,12 +595,10 @@ template < class T, } break; case MicroOp::IND: { - memptr_.full = bc_.full - 1; INxR_STEP(-1); } break; case MicroOp::INI: { - memptr_.full = bc_.full + 1; INxR_STEP(1); } break; @@ -599,6 +606,7 @@ template < class T, #define OUTxR_STEP(dir) \ bc_.halves.high--; \ + memptr_.full = uint16_t(bc_.full + dir); \ hl_.full += dir; \ \ sign_result_ = zero_result_ = bit53_result_ = bc_.halves.high; \ @@ -622,12 +630,10 @@ template < class T, case MicroOp::OUTD: { OUTxR_STEP(-1); - memptr_.full = bc_.full - 1; } break; case MicroOp::OUTI: { OUTxR_STEP(1); - memptr_.full = bc_.full + 1; } break; #undef OUTxR_STEP From a3569d72014c60f96d3197f107c7143edda917cd Mon Sep 17 00:00:00 2001 From: Thomas Harte Date: Thu, 27 Feb 2020 22:09:56 -0500 Subject: [PATCH 26/28] Corrects so as not to test header. Both Zexall and Zexdoc pass. --- .../xcshareddata/xcschemes/Clock Signal.xcscheme | 8 ++++---- OSBindings/Mac/Clock SignalTests/ZexallTests.swift | 4 ++-- 2 files changed, 6 insertions(+), 6 deletions(-) diff --git a/OSBindings/Mac/Clock Signal.xcodeproj/xcshareddata/xcschemes/Clock Signal.xcscheme b/OSBindings/Mac/Clock Signal.xcodeproj/xcshareddata/xcschemes/Clock Signal.xcscheme index a99eb0a5d..f049730f4 100644 --- a/OSBindings/Mac/Clock Signal.xcodeproj/xcshareddata/xcschemes/Clock Signal.xcscheme +++ b/OSBindings/Mac/Clock Signal.xcodeproj/xcshareddata/xcschemes/Clock Signal.xcscheme @@ -23,9 +23,9 @@ @@ -67,7 +67,7 @@ hl,.... OK\n\r" + "add hl,.......... OK\n\r" + "add ix,.......... OK\n\r" + @@ -127,7 +126,8 @@ class ZexallTests: XCTestCase, CSTestMachineTrapHandler { "ld (+1),a.............. OK\n\r" + "ld (),a................ OK\n\r" + "Tests complete\n\r" - XCTAssertEqual(targetOutput, output); + let successRange = output.range(of: targetOutput) + XCTAssertNotEqual(successRange, nil, output); } } } From 7ac0ea85292515e0732266b66c052583e78115bc Mon Sep 17 00:00:00 2001 From: Thomas Harte Date: Thu, 27 Feb 2020 22:33:18 -0500 Subject: [PATCH 27/28] Corrects test cases, as far as they go. --- .../Clock SignalTests/Z80MemptrTests.swift | 47 ++++++++++++++----- 1 file changed, 35 insertions(+), 12 deletions(-) diff --git a/OSBindings/Mac/Clock SignalTests/Z80MemptrTests.swift b/OSBindings/Mac/Clock SignalTests/Z80MemptrTests.swift index b8941d922..0a8bd65e4 100644 --- a/OSBindings/Mac/Clock SignalTests/Z80MemptrTests.swift +++ b/OSBindings/Mac/Clock SignalTests/Z80MemptrTests.swift @@ -44,7 +44,7 @@ class Z80MemptrTester: XCTestCase { let result = test(program: program, initialValue: expectedResult) XCTAssertEqual(result, expectedResult, "Failed for opcode \(String(opcode, radix:16))") - // One failure will do. + // One failure per opcode will do. if result != expectedResult { break } @@ -72,6 +72,7 @@ class Z80MemptrTester: XCTestCase { 0x22, // LD (nn), HL 0x28, // JR Z 0x29, // ADD HL, HL + 0x2a, // LD HL, (nn) 0x30, // JR NC 0x32, // LD (nn), A 0x38, // JR C @@ -87,29 +88,47 @@ class Z80MemptrTester: XCTestCase { func testEDPageOthers() { testPage(0xed, exclusions: [ + 0x40, // IN B, (C) + 0x41, // OUT (C), B 0x42, // SBC HL, BC 0x43, // LD (nn), HL 0x45, // RETN (??) + 0x48, // IN C, (C) + 0x49, // OUT (C), C 0x4a, // ADC HL, BC + 0x4b, // LD BC, (nn) 0x4d, // RETI + 0x50, // IN D, (C) + 0x51, // OUT (C), D 0x52, // SBC HL, DE 0x53, // LD (nn), DE 0x55, // RETN (??) + 0x58, // IN E, (C) + 0x59, // OUT (C), E 0x5a, // ADC HL, DE + 0x5b, // LD DE, (nn) 0x5d, // RETN (??) + 0x60, // IN H, (C) + 0x61, // OUT (C), H 0x62, // SBC HL, HL 0x63, // LD (nn), HL 0x65, // RETN (??) 0x67, // RRD + 0x68, // IN L, (C) + 0x69, // OUT (C), L 0x6a, // ADC HL, HL + 0x6b, // LD HL, (nn) 0x6d, // RETN (??) 0x6f, // RLD + 0x70, // IN (C) + 0x71, // OUT (C), 0 0x72, // SBC HL, SP 0x73, // LD (nn), SP 0x75, // RETN (??) 0x78, // IN A, (C) 0x79, // OUT (C), A 0x7a, // ADC HL, SP + 0x7b, // LD SP, (nn) 0x7d, // RETN (??) 0xa1, // CPI 0xa2, // INI @@ -117,10 +136,14 @@ class Z80MemptrTester: XCTestCase { 0xa9, // CPD 0xaa, // IND 0xab, // OUTD + 0xb0, // LDIR 0xb1, // CPIR + 0xb2, // INIR 0xb3, // OUIR + 0xb8, // LDDR 0xb9, // CPDR - 0xbb // OTDR + 0xba, // INDR + 0xbb, // OTDR ]) // testPage(0xcb, exclusions: []) // testPage(0xdd, exclusions: []) @@ -391,7 +414,7 @@ class Z80MemptrTester: XCTestCase { } func testJRcc() { - func testJR(instruction: UInt8) { + func testJR(instruction: UInt8, shouldPass: Bool) { var program: [UInt8] = [ instruction, 0x00 ] @@ -399,37 +422,37 @@ class Z80MemptrTester: XCTestCase { for offset in 0 ..< 256 { program[1] = UInt8(offset) let result = test(program: program, initialValue: 0xffff) - XCTAssertEqual(result, machine.value(for: .programCounter)) + XCTAssertEqual(result, shouldPass ? machine.value(for: .programCounter) : 0xffff) } } // JR NZ. machine.setValue(0x00, for: .AF) - testJR(instruction: 0x20) + testJR(instruction: 0x20, shouldPass: true) machine.setValue(0xff, for: .AF) - testJR(instruction: 0x20) + testJR(instruction: 0x20, shouldPass: false) // JR NC machine.setValue(0x00, for: .AF) - testJR(instruction: 0x30) + testJR(instruction: 0x30, shouldPass: true) machine.setValue(0xff, for: .AF) - testJR(instruction: 0x30) + testJR(instruction: 0x30, shouldPass: false) // JR Z machine.setValue(0x00, for: .AF) - testJR(instruction: 0x28) + testJR(instruction: 0x28, shouldPass: false) machine.setValue(0xff, for: .AF) - testJR(instruction: 0x28) + testJR(instruction: 0x28, shouldPass: true) // JR C machine.setValue(0x00, for: .AF) - testJR(instruction: 0x38) + testJR(instruction: 0x38, shouldPass: false) machine.setValue(0xff, for: .AF) - testJR(instruction: 0x38) + testJR(instruction: 0x38, shouldPass: true) } func testRST() { From 3f64cdaff836f5c7406b3de7835c2dc993355742 Mon Sep 17 00:00:00 2001 From: Thomas Harte Date: Thu, 27 Feb 2020 22:33:34 -0500 Subject: [PATCH 28/28] Improves documentation. --- .../Mac/Clock SignalTests/ZexallTests.swift | 18 ++++++++++-------- 1 file changed, 10 insertions(+), 8 deletions(-) diff --git a/OSBindings/Mac/Clock SignalTests/ZexallTests.swift b/OSBindings/Mac/Clock SignalTests/ZexallTests.swift index b1ea0a952..714a571bb 100644 --- a/OSBindings/Mac/Clock SignalTests/ZexallTests.swift +++ b/OSBindings/Mac/Clock SignalTests/ZexallTests.swift @@ -18,31 +18,32 @@ class ZexallTests: XCTestCase, CSTestMachineTrapHandler { if let filename = Bundle(for: type(of: self)).path(forResource: name, ofType: "com") { if let testData = try? Data(contentsOf: URL(fileURLWithPath: filename)) { - // install test program, at the usual CP/M place + // Install test program, at the usual CP/M place. let machine = CSTestMachineZ80() machine.setData(testData, atAddress: 0x0100) - // add a RET at the CP/M entry location, and establish it as a trap location + // Add a RET at the CP/M entry location, set a high memtop, and + // and establish the entry location as a trap location. machine.setValue(0xc9, atAddress: 0x0005) machine.setValue(0xff, atAddress: 0x0006) machine.setValue(0xff, atAddress: 0x0007) machine.addTrapAddress(0x0005); machine.trapHandler = self - // establish 0 as another trap location, as RST 0h is one of the ways that - // CP/M programs can exit + // Establish 0 as another trap location, as RST 0h is one of the ways that + // CP/M programs can exit. machine.addTrapAddress(0); - // ensure that if the CPU hits zero, it stays there until the end of the - // sampling window + // Ensure that if the CPU hits zero, it stays there until the end of the + // sampling window. machine.setValue(0xc3, atAddress: 0x0000) machine.setValue(0x00, atAddress: 0x0001) machine.setValue(0x00, atAddress: 0x0002) - // seed execution at 0x0100 + // Seed execution at 0x0100. machine.setValue(0x0100, for: .programCounter) - // run! + // Run! let cyclesPerIteration: Int32 = 400_000_000 var cyclesToDate: TimeInterval = 0 let startDate = Date() @@ -144,6 +145,7 @@ class ZexallTests: XCTestCase, CSTestMachineTrapHandler { let testMachineZ80 = testMachine as! CSTestMachineZ80 switch address { case 0x0005: + // Only the output text CP/M calls are implemented. let cRegister = testMachineZ80.value(for: .C) var textToAppend = "" switch cRegister {