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|GR8RAM
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C25M => SA[0]~reg0.CLK
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C25M => SA[1]~reg0.CLK
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C25M => SA[2]~reg0.CLK
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C25M => SA[3]~reg0.CLK
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C25M => SA[4]~reg0.CLK
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C25M => SA[5]~reg0.CLK
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|
C25M => SA[6]~reg0.CLK
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|
C25M => SA[7]~reg0.CLK
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|
C25M => SA[8]~reg0.CLK
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|
C25M => SA[9]~reg0.CLK
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|
C25M => SA[10]~reg0.CLK
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|
C25M => SA[11]~reg0.CLK
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|
C25M => SA[12]~reg0.CLK
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|
C25M => SBA[0]~reg0.CLK
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C25M => SBA[1]~reg0.CLK
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|
C25M => DQMH~reg0.CLK
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|
C25M => DQML~reg0.CLK
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|
C25M => SDOE.CLK
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C25M => nSWE~reg0.CLK
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C25M => nCAS~reg0.CLK
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C25M => nRAS~reg0.CLK
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|
C25M => nRCS~reg0.CLK
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|
C25M => RCKE~reg0.CLK
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|
C25M => WRD[0].CLK
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C25M => WRD[1].CLK
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|
C25M => WRD[2].CLK
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C25M => WRD[3].CLK
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C25M => WRD[4].CLK
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C25M => WRD[5].CLK
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|
C25M => WRD[6].CLK
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|
C25M => WRD[7].CLK
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|
C25M => MOSIout.CLK
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|
C25M => MOSIOE.CLK
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|
C25M => nFCS~reg0.CLK
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|
C25M => FCKout.CLK
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|
C25M => RestoreDone.CLK
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|
C25M => Bank.CLK
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|
C25M => AddrIncH.CLK
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|
C25M => AddrIncM.CLK
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|
C25M => AddrIncL.CLK
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C25M => Addr[0].CLK
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C25M => Addr[1].CLK
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|
C25M => Addr[2].CLK
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|
C25M => Addr[3].CLK
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|
C25M => Addr[4].CLK
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|
C25M => Addr[5].CLK
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|
C25M => Addr[6].CLK
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|
C25M => Addr[7].CLK
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|
C25M => Addr[8].CLK
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|
C25M => Addr[9].CLK
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|
C25M => Addr[10].CLK
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|
C25M => Addr[11].CLK
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|
C25M => Addr[12].CLK
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|
C25M => Addr[13].CLK
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|
C25M => Addr[14].CLK
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|
C25M => Addr[15].CLK
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|
C25M => Addr[16].CLK
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|
C25M => Addr[17].CLK
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|
C25M => Addr[18].CLK
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|
C25M => Addr[19].CLK
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|
C25M => Addr[20].CLK
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|
C25M => Addr[21].CLK
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|
C25M => Addr[22].CLK
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|
C25M => Addr[23].CLK
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|
C25M => IOROMEN.CLK
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|
C25M => nIOSTRBr.CLK
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|
C25M => REGEN.CLK
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|
C25M => nRESout~reg0.CLK
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|
C25M => LS[0].CLK
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|
C25M => LS[1].CLK
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|
C25M => LS[2].CLK
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|
C25M => LS[3].CLK
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|
C25M => LS[4].CLK
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|
C25M => LS[5].CLK
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|
C25M => LS[6].CLK
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|
C25M => LS[7].CLK
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|
C25M => LS[8].CLK
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|
C25M => LS[9].CLK
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|
C25M => LS[10].CLK
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|
C25M => LS[11].CLK
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|
C25M => LS[12].CLK
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|
C25M => LS[13].CLK
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|
C25M => PS[0].CLK
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|
C25M => PS[1].CLK
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|
C25M => PS[2].CLK
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|
C25M => PS[3].CLK
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|
C25M => nRESr.CLK
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|
C25M => nRESf[0].CLK
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|
C25M => nRESf[1].CLK
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|
C25M => nRESf[2].CLK
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|
C25M => nRESf[3].CLK
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|
C25M => PHI0r2.CLK
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|
C25M => PHI0r1.CLK
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|
C25M => IS~7.DATAIN
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|
C25M => RDD[0].CLK
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|
C25M => RDD[1].CLK
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|
C25M => RDD[2].CLK
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|
C25M => RDD[3].CLK
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|
C25M => RDD[4].CLK
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|
C25M => RDD[5].CLK
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|
C25M => RDD[6].CLK
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|
C25M => RDD[7].CLK
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|
PHI0 => comb.IN1
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PHI0 => nWEr.CLK
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|
PHI0 => RAr[0].CLK
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|
PHI0 => RAr[1].CLK
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|
PHI0 => RAr[2].CLK
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|
PHI0 => RAr[3].CLK
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|
PHI0 => RAr[4].CLK
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|
PHI0 => RAr[5].CLK
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|
PHI0 => RAr[6].CLK
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|
PHI0 => RAr[7].CLK
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|
PHI0 => RAr[8].CLK
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|
PHI0 => RAr[9].CLK
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|
PHI0 => RAr[10].CLK
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|
PHI0 => RAr[11].CLK
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|
PHI0 => CXXXr.CLK
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|
PHI0 => PHI0r1.DATAIN
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|
nRES => MOSIout.OUTPUTSELECT
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|
nRES => nRESf[0].DATAIN
|
|
nRESout <= nRESout~reg0.DB_MAX_OUTPUT_PORT_TYPE
|
|
SetFW[0] => ~NO_FANOUT~
|
|
SetFW[1] => ~NO_FANOUT~
|
|
INTin => INTout.DATAIN
|
|
INTout <= INTin.DB_MAX_OUTPUT_PORT_TYPE
|
|
DMAin => DMAout.DATAIN
|
|
DMAout <= DMAin.DB_MAX_OUTPUT_PORT_TYPE
|
|
nNMIout <= <VCC>
|
|
nIRQout <= <VCC>
|
|
nRDYout <= <VCC>
|
|
nINHout <= <VCC>
|
|
RWout <= <VCC>
|
|
nDMAout <= <VCC>
|
|
RA[0] => RAr[0].DATAIN
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RA[0] => Equal17.IN10
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RA[1] => RAr[1].DATAIN
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RA[1] => Equal17.IN9
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RA[2] => RAr[2].DATAIN
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|
RA[2] => Equal17.IN8
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RA[3] => RAr[3].DATAIN
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|
RA[3] => Equal17.IN7
|
|
RA[4] => RAr[4].DATAIN
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|
RA[4] => Equal17.IN6
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|
RA[5] => RAr[5].DATAIN
|
|
RA[5] => Equal17.IN5
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|
RA[6] => RAr[6].DATAIN
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|
RA[6] => Equal17.IN4
|
|
RA[7] => RAr[7].DATAIN
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|
RA[7] => Equal17.IN3
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|
RA[8] => RAr[8].DATAIN
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|
RA[8] => Equal17.IN2
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|
RA[9] => RAr[9].DATAIN
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|
RA[9] => Equal17.IN1
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|
RA[10] => RAr[10].DATAIN
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|
RA[10] => Equal17.IN0
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|
RA[11] => RAr[11].DATAIN
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|
RA[12] => Equal7.IN1
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|
RA[13] => Equal7.IN0
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|
RA[14] => Equal7.IN3
|
|
RA[15] => Equal7.IN2
|
|
nWE => comb.IN1
|
|
nWE => nWEr.DATAIN
|
|
RD[0] <> RD[0]
|
|
RD[1] <> RD[1]
|
|
RD[2] <> RD[2]
|
|
RD[3] <> RD[3]
|
|
RD[4] <> RD[4]
|
|
RD[5] <> RD[5]
|
|
RD[6] <> RD[6]
|
|
RD[7] <> RD[7]
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|
RAdir <= <VCC>
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RDdir <= comb.DB_MAX_OUTPUT_PORT_TYPE
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nIOSEL => SA.OUTPUTSELECT
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nIOSEL => comb.IN0
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nIOSEL => always6.IN1
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nDEVSEL => comb.IN1
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|
nDEVSEL => RAMSEL.IN1
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|
nDEVSEL => FCKout.IN1
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|
nDEVSEL => comb.IN1
|
|
nDEVSEL => RAMRegSEL.IN1
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|
nIOSTRB => nIOSTRBr.DATAIN
|
|
nIOSTRB => comb.IN1
|
|
nIOSTRB => comb.IN1
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|
SBA[0] <= SBA[0]~reg0.DB_MAX_OUTPUT_PORT_TYPE
|
|
SBA[1] <= SBA[1]~reg0.DB_MAX_OUTPUT_PORT_TYPE
|
|
SA[0] <= SA[0]~reg0.DB_MAX_OUTPUT_PORT_TYPE
|
|
SA[1] <= SA[1]~reg0.DB_MAX_OUTPUT_PORT_TYPE
|
|
SA[2] <= SA[2]~reg0.DB_MAX_OUTPUT_PORT_TYPE
|
|
SA[3] <= SA[3]~reg0.DB_MAX_OUTPUT_PORT_TYPE
|
|
SA[4] <= SA[4]~reg0.DB_MAX_OUTPUT_PORT_TYPE
|
|
SA[5] <= SA[5]~reg0.DB_MAX_OUTPUT_PORT_TYPE
|
|
SA[6] <= SA[6]~reg0.DB_MAX_OUTPUT_PORT_TYPE
|
|
SA[7] <= SA[7]~reg0.DB_MAX_OUTPUT_PORT_TYPE
|
|
SA[8] <= SA[8]~reg0.DB_MAX_OUTPUT_PORT_TYPE
|
|
SA[9] <= SA[9]~reg0.DB_MAX_OUTPUT_PORT_TYPE
|
|
SA[10] <= SA[10]~reg0.DB_MAX_OUTPUT_PORT_TYPE
|
|
SA[11] <= SA[11]~reg0.DB_MAX_OUTPUT_PORT_TYPE
|
|
SA[12] <= SA[12]~reg0.DB_MAX_OUTPUT_PORT_TYPE
|
|
nRCS <= nRCS~reg0.DB_MAX_OUTPUT_PORT_TYPE
|
|
nRAS <= nRAS~reg0.DB_MAX_OUTPUT_PORT_TYPE
|
|
nCAS <= nCAS~reg0.DB_MAX_OUTPUT_PORT_TYPE
|
|
nSWE <= nSWE~reg0.DB_MAX_OUTPUT_PORT_TYPE
|
|
DQML <= DQML~reg0.DB_MAX_OUTPUT_PORT_TYPE
|
|
DQMH <= DQMH~reg0.DB_MAX_OUTPUT_PORT_TYPE
|
|
RCKE <= RCKE~reg0.DB_MAX_OUTPUT_PORT_TYPE
|
|
SD[0] <> SD[0]
|
|
SD[1] <> SD[1]
|
|
SD[2] <> SD[2]
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|
SD[3] <> SD[3]
|
|
SD[4] <> SD[4]
|
|
SD[5] <> SD[5]
|
|
SD[6] <> SD[6]
|
|
SD[7] <> SD[7]
|
|
nFCS <= nFCS~reg0.DB_MAX_OUTPUT_PORT_TYPE
|
|
FCK <= FCKout.DB_MAX_OUTPUT_PORT_TYPE
|
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MISO => WRD.DATAB
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MISO => RDD.DATAB
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MOSI <> MOSI
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