mirror of
https://github.com/garrettsworkshop/GR8RAM.git
synced 2024-05-28 14:41:27 +00:00
165 lines
15 KiB
Plaintext
Executable File
165 lines
15 KiB
Plaintext
Executable File
-- Copyright (C) 1991-2013 Altera Corporation
|
|
-- Your use of Altera Corporation's design tools, logic functions
|
|
-- and other software and tools, and its AMPP partner logic
|
|
-- functions, and any output files from any of the foregoing
|
|
-- (including device programming or simulation files), and any
|
|
-- associated documentation or information are expressly subject
|
|
-- to the terms and conditions of the Altera Program License
|
|
-- Subscription Agreement, Altera MegaCore Function License
|
|
-- Agreement, or other applicable license agreement, including,
|
|
-- without limitation, that your use is for the sole purpose of
|
|
-- programming logic devices manufactured by Altera and sold by
|
|
-- Altera or its authorized distributors. Please refer to the
|
|
-- applicable agreement for further details.
|
|
--
|
|
-- This is a Quartus II output file. It is for reporting purposes only, and is
|
|
-- not intended for use as a Quartus II input file. This file cannot be used
|
|
-- to make Quartus II pin assignments - for instructions on how to make pin
|
|
-- assignments, please see Quartus II help.
|
|
---------------------------------------------------------------------------------
|
|
|
|
|
|
|
|
---------------------------------------------------------------------------------
|
|
-- NC : No Connect. This pin has no internal connection to the device.
|
|
-- DNU : Do Not Use. This pin MUST NOT be connected.
|
|
-- VCCINT : Dedicated power pin, which MUST be connected to VCC (2.5V/3.3V).
|
|
-- VCCIO : Dedicated power pin, which MUST be connected to VCC
|
|
-- of its bank.
|
|
-- Bank 1: 3.3V
|
|
-- Bank 2: 3.3V
|
|
-- GND : Dedicated ground pin. Dedicated GND pins MUST be connected to GND.
|
|
-- It can also be used to report unused dedicated pins. The connection
|
|
-- on the board for unused dedicated pins depends on whether this will
|
|
-- be used in a future design. One example is device migration. When
|
|
-- using device migration, refer to the device pin-tables. If it is a
|
|
-- GND pin in the pin table or if it will not be used in a future design
|
|
-- for another purpose the it MUST be connected to GND. If it is an unused
|
|
-- dedicated pin, then it can be connected to a valid signal on the board
|
|
-- (low, high, or toggling) if that signal is required for a different
|
|
-- revision of the design.
|
|
-- GND+ : Unused input pin. It can also be used to report unused dual-purpose pins.
|
|
-- This pin should be connected to GND. It may also be connected to a
|
|
-- valid signal on the board (low, high, or toggling) if that signal
|
|
-- is required for a different revision of the design.
|
|
-- GND* : Unused I/O pin. Connect each pin marked GND* directly to GND
|
|
-- or leave it unconnected.
|
|
-- RESERVED : Unused I/O pin, which MUST be left unconnected.
|
|
-- RESERVED_INPUT : Pin is tri-stated and should be connected to the board.
|
|
-- RESERVED_INPUT_WITH_WEAK_PULLUP : Pin is tri-stated with internal weak pull-up resistor.
|
|
-- RESERVED_INPUT_WITH_BUS_HOLD : Pin is tri-stated with bus-hold circuitry.
|
|
-- RESERVED_OUTPUT_DRIVEN_HIGH : Pin is output driven high.
|
|
---------------------------------------------------------------------------------
|
|
|
|
|
|
|
|
---------------------------------------------------------------------------------
|
|
-- Pin directions (input, output or bidir) are based on device operating in user mode.
|
|
---------------------------------------------------------------------------------
|
|
|
|
Quartus II 32-bit Version 13.0.1 Build 232 06/12/2013 Service Pack 1 SJ Web Edition
|
|
CHIP "GR8RAM" ASSIGNED TO AN: EPM240T100C5
|
|
|
|
Pin Name/Usage : Location : Dir. : I/O Standard : Voltage : I/O Bank : User Assignment
|
|
-------------------------------------------------------------------------------------------------------------
|
|
SA[0] : 1 : output : 3.3-V LVTTL : : 2 : N
|
|
GND* : 2 : : : : 1 :
|
|
SA[8] : 3 : output : 3.3-V LVTTL : : 1 : N
|
|
SA[2] : 4 : output : 3.3-V LVTTL : : 1 : N
|
|
RAdir : 5 : output : 3.3-V LVTTL : : 1 : N
|
|
SD[5] : 6 : bidir : 3.3-V LVTTL : : 1 : N
|
|
SD[4] : 7 : bidir : 3.3-V LVTTL : : 1 : N
|
|
SD[1] : 8 : bidir : 3.3-V LVTTL : : 1 : N
|
|
VCCIO1 : 9 : power : : 3.3V : 1 :
|
|
GNDIO : 10 : gnd : : : :
|
|
GNDINT : 11 : gnd : : : :
|
|
RA[3] : 12 : input : 3.3-V LVTTL : : 1 : N
|
|
VCCINT : 13 : power : : 2.5V/3.3V : :
|
|
C25M : 14 : input : 3.3-V LVTTL : : 1 : N
|
|
RA[5] : 15 : input : 3.3-V LVTTL : : 1 : N
|
|
RA[2] : 16 : input : 3.3-V LVTTL : : 1 : N
|
|
RA[0] : 17 : input : 3.3-V LVTTL : : 1 : N
|
|
SD[6] : 18 : bidir : 3.3-V LVTTL : : 1 : N
|
|
nRESout : 19 : output : 3.3-V LVTTL : : 1 : N
|
|
SD[7] : 20 : bidir : 3.3-V LVTTL : : 1 : N
|
|
MOSI : 21 : output : 3.3-V LVTTL : : 1 : N
|
|
TMS : 22 : input : : : 1 :
|
|
TDI : 23 : input : : : 1 :
|
|
TCK : 24 : input : : : 1 :
|
|
TDO : 25 : output : : : 1 :
|
|
SD[3] : 26 : bidir : 3.3-V LVTTL : : 1 : N
|
|
SD[2] : 27 : bidir : 3.3-V LVTTL : : 1 : N
|
|
MISO : 28 : input : 3.3-V LVTTL : : 1 : N
|
|
SD[0] : 29 : bidir : 3.3-V LVTTL : : 1 : N
|
|
FCK : 30 : output : 3.3-V LVTTL : : 1 : N
|
|
VCCIO1 : 31 : power : : 3.3V : 1 :
|
|
GNDIO : 32 : gnd : : : :
|
|
RA[8] : 33 : input : 3.3-V LVTTL : : 1 : N
|
|
RA[10] : 34 : input : 3.3-V LVTTL : : 1 : N
|
|
RA[7] : 35 : input : 3.3-V LVTTL : : 1 : N
|
|
RA[4] : 36 : input : 3.3-V LVTTL : : 1 : N
|
|
RA[9] : 37 : input : 3.3-V LVTTL : : 1 : N
|
|
RA[1] : 38 : input : 3.3-V LVTTL : : 1 : N
|
|
RA[11] : 39 : input : 3.3-V LVTTL : : 1 : N
|
|
GND* : 40 : : : : 1 :
|
|
GND* : 41 : : : : 1 :
|
|
SA[11] : 42 : output : 3.3-V LVTTL : : 1 : N
|
|
nFCS : 43 : output : 3.3-V LVTTL : : 1 : N
|
|
SA[12] : 44 : output : 3.3-V LVTTL : : 1 : N
|
|
VCCIO1 : 45 : power : : 3.3V : 1 :
|
|
GNDIO : 46 : gnd : : : :
|
|
GND* : 47 : : : : 1 :
|
|
DQMH : 48 : output : 3.3-V LVTTL : : 1 : N
|
|
GND* : 49 : : : : 1 :
|
|
GND* : 50 : : : : 1 :
|
|
GND* : 51 : : : : 1 :
|
|
SA[9] : 52 : output : 3.3-V LVTTL : : 2 : N
|
|
GND* : 53 : : : : 2 :
|
|
SA[4] : 54 : output : 3.3-V LVTTL : : 2 : N
|
|
SA[10] : 55 : output : 3.3-V LVTTL : : 2 : N
|
|
GND* : 56 : : : : 2 :
|
|
RA[13] : 57 : input : 3.3-V LVTTL : : 2 : N
|
|
RA[12] : 58 : input : 3.3-V LVTTL : : 2 : N
|
|
VCCIO2 : 59 : power : : 3.3V : 2 :
|
|
GNDIO : 60 : gnd : : : :
|
|
RA[14] : 61 : input : 3.3-V LVTTL : : 2 : N
|
|
RA[15] : 62 : input : 3.3-V LVTTL : : 2 : N
|
|
VCCINT : 63 : power : : 2.5V/3.3V : :
|
|
nIOSTRB : 64 : input : 3.3-V LVTTL : : 2 : N
|
|
GNDINT : 65 : gnd : : : :
|
|
DQML : 66 : output : 3.3-V LVTTL : : 2 : N
|
|
nDEVSEL : 67 : input : 3.3-V LVTTL : : 2 : N
|
|
SBA[1] : 68 : output : 3.3-V LVTTL : : 2 : N
|
|
nRAS : 69 : output : 3.3-V LVTTL : : 2 : N
|
|
RCKE : 70 : output : 3.3-V LVTTL : : 2 : N
|
|
nIOSEL : 71 : input : 3.3-V LVTTL : : 2 : N
|
|
PHI0 : 72 : input : 3.3-V LVTTL : : 2 : N
|
|
nRES : 73 : input : 3.3-V LVTTL : : 2 : N
|
|
nWE : 74 : input : 3.3-V LVTTL : : 2 : N
|
|
RDdir : 75 : output : 3.3-V LVTTL : : 2 : N
|
|
GND* : 76 : : : : 2 :
|
|
SA[5] : 77 : output : 3.3-V LVTTL : : 2 : N
|
|
GND* : 78 : : : : 2 :
|
|
GNDIO : 79 : gnd : : : :
|
|
VCCIO2 : 80 : power : : 3.3V : 2 :
|
|
SA[7] : 81 : output : 3.3-V LVTTL : : 2 : N
|
|
nSWE : 82 : output : 3.3-V LVTTL : : 2 : N
|
|
nCAS : 83 : output : 3.3-V LVTTL : : 2 : N
|
|
nRCS : 84 : output : 3.3-V LVTTL : : 2 : N
|
|
RD[2] : 85 : bidir : 3.3-V LVTTL : : 2 : N
|
|
SBA[0] : 86 : output : 3.3-V LVTTL : : 2 : N
|
|
RD[7] : 87 : bidir : 3.3-V LVTTL : : 2 : N
|
|
SA[3] : 88 : output : 3.3-V LVTTL : : 2 : N
|
|
RD[6] : 89 : bidir : 3.3-V LVTTL : : 2 : N
|
|
RD[1] : 90 : bidir : 3.3-V LVTTL : : 2 : N
|
|
RA[6] : 91 : input : 3.3-V LVTTL : : 2 : N
|
|
RD[0] : 92 : bidir : 3.3-V LVTTL : : 2 : N
|
|
GNDIO : 93 : gnd : : : :
|
|
VCCIO2 : 94 : power : : 3.3V : 2 :
|
|
RD[4] : 95 : bidir : 3.3-V LVTTL : : 2 : N
|
|
RD[3] : 96 : bidir : 3.3-V LVTTL : : 2 : N
|
|
RD[5] : 97 : bidir : 3.3-V LVTTL : : 2 : N
|
|
SA[6] : 98 : output : 3.3-V LVTTL : : 2 : N
|
|
GND* : 99 : : : : 2 :
|
|
SA[1] : 100 : output : 3.3-V LVTTL : : 2 : N
|