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2022-03-29 04:23:54 -04:00

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Will use the default filename of 'WarpSE.ise'.INFO:Cpld - Inferring BUFG constraint for signal 'CLK2X_IOB' based upon the LOC constraint 'P22'. It is recommended that you declare this BUFG explicitedly in your design. Note that for certain device families the output of a BUFG constraint can not drive a gated clock, and the BUFG constraint will be ignored.INFO:Cpld - Inferring BUFG constraint for signal 'CLK_FSB' based upon the LOC constraint 'P27'. It is recommended that you declare this BUFG explicitedly in your design. Note that for certain device families the output of a BUFG constraint can not drive a gated clock, and the BUFG constraint will be ignored.INFO:Cpld - Inferring BUFG constraint for signal 'CLK_IOB' based upon the LOC constraint 'P23'. It is recommended that you declare this BUFG explicitedly in your design. Note that for certain device families the output of a BUFG constraint can not drive a gated clock, and the BUFG constraint will be ignored.</warning><warning>Cpld:1007 - Removing unused input(s) 'SW&lt;2&gt;'. The input(s) are unused after optimization. Please verify functionality via simulation.</warning></messages><compOpts exhaust="OFF" gclkopt="ON" gsropt="ON" gtsopt="ON" ignorets="OFF" inputs="54" keepio="OFF" loc="ON" mlopt="ON" optimize="SPEED" part="xc95144xl-10-TQ100" power="STD" prld="LOW" pterms="50" slew="FAST" terminate="KEEPER" unused="OFF" wysiwyg="OFF"/><specSig signal="A_FSB9_SPECSIG" value="A_FSB&lt;9&gt;"/><specSig signal="A_FSB8_SPECSIG" value="A_FSB&lt;8&gt;"/><specSig signal="A_FSB15_SPECSIG" value="A_FSB&lt;15&gt;"/><specSig signal="A_FSB14_SPECSIG" value="A_FSB&lt;14&gt;"/><specSig signal="A_FSB13_SPECSIG" value="A_FSB&lt;13&gt;"/><specSig signal="A_FSB12_SPECSIG" value="A_FSB&lt;12&gt;"/><specSig signal="A_FSB11_SPECSIG" value="A_FSB&lt;11&gt;"/><specSig signal="A_FSB10_SPECSIG" value="A_FSB&lt;10&gt;"/><specSig signal="A_FSB23_SPECSIG" value="A_FSB&lt;23&gt;"/><specSig signal="A_FSB22_SPECSIG" value="A_FSB&lt;22&gt;"/><specSig signal="A_FSB21_SPECSIG" value="A_FSB&lt;21&gt;"/><specSig signal="A_FSB20_SPECSIG" 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